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Forum: FPGA, VHDL & Co. Problem mit der Initialisierung eines Arrays von std_logic_vector


Autor: Hans-Werner (Gast)
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Ich habe mit der Initialisierung folgenden Arrays ein "klitzekleines" 
Problem. Habe hier im Forum keine passende Antwort gefunden. ISE fügt 
Latches ein da keine Initialisierung vorliegt mit dem Hinweis das diese 
wieder herausoptimiert werden. Erhalte jedenfalls eine Unmenge von 
Warnings.

type rotor_array is array(0 TO 2 ** address_width - 1) of 
std_logic_vector(0 to data_width - 1);

Sowohl address_width als auch data_width sind generisch.
Geht das nur über eine for-Schleife für die einzelnen Elemente ?

Danke

Autor: Kippis (Gast)
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Du kannst Dein Array z.B. so mit Nullen initialisieren:
signal rotor1 : rotor_array (array_width downto 0) := (others => (others 
=> '0'));

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