Forum: FPGA, VHDL & Co. reg und wire


reg und wire
von Markus (Gast)

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Hallo,

was istder Unterschied zwischen reg und wire in Verilog?

Markus

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Re: reg und wire
von lkmiller (Gast)

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Wie der Name schon sagt:
Ein wire ist nur eine Verbindung und kann nichts speichern.
Ein reg ist ein Register und kann sich Werte merken.

Schau genau:
http://www.doulos.com/knowhow/verilog_designers_guide/synthesizing_latches/

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Re: reg und wire
von Günter -. (guenter)

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... oder im Verilog Artikel unter 
http://www.mikrocontroller.net/articles/Verilog#Datentypen:_wire.2C_reg

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