Forum: Mikrocontroller und Digitale Elektronik JK-Flip Flop


JK-Flip Flop
von Klaus H. (madmax22222)

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Verständnisproblem


Dem Datenblatt eines JK-Flip-Flops wurde die folgende Tabelle entnommen:
Datenblatt als anhang.
wie sind hir die ein- und ausgangsseitigen Lastfaktoren
und Strömen aller Ein- und Ausgänge?

Welche Anzahl von RDO-Eingängen kann ein Q-Ausgang versorgen,
wenn bereits 10 Standardlasten angeschlossen sind und am Ausgang keine
Überlastung auftreten soll?

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Re: JK-Flip Flop
von Yagan Ζ. D. (yagan)

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Klaus,

diese Abschrift des Datenblatts ist fehlerhaft,
fanOut für Q0, Q1 muss lauten 50/33 (HIGH/LOW) für 1.8/20mA.

Ein Q-Ausgang kann also insgesamt 11 RD0-Eingänge treiben (33/3).
Wenn man nun 10 1-Lasten abzieht bleiben noch (33-10)/3, d.h. maximal 7 
RD0 übrig.
Falls für fanIn oder fanOut unterschiedliche HIGH/LOW-Werte angegeben 
sind, gilt immer der ungünstigste Fall (worst case).


Ciao, Yagan

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