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Forum: FPGA, VHDL & Co. Verkettung &?


Autor: Andreas B. (Firma: none) (suicide0)
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Hallo vhdl-wissende,
ich google mich kaputt nach einer für mich verständlichen Erklärung
zur Verkettung (&).

kann mir das einer von euch evtl. transparent machen?

was wäre ergebnis?

ergebis<=1111&0000;
oder
ergebis<=11&01&000;

Danke schonmal
Gruß
Andreas

Autor: Lothar Miller (lkmiller) (Moderator) Benutzerseite
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> ergebis<=1111&0000;    oder     ergebis<=11&01&000;

Wenn ich erst mal deine Schreibweise korrigiere:
> ergebnis <= "1111"&"0000";
dann gibt das einen 8-Bit Vektor mit Inhalt "11110000"

> ergebnis <= "11"&"01"&"000";
das wäre ein 7-Bit Vektor mit Inhalt "1101000"

Autor: Gugug (Gast)
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Das mit dem Googeln wird im Laufe der Jahre immer leichter. Nur nicht 
den Mut verlieren. Ersatzweise tut es ein gutes VHDL-Buch.

Autor: Andreas B. (Firma: none) (suicide0)
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@Lothar Miller
Danke für Deine Antwort.

Gruß
Andreas

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