Hallo, gibt es die Möglichkeit, einen schematic file von Quartus in einen reinen Vhdl file umzuwandeln? Gibt es sonst Möglichkeit, einen schematic file in modelsim zu simulieren? ich konnte da bisher nur einzelne Blöcke simulieren, möchte aber den ganzen file als einen Block ansehen. MFG
Ja, die Möglichkeit besteht. Öffne das .bdf und schau mal unter Datei->Convert/Update Dort sollte Convert to VHDL/Verilog ... oder so in der Art.
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