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Forum: FPGA, VHDL & Co. Wer benutzt die XI ISE 12.3?


Autor: Frager (Gast)
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Ich habe ein design, welches auf der 12.2 komplett lief auf der 12.3 
synthetisiert und finde vor, daß die clk offenbar nicht mehr geht. Er 
meldet auch angeblich faule offsetout constraints in der Art, daß es 
angeblich keinen Pfad von dem Takt zu diesem Signal gäbe.

Laufen tut garnichts. Keich ChipsScope und auch sonst nichts.

Idee?

Autor: Christian R. (supachris)
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ChipScope hab ich mit der 12.3 glaube noch nicht wieder gemacht. Aber 
sonst arbeitet die bisher, wie sie soll. Keine komischen Effekte 
festgestellt. Hast du mal in die Known Issues geschaut?

Autor: Frager (Gast)
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>Hast du mal in die Known Issues geschaut?
Ich habe einen aufgemacht :-)

Mit der 12.2 läuft das design wirklich. Irgendwie verhunzt er was mit 
den DCMs. Es steht auch irgendwo etwas drin mit einer neuen DCM policy, 
finde es nur nicht mehr. Ich muss dazu sagen, dass ich ein spezial board 
nutze und Xilinx dafür extra ein DCM-wakeup-Design formuliert hat. Das 
ist auch in den issues schon drin. Nur haben sie in der 12.3 wohl wieder 
irgendwas gemacht und dies nicht mitbedacht.

:-(

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