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Datum:
Hallo Leute, ich lade gerade mal die ISE Version 14.1 von Xilinx herunter. Hat schon jemand mit der Version seine Erfahrungen gemacht? Wo finde ich denn das Changelogfile?
Datum:
"What's new": http://www.xilinx.com/support/documentation/sw_man... Der große Wurf scheint's nicht zu sein.
Datum:
Sebastian schrieb: > Hat schon > jemand mit der Version seine Erfahrungen gemacht? Man muß jetzt selber dafür sorgen, daß die Ausgangssignale einer DCM über einen BUFG gehen. Früher (tm) ging das mal automatisch. Sonst hab ich noch nix gefunden. Modellpflege eben :-) Duke
Datum:
Den BUFG habe ich schon immer selbst drangehängt. Aber danke für die Infos
Datum:
Läuft bisher genauso wie die 13.4, die Bugs in impact sind noch die gleichen.
Autor:
Lothar Miller
(lkmiller)
(Moderator)
Datum:
Xilinx hatte es noch nie so richtig mit den geradzahligen Versionen... ;-)
Datum:
Vielleicht sind die ja auch der Meinung its not a bug its a feature
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Sebastian schrieb: > Den BUFG habe ich schon immer selbst drangehängt. Aber danke für die > > Infos sicher haben sie es nun geschnallt, dass ihnen die AutoBuffer immer dazwischen spucken.
Datum:
Schön wäre es , wenn Xilinx mal dem ChipScope beibringen könnte, zu zu zählen, vernünftig zu zoomen etc. Leider tun die keinen Schlag mehr.
Datum:
Ein sinnvoll zu bedienender Editor wäre auch was. Aber mittlerweile nehme ich viel Eclipse + VEditor.
Datum:
Schön wäre es wenn die ISE eine Datenbank/Browswer und Generator für Anwender erstellte Module hätte. So könnte man seine eigen Modulbibliothek komfortabel einsetzen und dokumentieren. Bspw. bei jeder Verwendung in unterschiedlichen Projekten wieviel slices das Modul dort brauchte und wie der kritische Pfad verlief.
Autor:
J. S.
(engineer)
Datum:
Mister LG schrieb: > Schön wäre es , wenn Xilinx mal dem ChipScope beibringen könnte, zu zu > zählen, vernünftig zu zoomen etc. Leider tun die keinen Schlag mehr. Den Eindruck habe ich auch! Besonders bei ChipScope liegt einiges im Argen. Schon länger ist mal eine Verbesserung angekündigt gesen, aber bisher: Nichts! Bei mir passiert es ständig, dass er designs nicht routen kann, weil ihm angeblich die RAMs ausgehen, obwohl es rechnerisch mehrfach passen müsste.
Datum:
J. S. schrieb: > dass er designs nicht > routen kann, weil ihm angeblich die RAMs ausgehen, obwohl es rechnerisch > mehrfach passen müsste. Das ist doch aber ein bekannter Bug, oder? Dafür hab ich selbst hier im Forum schon mal den Link zum Answer Report mit Workaround gelesen...
Datum:
Hey Leute, also der integrierte Logik-Analyzer von Lattice, Reveal genannt, ist mittlerweile sehr komfortabel! Das Zoomen funktioniert, die Radix-Darstellung funktioniert, Multi-Trigger, man kann sogar mehrere Reveal-Core parallel laufen lassen UND durch einen Trigger alles anhalten. Gerade bei Multi-Clock-Designs eine sehr große Hilfe. Lattice User
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