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Forum: FPGA, VHDL & Co. Xilinx Global Pins erklärt??


Autor: hmann (Gast)
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Hi!

Ich arbeite mich gerade in CPLDs ein und verwende dazu Xilinx XC9536XL
CPLDs.
Mir ist aber nicht ganz klar wie ich den Ablauf im CPLD takte.
Das Stichwort GlobalClock habe ich schon öfter gelesen, aber wie man es
anwendet finde ich nirgendwo bei Xilinx.
Muss ich einen Prozess über "wait" mit dem Clock Signal
synchronisieren?
Und wie lege ich fest welcher Pin der GlobalClock pin ist? er arbeitet
ja so wie es aussieht auch als normaler I/O Pin.
Und wo ich schon dabei bin, gibt es irgendwo eine Doku zu allen Global
Pins der Xilinx CPLDs, die Clock Pins sind ja nicht die einzigen...

Danke
  hmann

Autor: Peter Dannegger (peda)
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Wenn Du keine Pin-Zuordnung machst, macht er das automatisch. Ansonsten
ist es einfach von der Zuordnung (User Constraints) abhängig.


Welche Pins das sind, steht im Datenblatt.
Achtung, das ist Gehäuse-abhängig !!!


Peter

Autor: hmann (Gast)
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Danke Peter!
Jetzt ist mir das so einigermaßen klar. Habs gerade ausprobiert und es
klappt so wie ich das wollte.

Ciao
  hmann

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