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Forum: FPGA, VHDL & Co. VHDL: Tristate als Zustand verwenden?


Autor: Matthias (Gast)
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hmm, der betreff klingt viel komplizierter, als es eigentlich ist, ich
hab einen 2 bit std_logic_vector, der die aktuell offene bank des
SDRAM, den ich anspreche, enthält, logischerweise eine von 4. um
herauszufinden, ob ich bank wechseln muss vergleich ich mit diesem
std_logic_vector. wenn ich den SDRAM refreshe muss ich alle bänke
schließen, meine frage ist, ob ich da einfach "ZZ" zuweisen kann,
beim nächsten zugriff einen "normalen" wert damit vergleiche und das
funktioniert dann auch. in der simulation ist es kein problem aber
funkioniert das auch in hw?

oder ist es doch besser, noch 1 bit einzuführen, das mir sagt, ob
überhaupt eine bank offen ist?

thx in advance
matthias

Autor: Cpt (Gast)
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Hallo!

Denke nicht, daß das funktioniert. Die Zuweisung von 'Z' versetzt die
Leitung in den "High impedance" Status. Also im Prinzip genauso als
wäre sie nicht angeschlossen. In der Hardware funktioniert das so wohl
eher nicht.
Hoffe ich hab dich richtig verstanden.

Grüße Cpt

Autor: Matthias (Gast)
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dankda. du bestätigst mir das, was ich mir auch gedacht hab, in der
hardware wird das nicht funktionieren. noch ein gedanke dazu: wird
schon  eine schaltung zu haben sein, die high impedance erkennt, aber
um ein bit einzusparen ist das wohl eine ziemlich kranke idee g.

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