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Forum: FPGA, VHDL & Co. ISE7.1 Schematic Editor Problem


Autor: Daniel (Gast)
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Hallo allerseits,

mein Projekt wächst und gedeiht. Habe noch eine Frage im Umgang mit dem
Schmatic Editor. Wie kann ich eine Netzliste anlegen? Also, ich habe es
mit vielen ChipSelect Signalen zu tun, die jeweils als ein
std_logic_vector definiert sind. Diese möchte ich alle zusammen auf
eine "Busleitung" legen und dann durch Labels oder ähnliches
abgreifen - einfach nur um bessere Übersicht zu erhalten. Ich kann
mittels "wire" jede einzelne Ltg. anbinden. Wie füge ich diese zu
einem Bus zusammen? Ich möchte diese CS_Signale jedoch nicht als Vector
innerhalb des Macros definieren, sondern dies gesondert in der
übergeordneten Schematic tun. (alle macros selbst sind VHDL)

Danke für Antwort, Daniel

Autor: Feadi (Gast)
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Hm, wenn ich Dich richtig verstehe möchtest Du mehrere einzelne
Leitungen zu einem Bus zusammenlegen.

z.B:

Du hast 2 Leitungen (A und B),
jetzt sollen diese Beiden zu einem Bus zusammengelegt werden.

Dafur erstellst Du eine neue Leitung und nennst diese "A,B".
Ich habe leider vergessen wie Xilinx diese Busse nennt :(


Feadi

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