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Forum: FPGA, VHDL & Co. BRam aus Coregenerator in user_logic einfügen


Autor: breti (Gast)
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Hi,

ich möchte in eine selbstgebaute Peripheriekomponente im EDK ein
Blockram einfügen. Dieses Blockram habe ich mit dem Coregen unter ISE
erstellt. Was muss ich nun tun, damit das EDK die in user_logic
definierte Instanz vom BRam synthetisieren kann.

Die Fehlermeldung, die ich bei synthetisieren bekomme sagt mit, dass
"commponent bram could not be resolved". Dies finde ich logisch,
allerdings weiß ich nicht, welche Dateien vom bram ich wo hinkopieren
muss, damit das edk sie findet.

Irgendeine Idee?

Gruß,
       Thomas

Autor: Sven Johannes (Gast)
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Moin...

Welche Software benutzt du?
Das Webpack generiert normalerweise ein "Instatiation Template" das
du in deine Logik übernehmen kannst.

--
 Sven Johannes

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