Welche Tools zum Vergleichen und Zusammenführen (diff/merge) von VHDL Files sind empfehlenswert? Speziell soll es syntax Highlight für VHDL beherrschen (hilfreich wäre schon ein Ignorieren,Ausblenden, Markieren von Kommentaren) und es muß unter Linux laufen. Eingesetzt habe ich Compare It! und araxis, die laufen aber nur Windows. Das Emacs diff tool ist mir zu unhandlich und unübersichtlich. Dem zuletzt getestenden kdiff3 fehlt das Syntax Highlight.
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