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Forum: FPGA, VHDL & Co. Daten nicht weg minimieren


Autor: Sebi (Gast)
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Moin,
ich bin neu in der VHDL Welt. Darum mache ich immer nur kleine Schritte 
in der Programmierung und will mir die Signale dann in chip scope 
angucken od alles ok ist.

Allerdings sind die Schritte oft so klein das die erzeugten Siganle noch 
nicht wo anders angebunden sind und somit auch noch nicht gebraucht 
werden. Somit werden sie einfach weg minimiert. Bis jetzt konnte ich mir 
immer nur helfen indem ich die Signale kurz auf einen Pin gelegt habe 
das ist aber nicht das wahre. Besonders jetzt wo ich mir einen zähler in 
chip scope angucken will. Da müßte ich ja alle 16 Bit auf ausgänge 
legen.

Hier mal die Fehlermeldung
WARNING:Xst:1291 - FF/Latch <laengencounter_BLOCK/Datenlaenge_int_0> is 
unconnected in block <Ethernet>.

Gibt es einen tolen Trick das die Signale nicht einfach weg minimiert 
werden obwohl sie (noch) nicht gebraucht werden bzw nirgends 
angeschlossen sind?

Danke

Autor: Joerg Wolfram (joergwolfram)
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Ich denke, beim Zähler reicht es, wenn Du das höchstwertige Bit benutzt 
(z.B. auf einen Ausgang legst). Die anderen Bits können dann nicht 
wegoptimiert werden, außer der Zähler zählt z.B. +2

Jörg

Autor: Christian Peters (kron)
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Warum guckst du denn nicht erstmal mit ModelSim?
Da erkennt man doch schon die meisten Probleme und Fehler.

Autor: Sebi (Gast)
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Ah ok das ist ne gute Idee

Gibt es aber überhaupt eine andere Möglichkeit das die Signale nicht weg 
optimiert werden?

Autor: Sebi (Gast)
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ModelSim funktioniert bei mir nicht

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