Forum: FPGA, VHDL & Co. Brams werden wegoptimiert


Brams werden wegoptimiert
von Gast (Gast)

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Weiß es jemand woran es liegen kann, dass ISE bei der Synthese die Logik 
als BlockRAM erkennt, aber nach dem Implement-Design Vorgang diese 
wegoptimiert.
Bzw. kann man es ISE verbieten, diese weg zu optimieren, wenn man im 
Blockram nur bestimmte statische Sachen ablegen möchte?

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Re: Brams werden wegoptimiert
von Gast (Gast)

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Hat sich erledigt, wurde anscheinend mein Gehirn wegoptimiert. Die BRAMS 
sind doch noch da.

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