Forum: FPGA, VHDL & Co. Function in VHDL


Function in VHDL
von neuling (Gast)

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Hallo,

in Verilog gibt es Möglichkeiten Funktionen zu schreiben. z.B.

1
function [1:0] beispiel;

2
input [1:0] a1;

3
input [1:0] a2;

4
input b;

5
begin

6
  if b

7
     beispiel = a1;

8
  else 

9
     beispiel = a2;

10
end

11
endfunction


Kann man sowas in VHDL verwenden?

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Re: Function in VHDL
von neuling (Gast)

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Schon erledigt... :)

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Re: Function in VHDL
von Daniel N. (Gast)

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Wie lautet denn die Antwort?

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Re: Function in VHDL
von neuling (Gast)

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http://www.vdlande.com/VHDL/function.html

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