Gibt es einen maximal zulässige differenz zwischen eingestellter Baudrate und tatsächlicher Baudrate? Ich habe einen Takt von 40MHz und würde damit gerne eine Baudrate von 115200 erzeugen. Der Fehler liegt hierbei jedoch bei ca. 1,3%. Ich kann leider überhaupt nicht einschätzen ob das viel ist oder noch im Rahmen... Kann mir da vielleicht jemand einen Tipp geben? MfG Bernd
1,3% Fehler würde nach 10 Bit (Start, Daten, Stop) eine 13% Verschiebung einer Bitzeit bedeuten. Wird jedes Bit 4x je Bitlänge gesampled, so wird dieser Fehler wohl nicht ins Gewicht fallen. Würde ich einen UART bauen, würde erst ab 50% Abweichung ein Fehler auftreten ;-).
Wobei man den Baudratenfehler als Summe der Fehler auf beiden Seiten sehen sollte. Wenn beide Seiten 30% gleichsinnig daneben liegen geht's auch ;-). Wenn jedoch beide 2% daneben liegen, aber in umgekehrter Richtung, wird's eng.
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