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Forum: FPGA, VHDL & Co. komplettes Design in VHDL nach Symbol / Schematic portieren


Autor: Gast (Gast)
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Ich möchte ein design dokumentieren und nutze dazu gerne die SYM/SCH - 
Funktion von Xilinx, indem ich ein Projekt anlege, alles importiere und 
dann Symbole mache.

Frage: Geht das auch in der Alteralandschaft? Wie macht man das ?

Autor: Thomas Hertwig (mac4ever)
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Also die Altera IDEs bieten ebenfalls Schematics. Es sollte also genau 
so wie bei der Xilinx ISE möglich sein.
Oder reden wir gerade aneinandere vorbei ? ^^

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