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Forum: FPGA, VHDL & Co. Ausgangssignal an einen Ausgang und an ein Signal binden


Autor: Peter (Gast)
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Hallo,

ich habe eine interne Komponenet die ein Ausgangssignal hat.

Dieses Ausgangssignal möchte ich nach außen geben (Out-Signal der 
übergeordneten Komponente, zudem möchte ich dieses Ausgangssignal über 
eine interne Signalleitung einer anderen internen Komonente zuführen.

Die Doppelte Zuweisung bei der Port Map

Beispiel 1 : interne Komponenet port map
          Ausgangssignal => Ausgang_äußere Komponente
          Ausgangssignal => internes_Signal --für andere interne 
Komponente

lässt der Compiler nicht zu.

Kennt jemand hierfür eine Lösung.

Man kann natürlich in der internen Komponent das Signal kopieren und 
zwei Ausgangssignale erzeugen.

Geht es aber auch anders?

Besten Dank im Voraus.


Peter

Autor: Jan M. (mueschel)
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Geht ganz einfach: Das interne Signal in der port map anschließen und 
dieses dann an den Ausgang.

Autor: Peter (Gast)
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Hallo,
irgendwie stehe ich hier auf dem Schlauch.

Wo soll ich denn das signal an den Ausgang der äußeren Komponente 
anschließen? (Habe ja keine PortMap für die äußere Komponente)

Hier ein Beispiel:

entity außere_komponente is
   Port (Ausgang : out Bit);
end entity;


architecture Test of außere_komponente
component Intern1
  Port (KIOUT : out Bit);
end component;

component Intern2
  Port (KIIN : in Bit);
end component;

signal S : Bit;

begin
KIntern1: Intern1 Port Map (KIOUT => S)
KIntern2: Intern2 Port Map (KIIN => S)

End;

So und nun noch S an Ausgang binden aber wie?

Besten Dank im Voraus.

Gruß

Peter

Autor: Jan M. (mueschel)
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äh? Ein Signal einem anderen zuweisen...

Ausgang <= S;

Autor: Rick Dangerus (Gast)
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Die Pinzuordnung wird bei Xilinx z.B. mittels UCF-Dateien gelöst. 
Das dürfte bei anderen Herstellern ähnlich aussehen.

Rick

Autor: Peter (Gast)
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Hallo besten Dank!

Jetzt habe ich es kapiert.

Gruß

Peter

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