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	<title>Mikrocontroller.net - Benutzerbeiträge [de]</title>
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	<updated>2026-04-11T03:16:27Z</updated>
	<subtitle>Benutzerbeiträge</subtitle>
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		<id>https://www.mikrocontroller.net/index.php?title=ModelSim&amp;diff=17642</id>
		<title>ModelSim</title>
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		<updated>2006-10-15T16:16:09Z</updated>

		<summary type="html">&lt;p&gt;84.57.198.20: &lt;/p&gt;
&lt;hr /&gt;
&lt;div&gt;Modelsim ist eine mächtige Simulationsumgebung für [[Hardwarebeschreibungssprachen|HDL]]s. Diese erlaubt die taktsynchrone oder timinggenaue Simulation von digitalen Logikelementen. Die Simulationsumgebung ist z.B. im ISE WebPack als ModelSim XE III Starter enthalten, das kostenlos bei [http://www.xilinx.com Xilinx] erhältlich ist.&lt;br /&gt;
Es gibt auche eine kostenlose &amp;quot;Altera Web Edition&amp;quot;, die auf 10000 Zeilen brschränkt ist.&lt;br /&gt;
&lt;br /&gt;
&lt;br /&gt;
==Unter Modelsim XE Altera Bauteile simulieren==&lt;br /&gt;
Für die Simulation Altera-spezifischer Bausteine wie BRAM, DDR, IOs, PLL werden die Libraries von Altera benötigt, die eingebunden werden müssen.&lt;br /&gt;
&lt;br /&gt;
Dazu die Modelsim Altera Version downloaden und installieren, das Verzeichnis Modelsim ae/altera nach modelsim xe/altera kopieren und die INI-Datei im Modelsim_xe verzeichnis folgendermassen erweitern:&lt;br /&gt;
&lt;br /&gt;
[Library]&lt;br /&gt;
*std = $MODEL_TECH/../std  &lt;br /&gt;
*ieee = $MODEL_TECH/../ieee&lt;br /&gt;
*verilog = $MODEL_TECH/../verilog&lt;br /&gt;
*vital2000 = $MODEL_TECH/../vital2000&lt;br /&gt;
*std_developerskit = $MODEL_TECH/../std_developerskit&lt;br /&gt;
*synopsys = $MODEL_TECH/../synopsys&lt;br /&gt;
*modelsim_lib = $MODEL_TECH/../modelsim_lib&lt;br /&gt;
*lpm = $MODEL_TECH/../altera/vhdl/220model&lt;br /&gt;
*alt_vtl = $MODEL_TECH/../altera/vhdl/alt_vtl&lt;br /&gt;
*altera_mf = $MODEL_TECH/../altera/vhdl/altera_mf&lt;br /&gt;
*altgxb = $MODEL_TECH/../altera/vhdl/altgxb&lt;br /&gt;
*cyclone = $MODEL_TECH/../altera/vhdl/cyclone&lt;br /&gt;
*sgate = $MODEL_TECH/../altera/vhdl/sgate&lt;br /&gt;
&lt;br /&gt;
Modelsim_xe starten, die neu hinzugekommenen Libraries rekompilieren&lt;br /&gt;
&lt;br /&gt;
[[Category:FPGA und Co]]&lt;br /&gt;
&lt;br /&gt;
==Simulation von Speicherinhalten von Quartus unter Modelsim==&lt;br /&gt;
Der Inhalt des Speichers muss im Intel hex Format vorliegen.&lt;br /&gt;
Falls dies nicht der Fall ist müssen folgende Schritte durchgeführt werden:&lt;br /&gt;
* Quartus öffnen&lt;br /&gt;
* Speicher Datei öffnen (mif)&lt;br /&gt;
* Datei/speichern unter.. &lt;br /&gt;
** hex als Dateiendung wählen&lt;br /&gt;
* Hinweis: Dateiname und Endung immer klein schreiben!!!&lt;br /&gt;
&lt;br /&gt;
Im Design muss noch die File Endung von mif in hex geändert werden.&lt;br /&gt;
* init_file =&amp;gt; &amp;quot;prog.hex&amp;quot;&lt;br /&gt;
&lt;br /&gt;
Hinweis:&lt;br /&gt;
Der Speicherinhalt kann unter View/debug/memory angeschaut werden.&lt;/div&gt;</summary>
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