Sineloop:		
  
	lpm  r0,z       ; 3  
	out  PORTB,r31  ; 1  update Bit 8
	out  PORTD,r0   ; 1  update bit 0..7
	add  r28,r24    ; 1
	adc  r29,r25    ; 1
	adc  r30,r26    ; 1
	adc  r31,r27    ; 1
	cbr  r31,4  	; 1  limit to 1.5 table length
	lpm  r0,z       ; 3
	out  PORTB,r31  ; 1  update Bit 8
	out  PORTD,r0   ; 1  update bit 0..7
	add  r28,r24    ; 1
	adc  r29,r25    ; 1
	adc  r30,r26    ; 1
	adc  r31,r27    ; 1   
	lpm  r0,z       ; 3  
	add  r28,r24    ; 1
	out  PORTB,r31  ; 1  update Bit 8
	out  PORTD,r0   ; 1  update bit 0..7
	adc  r29,r25    ; 1
	adc  r30,r26    ; 1
	adc  r31,r27    ; 1
	cbr  r31,4	; 1  limit to 1.5 table length
	lpm  r0,z       ; 3
	add  r28,r24    ; 1
	out  PORTB,r31  ; 1  update Bit 8
	out  PORTD,r0   ; 1  update bit 0..7
	adc  r29,r25    ; 1
	adc  r30,r26    ; 1
	adc  r31,r27    ; 1
	rjmp SineLoop   ; 2 => 40 / 4 = 10 cycles

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