34: 66 c6 rjmp .+3276 ; 0xd02 <_exit> 00000036 <__bad_interrupt>: 36: e4 cf rjmp .-56 ; 0x0 <__vectors> 00000038

: // Define the I/O port to be used for the LED. // This a number between 0 and 7 that tells which bit to use. #define LED_PORT PB3 int main(void) { 38: 0f 93 push r16 3a: 1f 93 push r17 3c: df 93 push r29 3e: cf 93 push r28 40: cd b7 in r28, 0x3d ; 61 42: de b7 in r29, 0x3e ; 62 44: cc 51 subi r28, 0x1C ; 28 46: cd bf out 0x3d, r28 ; 61 // Set the LED port number as output. // The DDRB is the data direction for port B. // This ... // - shifts the "1" on left to the desired position and ... // - does bitwise "OR" with the value in the port register. DDRB |= (1 << LED_PORT); 48: 87 e3 ldi r24, 0x37 ; 55 4a: 90 e0 ldi r25, 0x00 ; 0 4c: 27 e3 ldi r18, 0x37 ; 55 4e: 30 e0 ldi r19, 0x00 ; 0 50: f9 01 movw r30, r18 52: 20 81 ld r18, Z 54: 28 60 ori r18, 0x08 ; 8 56: fc 01 movw r30, r24 58: 20 83 st Z, r18 // Start infinite loop. // (this is how most programs work) while (1) { // Set the LED bit to "1" - LED will be "on". PORTB |= (1 << LED_PORT); 5a: 88 e3 ldi r24, 0x38 ; 56 5c: 90 e0 ldi r25, 0x00 ; 0 5e: 28 e3 ldi r18, 0x38 ; 56 60: 30 e0 ldi r19, 0x00 ; 0 62: f9 01 movw r30, r18 64: 20 81 ld r18, Z 66: 28 60 ori r18, 0x08 ; 8 68: fc 01 movw r30, r24 6a: 20 83 st Z, r18 6c: 80 e0 ldi r24, 0x00 ; 0 6e: 90 e0 ldi r25, 0x00 ; 0 70: a8 e4 ldi r26, 0x48 ; 72 72: b3 e4 ldi r27, 0x43 ; 67 74: 89 83 std Y+1, r24 ; 0x01 76: 9a 83 std Y+2, r25 ; 0x02 78: ab 83 std Y+3, r26 ; 0x03 7a: bc 83 std Y+4, r27 ; 0x04 #endif __builtin_avr_delay_cycles(__ticks_dc); #elif !__HAS_DELAY_CYCLES || (__HAS_DELAY_CYCLES && !defined(__OPTIMIZE__)) || defined (__DELAY_BACKWARD_COMPATIBLE__) __tmp = ((F_CPU) / 4e3) * __ms; 7c: 69 81 ldd r22, Y+1 ; 0x01 7e: 7a 81 ldd r23, Y+2 ; 0x02 80: 8b 81 ldd r24, Y+3 ; 0x03 82: 9c 81 ldd r25, Y+4 ; 0x04 84: 20 e0 ldi r18, 0x00 ; 0 86: 30 e0 ldi r19, 0x00 ; 0 88: 4a e7 ldi r20, 0x7A ; 122 8a: 53 e4 ldi r21, 0x43 ; 67 8c: af d2 rcall .+1374 ; 0x5ec <__mulsf3> 8e: dc 01 movw r26, r24 90: cb 01 movw r24, r22 92: 8d 83 std Y+5, r24 ; 0x05 94: 9e 83 std Y+6, r25 ; 0x06 96: af 83 std Y+7, r26 ; 0x07 98: b8 87 std Y+8, r27 ; 0x08 if (__tmp < 1.0) 9a: 11 e0 ldi r17, 0x01 ; 1 9c: 6d 81 ldd r22, Y+5 ; 0x05 9e: 7e 81 ldd r23, Y+6 ; 0x06 a0: 8f 81 ldd r24, Y+7 ; 0x07 a2: 98 85 ldd r25, Y+8 ; 0x08 a4: 20 e0 ldi r18, 0x00 ; 0 a6: 30 e0 ldi r19, 0x00 ; 0 a8: 40 e8 ldi r20, 0x80 ; 128 aa: 5f e3 ldi r21, 0x3F ; 63 ac: ea d3 rcall .+2004 ; 0x882 <__ltsf2> ae: 88 23 and r24, r24 b0: 0c f0 brlt .+2 ; 0xb4 <__stack+0x15> b2: 10 e0 ldi r17, 0x00 ; 0 b4: 11 23 and r17, r17 b6: 29 f0 breq .+10 ; 0xc2 <__stack+0x23> __ticks = 1; b8: 81 e0 ldi r24, 0x01 ; 1 ba: 90 e0 ldi r25, 0x00 ; 0 bc: 9a 87 std Y+10, r25 ; 0x0a be: 89 87 std Y+9, r24 ; 0x09 c0: 42 c0 rjmp .+132 ; 0x146 <__stack+0xa7> else if (__tmp > 65535) c2: 11 e0 ldi r17, 0x01 ; 1 c4: 6d 81 ldd r22, Y+5 ; 0x05 c6: 7e 81 ldd r23, Y+6 ; 0x06 c8: 8f 81 ldd r24, Y+7 ; 0x07 ca: 98 85 ldd r25, Y+8 ; 0x08 cc: 20 e0 ldi r18, 0x00 ; 0 ce: 3f ef ldi r19, 0xFF ; 255 d0: 4f e7 ldi r20, 0x7F ; 127 d2: 57 e4 ldi r21, 0x47 ; 71 d4: 80 d3 rcall .+1792 ; 0x7d6 <__gtsf2> d6: 18 16 cp r1, r24 d8: 0c f0 brlt .+2 ; 0xdc <__stack+0x3d> da: 10 e0 ldi r17, 0x00 ; 0 dc: 11 23 and r17, r17 de: 51 f1 breq .+84 ; 0x134 <__stack+0x95> { // __ticks = requested delay in 1/10 ms __ticks = (uint16_t) (__ms * 10.0); e0: 69 81 ldd r22, Y+1 ; 0x01 e2: 7a 81 ldd r23, Y+2 ; 0x02 e4: 8b 81 ldd r24, Y+3 ; 0x03 e6: 9c 81 ldd r25, Y+4 ; 0x04 e8: 20 e0 ldi r18, 0x00 ; 0 ea: 30 e0 ldi r19, 0x00 ; 0 ec: 40 e2 ldi r20, 0x20 ; 32 ee: 51 e4 ldi r21, 0x41 ; 65 f0: 7d d2 rcall .+1274 ; 0x5ec <__mulsf3> f2: dc 01 movw r26, r24 f4: cb 01 movw r24, r22 f6: bc 01 movw r22, r24 f8: cd 01 movw r24, r26 fa: b6 d0 rcall .+364 ; 0x268 <__fixunssfsi> fc: dc 01 movw r26, r24 fe: cb 01 movw r24, r22 100: 9a 87 std Y+10, r25 ; 0x0a 102: 89 87 std Y+9, r24 ; 0x09 104: 12 c0 rjmp .+36 ; 0x12a <__stack+0x8b> 106: 89 e1 ldi r24, 0x19 ; 25 108: 90 e0 ldi r25, 0x00 ; 0 10a: 9c 87 std Y+12, r25 ; 0x0c 10c: 8b 87 std Y+11, r24 ; 0x0b milliseconds can be achieved. */ void _delay_loop_2(uint16_t __count) { __asm__ volatile ( 10e: 8b 85 ldd r24, Y+11 ; 0x0b 110: 9c 85 ldd r25, Y+12 ; 0x0c 112: 8c 01 movw r16, r24 114: c8 01 movw r24, r16 116: 01 97 sbiw r24, 0x01 ; 1 118: f1 f7 brne .-4 ; 0x116 <__stack+0x77> 11a: 8c 01 movw r16, r24 11c: 1c 87 std Y+12, r17 ; 0x0c 11e: 0b 87 std Y+11, r16 ; 0x0b while(__ticks) { // wait 1/10 ms _delay_loop_2(((F_CPU) / 4e3) / 10); __ticks --; 120: 89 85 ldd r24, Y+9 ; 0x09 122: 9a 85 ldd r25, Y+10 ; 0x0a 124: 01 97 sbiw r24, 0x01 ; 1 126: 9a 87 std Y+10, r25 ; 0x0a 128: 89 87 std Y+9, r24 ; 0x09 __ticks = 1; else if (__tmp > 65535) { // __ticks = requested delay in 1/10 ms __ticks = (uint16_t) (__ms * 10.0); while(__ticks) 12a: 89 85 ldd r24, Y+9 ; 0x09 12c: 9a 85 ldd r25, Y+10 ; 0x0a 12e: 00 97 sbiw r24, 0x00 ; 0 130: 51 f7 brne .-44 ; 0x106 <__stack+0x67> 132: 16 c0 rjmp .+44 ; 0x160 <__stack+0xc1> __ticks --; } return; } else __ticks = (uint16_t)__tmp; 134: 6d 81 ldd r22, Y+5 ; 0x05 136: 7e 81 ldd r23, Y+6 ; 0x06 138: 8f 81 ldd r24, Y+7 ; 0x07 13a: 98 85 ldd r25, Y+8 ; 0x08 13c: 95 d0 rcall .+298 ; 0x268 <__fixunssfsi> 13e: dc 01 movw r26, r24 140: cb 01 movw r24, r22 142: 9a 87 std Y+10, r25 ; 0x0a 144: 89 87 std Y+9, r24 ; 0x09 146: 89 85 ldd r24, Y+9 ; 0x09 148: 9a 85 ldd r25, Y+10 ; 0x0a 14a: 9e 87 std Y+14, r25 ; 0x0e 14c: 8d 87 std Y+13, r24 ; 0x0d 14e: 8d 85 ldd r24, Y+13 ; 0x0d 150: 9e 85 ldd r25, Y+14 ; 0x0e 152: 8c 01 movw r16, r24 154: f8 01 movw r30, r16 156: 31 97 sbiw r30, 0x01 ; 1 158: f1 f7 brne .-4 ; 0x156 <__stack+0xb7> 15a: 8f 01 movw r16, r30 15c: 1e 87 std Y+14, r17 ; 0x0e 15e: 0d 87 std Y+13, r16 ; 0x0d // Wait a little. // The delay function simply does N-number of "empty" loops. _delay_ms(200); // Set the LED bit to "0" - LED will be "off". PORTB &= ~(1 << LED_PORT); 160: 88 e3 ldi r24, 0x38 ; 56 162: 90 e0 ldi r25, 0x00 ; 0 164: 28 e3 ldi r18, 0x38 ; 56 166: 30 e0 ldi r19, 0x00 ; 0 168: f9 01 movw r30, r18 16a: 20 81 ld r18, Z 16c: 27 7f andi r18, 0xF7 ; 247 16e: fc 01 movw r30, r24 170: 20 83 st Z, r18 172: 80 e0 ldi r24, 0x00 ; 0 174: 90 e0 ldi r25, 0x00 ; 0 176: a8 ec ldi r26, 0xC8 ; 200 178: b3 e4 ldi r27, 0x43 ; 67 17a: 8f 87 std Y+15, r24 ; 0x0f 17c: 98 8b std Y+16, r25 ; 0x10 17e: a9 8b std Y+17, r26 ; 0x11 180: ba 8b std Y+18, r27 ; 0x12 #endif __builtin_avr_delay_cycles(__ticks_dc); #elif !__HAS_DELAY_CYCLES || (__HAS_DELAY_CYCLES && !defined(__OPTIMIZE__)) || defined (__DELAY_BACKWARD_COMPATIBLE__) __tmp = ((F_CPU) / 4e3) * __ms; 182: 6f 85 ldd r22, Y+15 ; 0x0f 184: 78 89 ldd r23, Y+16 ; 0x10 186: 89 89 ldd r24, Y+17 ; 0x11 188: 9a 89 ldd r25, Y+18 ; 0x12 18a: 20 e0 ldi r18, 0x00 ; 0 18c: 30 e0 ldi r19, 0x00 ; 0 18e: 4a e7 ldi r20, 0x7A ; 122 190: 53 e4 ldi r21, 0x43 ; 67 192: 2c d2 rcall .+1112 ; 0x5ec <__mulsf3> 194: dc 01 movw r26, r24 196: cb 01 movw r24, r22 198: 8b 8b std Y+19, r24 ; 0x13 19a: 9c 8b std Y+20, r25 ; 0x14 19c: ad 8b std Y+21, r26 ; 0x15 19e: be 8b std Y+22, r27 ; 0x16 if (__tmp < 1.0) 1a0: 11 e0 ldi r17, 0x01 ; 1 1a2: 6b 89 ldd r22, Y+19 ; 0x13 1a4: 7c 89 ldd r23, Y+20 ; 0x14 1a6: 8d 89 ldd r24, Y+21 ; 0x15 1a8: 9e 89 ldd r25, Y+22 ; 0x16 1aa: 20 e0 ldi r18, 0x00 ; 0 1ac: 30 e0 ldi r19, 0x00 ; 0 1ae: 40 e8 ldi r20, 0x80 ; 128 1b0: 5f e3 ldi r21, 0x3F ; 63 1b2: 67 d3 rcall .+1742 ; 0x882 <__ltsf2> 1b4: 88 23 and r24, r24 1b6: 0c f0 brlt .+2 ; 0x1ba <__stack+0x11b> 1b8: 10 e0 ldi r17, 0x00 ; 0 1ba: 11 23 and r17, r17 1bc: 29 f0 breq .+10 ; 0x1c8 <__stack+0x129> __ticks = 1; 1be: 81 e0 ldi r24, 0x01 ; 1 1c0: 90 e0 ldi r25, 0x00 ; 0 1c2: 98 8f std Y+24, r25 ; 0x18 1c4: 8f 8b std Y+23, r24 ; 0x17 1c6: 42 c0 rjmp .+132 ; 0x24c <__stack+0x1ad> else if (__tmp > 65535) 1c8: 11 e0 ldi r17, 0x01 ; 1 1ca: 6b 89 ldd r22, Y+19 ; 0x13 1cc: 7c 89 ldd r23, Y+20 ; 0x14 1ce: 8d 89 ldd r24, Y+21 ; 0x15 1d0: 9e 89 ldd r25, Y+22 ; 0x16 1d2: 20 e0 ldi r18, 0x00 ; 0 1d4: 3f ef ldi r19, 0xFF ; 255 1d6: 4f e7 ldi r20, 0x7F ; 127 1d8: 57 e4 ldi r21, 0x47 ; 71 1da: fd d2 rcall .+1530 ; 0x7d6 <__gtsf2> 1dc: 18 16 cp r1, r24 1de: 0c f0 brlt .+2 ; 0x1e2 <__stack+0x143> 1e0: 10 e0 ldi r17, 0x00 ; 0 1e2: 11 23 and r17, r17 1e4: 51 f1 breq .+84 ; 0x23a <__stack+0x19b> { // __ticks = requested delay in 1/10 ms __ticks = (uint16_t) (__ms * 10.0); 1e6: 6f 85 ldd r22, Y+15 ; 0x0f 1e8: 78 89 ldd r23, Y+16 ; 0x10 1ea: 89 89 ldd r24, Y+17 ; 0x11 1ec: 9a 89 ldd r25, Y+18 ; 0x12 1ee: 20 e0 ldi r18, 0x00 ; 0 1f0: 30 e0 ldi r19, 0x00 ; 0 1f2: 40 e2 ldi r20, 0x20 ; 32 1f4: 51 e4 ldi r21, 0x41 ; 65 1f6: fa d1 rcall .+1012 ; 0x5ec <__mulsf3> 1f8: dc 01 movw r26, r24 1fa: cb 01 movw r24, r22 1fc: bc 01 movw r22, r24 1fe: cd 01 movw r24, r26 200: 33 d0 rcall .+102 ; 0x268 <__fixunssfsi> 202: dc 01 movw r26, r24 204: cb 01 movw r24, r22 206: 98 8f std Y+24, r25 ; 0x18 208: 8f 8b std Y+23, r24 ; 0x17 20a: 12 c0 rjmp .+36 ; 0x230 <__stack+0x191> 20c: 89 e1 ldi r24, 0x19 ; 25 20e: 90 e0 ldi r25, 0x00 ; 0 210: 9a 8f std Y+26, r25 ; 0x1a 212: 89 8f std Y+25, r24 ; 0x19 214: 89 8d ldd r24, Y+25 ; 0x19 216: 9a 8d ldd r25, Y+26 ; 0x1a 218: 8c 01 movw r16, r24 21a: c8 01 movw r24, r16 21c: 01 97 sbiw r24, 0x01 ; 1 21e: f1 f7 brne .-4 ; 0x21c <__stack+0x17d> 220: 8c 01 movw r16, r24 222: 1a 8f std Y+26, r17 ; 0x1a 224: 09 8f std Y+25, r16 ; 0x19 while(__ticks) { // wait 1/10 ms _delay_loop_2(((F_CPU) / 4e3) / 10); __ticks --; 226: 8f 89 ldd r24, Y+23 ; 0x17 228: 98 8d ldd r25, Y+24 ; 0x18 22a: 01 97 sbiw r24, 0x01 ; 1 22c: 98 8f std Y+24, r25 ; 0x18 22e: 8f 8b std Y+23, r24 ; 0x17 __ticks = 1; else if (__tmp > 65535) { // __ticks = requested delay in 1/10 ms __ticks = (uint16_t) (__ms * 10.0); while(__ticks) 230: 8f 89 ldd r24, Y+23 ; 0x17 232: 98 8d ldd r25, Y+24 ; 0x18 234: 00 97 sbiw r24, 0x00 ; 0 236: 51 f7 brne .-44 ; 0x20c <__stack+0x16d> // Wait a little. _delay_ms(400); // Do it again ... } 238: 10 cf rjmp .-480 ; 0x5a <__SREG__+0x1b> __ticks --; } return; } else __ticks = (uint16_t)__tmp; 23a: 6b 89 ldd r22, Y+19 ; 0x13 23c: 7c 89 ldd r23, Y+20 ; 0x14 23e: 8d 89 ldd r24, Y+21 ; 0x15 240: 9e 89 ldd r25, Y+22 ; 0x16 242: 12 d0 rcall .+36 ; 0x268 <__fixunssfsi> 244: dc 01 movw r26, r24 246: cb 01 movw r24, r22 248: 98 8f std Y+24, r25 ; 0x18 24a: 8f 8b std Y+23, r24 ; 0x17 24c: 8f 89 ldd r24, Y+23 ; 0x17 24e: 98 8d ldd r25, Y+24 ; 0x18 250: 9c 8f std Y+28, r25 ; 0x1c 252: 8b 8f std Y+27, r24 ; 0x1b 254: 8b 8d ldd r24, Y+27 ; 0x1b 256: 9c 8d ldd r25, Y+28 ; 0x1c 258: 8c 01 movw r16, r24 25a: f8 01 movw r30, r16 25c: 31 97 sbiw r30, 0x01 ; 1 25e: f1 f7 brne .-4 ; 0x25c <__stack+0x1bd> 260: 8f 01 movw r16, r30 262: 1c 8f std Y+28, r17 ; 0x1c 264: 0b 8f std Y+27, r16 ; 0x1b 266: f9 ce rjmp .-526 ; 0x5a <__SREG__+0x1b> 00000268 <__fixunssfsi>: 268: ef 92 push r14 26a: ff 92 push r15 26c: 0f 93 push r16 26e: 1f 93 push r17 270: 7b 01 movw r14, r22 272: 8c 01 movw r16, r24 274: 20 e0 ldi r18, 0x00 ; 0 276: 30 e0 ldi r19, 0x00 ; 0 278: 40 e0 ldi r20, 0x00 ; 0 27a: 5f e4 ldi r21, 0x4F ; 79 27c: d7 d2 rcall .+1454 ; 0x82c <__gesf2> 27e: 87 fd sbrc r24, 7 280: 0f c0 rjmp .+30 ; 0x2a0 <__fixunssfsi+0x38> 282: c8 01 movw r24, r16 284: b7 01 movw r22, r14 286: 20 e0 ldi r18, 0x00 ; 0 288: 30 e0 ldi r19, 0x00 ; 0 28a: 40 e0 ldi r20, 0x00 ; 0 28c: 5f e4 ldi r21, 0x4F ; 79 28e: 83 d1 rcall .+774 ; 0x596 <__subsf3> 290: 23 d3 rcall .+1606 ; 0x8d8 <__fixsfsi> 292: 9b 01 movw r18, r22 294: ac 01 movw r20, r24 296: 20 50 subi r18, 0x00 ; 0 298: 30 40 sbci r19, 0x00 ; 0 29a: 40 40 sbci r20, 0x00 ; 0 29c: 50 48 sbci r21, 0x80 ; 128 29e: 05 c0 rjmp .+10 ; 0x2aa <__fixunssfsi+0x42> 2a0: c8 01 movw r24, r16 2a2: b7 01 movw r22, r14 2a4: 19 d3 rcall .+1586 ; 0x8d8 <__fixsfsi> 2a6: 9b 01 movw r18, r22 2a8: ac 01 movw r20, r24 2aa: b9 01 movw r22, r18 2ac: ca 01 movw r24, r20 2ae: 1f 91 pop r17 2b0: 0f 91 pop r16 2b2: ff 90 pop r15 2b4: ef 90 pop r14 2b6: 08 95 ret 000002b8 <_fpadd_parts>: 2b8: a0 e0 ldi r26, 0x00 ; 0 2ba: b0 e0 ldi r27, 0x00 ; 0 2bc: e1 e6 ldi r30, 0x61 ; 97 2be: f1 e0 ldi r31, 0x01 ; 1 2c0: ed c4 rjmp .+2522 ; 0xc9c <__prologue_saves__+0x8> 2c2: fc 01 movw r30, r24 2c4: ea 01 movw r28, r20 2c6: 80 81 ld r24, Z 2c8: 82 30 cpi r24, 0x02 ; 2 2ca: 08 f4 brcc .+2 ; 0x2ce <_fpadd_parts+0x16> 2cc: 38 c1 rjmp .+624 ; 0x53e <_fpadd_parts+0x286> 2ce: db 01 movw r26, r22 2d0: 9c 91 ld r25, X 2d2: 92 30 cpi r25, 0x02 ; 2 2d4: 08 f4 brcc .+2 ; 0x2d8 <_fpadd_parts+0x20> 2d6: 30 c1 rjmp .+608 ; 0x538 <_fpadd_parts+0x280> 2d8: 84 30 cpi r24, 0x04 ; 4 2da: 59 f4 brne .+22 ; 0x2f2 <_fpadd_parts+0x3a> 2dc: 94 30 cpi r25, 0x04 ; 4 2de: 09 f0 breq .+2 ; 0x2e2 <_fpadd_parts+0x2a> 2e0: 2e c1 rjmp .+604 ; 0x53e <_fpadd_parts+0x286> 2e2: 91 81 ldd r25, Z+1 ; 0x01 2e4: 11 96 adiw r26, 0x01 ; 1 2e6: 8c 91 ld r24, X 2e8: 11 97 sbiw r26, 0x01 ; 1 2ea: 98 17 cp r25, r24 2ec: 09 f0 breq .+2 ; 0x2f0 <_fpadd_parts+0x38> 2ee: 21 c1 rjmp .+578 ; 0x532 <_fpadd_parts+0x27a> 2f0: 26 c1 rjmp .+588 ; 0x53e <_fpadd_parts+0x286> 2f2: 94 30 cpi r25, 0x04 ; 4 2f4: 09 f4 brne .+2 ; 0x2f8 <_fpadd_parts+0x40> 2f6: 20 c1 rjmp .+576 ; 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2 336: 6d 90 ld r6, X+ 338: 7c 90 ld r7, X 33a: 13 97 sbiw r26, 0x03 ; 3 33c: 24 81 ldd r18, Z+4 ; 0x04 33e: 35 81 ldd r19, Z+5 ; 0x05 340: 46 81 ldd r20, Z+6 ; 0x06 342: 57 81 ldd r21, Z+7 ; 0x07 344: 14 96 adiw r26, 0x04 ; 4 346: ed 90 ld r14, X+ 348: fd 90 ld r15, X+ 34a: 0d 91 ld r16, X+ 34c: 1c 91 ld r17, X 34e: 17 97 sbiw r26, 0x07 ; 7 350: c6 01 movw r24, r12 352: 86 19 sub r24, r6 354: 97 09 sbc r25, r7 356: 5c 01 movw r10, r24 358: 97 ff sbrs r25, 7 35a: 04 c0 rjmp .+8 ; 0x364 <_fpadd_parts+0xac> 35c: aa 24 eor r10, r10 35e: bb 24 eor r11, r11 360: a8 1a sub r10, r24 362: b9 0a sbc r11, r25 364: b0 e2 ldi r27, 0x20 ; 32 366: ab 16 cp r10, r27 368: b1 04 cpc r11, r1 36a: 0c f0 brlt .+2 ; 0x36e <_fpadd_parts+0xb6> 36c: 61 c0 rjmp .+194 ; 0x430 <_fpadd_parts+0x178> 36e: 18 16 cp r1, r24 370: 19 06 cpc r1, r25 372: 6c f5 brge .+90 ; 0x3ce <_fpadd_parts+0x116> 374: 37 01 movw r6, r14 376: 48 01 movw r8, r16 378: 0a 2c mov r0, r10 37a: 04 c0 rjmp .+8 ; 0x384 <_fpadd_parts+0xcc> 37c: 96 94 lsr r9 37e: 87 94 ror r8 380: 77 94 ror r7 382: 67 94 ror r6 384: 0a 94 dec r0 386: d2 f7 brpl .-12 ; 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