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Hilfe für IDELAY
verwende einen Xilinx FPGA (Virtex 5 LX30T Speedgrade -1) und einen TI AD-Wandler mit max 400MSample (ADS5474) Hier das Datenblatt des AD-Wandlers: http://focus.ti.com/lit/ds/symlink/ads5474.pdf Auf Seite 7 wird das Timing des Wandlers beschrieben. Der Wandler erzeugt ein Dataready Signal (DRY).
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14Bit 400MHz ADC
dies zu ungenau? Hier mal das Datenblatt des AD-Wandlers: http://focus.ti.com/lit/ds/symlink/ads5474.pdf
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400MHz ADC mit Spartan 6
werde ich es dann erst mal mit dem Virtex5 versuchen. Ti hat dort ein Evaluation Board im Angebot. ADS5474 ADX. Dort ist ein Virtex 5 (XC5VSX50T) verbaut. Dies ist ein sehr interessantes Board. Es befindet sich ein SMA-Steckverbinder drauf. Dort kann man einen externen Clock für die Digitalisierung
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ATMEGA 328 - AREF wiedersprüchlich
Grad gesehen: Der ADS5474MHFGV ist für knapp 9000 Euro zu haben hrhrhr