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FPGA verrechnet sich sporadisch
Synthese zu Grunde liegenden) timing Modelle oft noch nicht ganz ausgereift. So hatte ich mal ein MAX10 Design, das nur mit einer aelteren Quartus Version timing closure erreichen konnte. Neuere Versionen enthielten neuere Versionen der device support libraries (mit MAX10 relevanten Eintraegen in den
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Relais-Karten abzugeben
entscheidende eigentlich. Die Abfallzeit wird pro Relais kalibriert (bei meinem Exemplar 7,9 ms, Datenblatt max. 10 ms). Nach jedem Abschalten prüft die Firmware am gemessenen Strom, ob der Kontakt rechtzeitig offen war, und meldet sonst „LATE“. Drift oder Alterung fallen also auf. Die Streuung von Schaltung zu
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Fundamenterder, Armierung im Kellerboden
und Schneidebetrieb hatte, hatte ich ein Profometer mit separatem Messkopf, das ging auch nur bis max 10cm. Damals halt ...... Udo S. schrieb im Beitrag #8106106: > Postest du deine Erfahrungen hier bitte? Mache ich.