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Testsignal für Filter
seinen Filter. Dessen Output kann man dann in aller Ruhe auswerten. Und wie man mit einem simplen DDS-Algorithmus in double saubere Testdaten erzeugt, sollte jeder selber wissen. Merke: das Verifizieren von egal was hat grundsätzlich mit einer anderen Methode/Equipment zu erfolgen als derjenigen,
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ATTiny13 Entwicklungsboard ?
Assemblercode zu kucken. So kann man auf C so schreiben, daß besser optimiert wird. Ein Beispiel: DDS mit AVR. Ich habe ausprobiert C und Assembler-Varianten. Hier gilt was ich schon geschrieben habe: solange alles in Register paßt, ist Assembler schneller. Hier ist das so, wenn 1-Kanal-DDS. Wenn mehrere
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Macht ihr noch Lochrasterplatinen für Prototypen?
Im Deckel hängt noch ein Raspi3 unter dem "offiziellen" Touchscreen. schon drei Jahre her. Ein DDS, ein Pythagoras-Analogrechner aus dem Datenblatt zum AD637, Isolationsverstärker und einiges mehr.
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Funktionsgeneratoren a la JDS6600, FY6800/6900 & Co.
meiner Meinung nach gehen -- vorausgesetzt natürlich, man hat einen passenden Tiefpass zwischen DDS und Komparator. Der DDS erzeugt die Grundwelle, der Komparator fügt die Harmonischen hinzu.
meiner Meinung nach gehen -- vorausgesetzt > natürlich, man hat einen passenden Tiefpass zwischen > DDS und Komparator. > Der DDS erzeugt die Grundwelle, der Komparator fügt die > Harmonischen hinzu. Das ist bestenfalls die halbe Wahrheit. Ein DDS erzeugt auch bei Sinus haufenweise Nebenlinien im
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8038 nachbilden
Signalgenerator-IC hilfreich, dass sehr genau > und bis in den hohen MHz-Bereich arbeiten kann. Das geht mit DDS.
bis in den hohen MHz-Bereich arbeiten > kann. Das gibt es. Für mittlere Frequenzen heißt das "DDS" und für richtig hohe "PLL".
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Funkamateure: Suche historische Senderschaltungen mit A- Betrieb
geht die AM Modulation aber mit dem Ringmodulator oder Gilbertzelle. Noch sauberer geht es mit einen DDS Synthesizer. Ralph Berres
der Sinus kann sich sehen lassen. Die Basis zum Basteln: http://www.ad7c.com/projects/ad9850-dds-vfo/ LG old.
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[B] kurzfristige Mitbestellmöglichkeit bei Mouser
@jofe: bitte kurzes Statement ob es dabei bleibt oder ob wir zu @dds5 rüber wechseln sollen.
@dds5 hab dir eine PN geschrieben. Gruß Peter
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Ist es wirklich so schwer Elektronik Kumpels zu finden?
samt Umschaltung von R und C, > Sprich Frequenzbereich ändern - ohne Programm Bis man das mit einer DDS kann, muss man schon ordentlich was auflegen. >Re: Ist es wirklich so schwer Elektronik Kumpels zu finden? An Hochschulen nicht. Die Bastler haben es schwer. Aber wir hatte früher nur die Bücher
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FM-Synthesizer Analyse
die Eintraege in der Tabelle sind bei mir keine Frequenzen sondern bereits Phaseninkremente fuer die DDS-Oszillatoren.
Eintraege in der Tabelle sind bei mir keine Frequenzen > sondern bereits Phaseninkremente fuer die DDS-Oszillatoren. Das ist aber doch irgendwie dasselbe, oder? Je höher die Frequenz, desto höher das Inkrement. Und in dem Fall sind beide ja wirklich linear. Meines Wissens ist das doch eine simple DDS
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Sinusgenerator RIM 80er Spannung bricht zusammen warum?
index.php eventuell als Kombi dazu::: https://www.ebay.de/itm/Dual-channel-Arbitrary-Waveform-DDS-Function-Signal-Generator-JDS2800-60MHz-B0X0/254378983104?_trkparms=aid%3D555018%26algo%3DPL.SIM%26ao%3D1%26asc%3D57926%26meid%3Dc262391385f541528b4c332bce5f762e%26pid%3D100005%26rk%3D4%26rkt%3D12%26mehot
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UpChirp / DownChirp mit Phasenmmodulation
das es keinen DAC MIT 60 GHz gibt. Aber wenn ich mit einer Integer-N-PLL zur Multiplikation eines DDS-Signal sieht die Welt doch ganz anders aus. Man könnte ein DDS Bausteil nehmen oder auch ein FPGA was mir die Erzeugung der verschiedenen Rampen erleichtern würde. Jedoch stellt sich mir immer
mal das erste Bild was ich oben im ersten Beitrag angehangen haben: Um die Anforderungen an den DDS zu senken, kann eine Integer-N-PLL verwendet werden, um die Ausgangsfrequenz des DDS zu multiplizieren. Ein spannungsgesteuerter Oszillator (VCO) erzeugt ein Ausgangssignal, dessen Frequenz [fout] um
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Verständnis FMCW Erzeugung
Modulation zu bekommen, benötige ich eine PLL bestehend aus einer externen Signalquelle (XTO oder DDS), Phasen-Frequenz-Detektor (PFD, phase frequency detector), einer Ladungspumpe (CP, charge pump), einem Schleifenfilter, einem VCO und einem Frequenzteiler. Der VCO und der Teiler mit 1/32 ist ja
bauen ich eine PLL (eventuell mit dem ADF4159 auf) wenn zuvor schon ein Teiler ist? Kann man einen DDS anstatt eine Quarz zur Referenz verwenden, ist das Sinnvoll? Vielen Dank für eure Hilfe Fabi P.s: Ich frage aufgrund von Lernzwecken, also bitte gnädig sein, falls ich arg dumme Fragen stelle
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Conrad Elektronik hat Probleme
unzufrieden. Nur HF mäßig finden sich oft Abkündigungen bei DK. Ich entwickelte vor Jahren einen 200MHz DDS Generator. Machte dann einige Jahre nicht weiter und in der Zwischenzeit wurden einige wichtige Komponenten abgekündigt. So habe ich das Projekt so ziemlich aufs Eis gestellt. Ein totales Re-design
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zeitliche Fehler-Akkumulation verhindern
Ein digitale DDS wird verwendet, um einen Steuertakt für ein Zielsystem vorzugeben. Die Frequenz beträgt zwischen 100 und 180kHz und bewegt sich hin und her. Die DDS wird mit einer Abtastfrequenz von 24MHz erzeugt.
von DDS sprechen kann? Irgenwie schon, es ist halt nur eine 2 Werte Tabelle und ein 1 Bit DAC. Besser wäre der Begriff NCO. Dass er eine richtige DDS mit Sinus oder Dreieck (spart die Wellentabelle) verwenden
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Mouser Bestellung
Bestellungen habe ich bis dato von: wolf17, dds5 und knibbel
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Mischfrequenzen: DDS oder Singlebuffer
Christoph db1uq K. schrieb im Beitrag #5999822: > Das wichtigste Kriterium ist hier, Da wäre DDS in meinen Augen auch der komplett falsche Weg.
Kann man die beiden Frequenzen auch mit einem DDS Akku erzeugen? Also dass man z. B. die Schrittweite abwechselt die man draufaddiert. Mal großen Wert für die niedrigere Frequenz und mal kleineren Wert für die höhere Frequenz.
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Kabelbaum Prüfgerät
current 2kv ISO 64x. Dmm mit rs232, hochspannungsteiler, 2000V PSU, 20v vref , 100:1 Teiler. USB dso, dds signal generator, cpld/fpga für signal integrity bist.
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Signal simulieren - suche Signalgenerator/Pulser
Widerstand entladen wird, liefert einen exponentiellen Abfall. Dafür braucht man keinen Arbitrary DDS Sonstwas Generator ;-)
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Datenrettung / Image von Fesplatte unter Linux
eine gute Idee, dem dd eine Blocksize mitzugeben. Z.B. bs=1024000 Ein Bekannter hatte mal vor DDS-Tapes zu kopieren. Ohne Blocksize wird da wirklich immer nut ein Block (= 512 byte) gelesen und geschrieben. Das war fuer die beiden Streamer natuerlich Tierquaelerei und dauerte obendrein *ewig
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Artikel
DDS-Signalgenerator per USB
Richtung USB. So laufen moderne Logic Analyzer genau wie moderne Messgeräte über USB. Lösung ist ein DDS, dies steht für Direct Digital Synthesis und ist ein Verfahren zur Erzeugung periodischer Signale. Dies kann sowohl ein Sinus-, Dreieck- oder Rechtecksignal sein. Nimmt man nun noch einen PWM-Kanal
qualitativ sehr hochwertigen Signalgenerator für unter 25€ selbst zusammenbauen kann. Mehr zum Thema DDS findet ihr hier. Wer jetzt noch der Meinung ist, ein digitaler Signalgenerator sollte auch Protokolle wie I 2 C oder SPI ausgeben können, der darf gerne weiterlesen! Es gibt eine Extended Edition, welche
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Artikel der Woche: DDS-Signalgenerator - und dann?
Hallo Forum, der momentane Artikel der Woche ist: DDS-Signalgenerator per USB https://www.mikrocontroller.net/articles/DDS-Signalgenerator_per_USB Ich bin sehr interessiert - aber, weder wird erklärt, wie man das Signal (z.B. Sinus) filtern kann /
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ADF4351 et al. : Performance Messungen und Diskussion
ganz erfüllt werden, um es mal vorsichtig auszudrücken. Jetzt könnte man drüber nachdenken, ob ein DDS synthesizer besser geeignet wäre. Die Tage notiere ich mal die Konfiguration des Frickelmoduls. Nebenbei bemerkt macht es fast kein Unterschied ob ich fractional/n oder Integer wähle. Aber es
stabilsten ist, wo auch immer. Ein 2. Oszillator liefert die Ausgangsfrequenz und ist über einen DDS an den 1. angebunden. Man kann ihn also digital ziehen. Pegel und Nebenwellen sind ein Bastelobjekt für die Feiertage. Gruß, Gerhard
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Alte SCSI-Festplatte auslesen
heute laufen. Klar, mittlerweile habe ich da natuerlich keine Platten mehr dran, aber immer noch MOD, DDS, Brenner und CF-Reader. Olaf
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Signalgenerator auf kleineren Duty Cycle umbauen
oberwellenarme, weil tiefpass- gefilterte Sinussignal losgeht und daraus ein Rechteck macht. Signalfluss: DDS --> Filter --> Komparator. Beim Dreieckssignal soll aber der DDS das GESAMTE Spektrum mit einem Mal erzeugen, und das geht eben nur für verhältnismäßig niedrige Frequenzen. Signalfluss: DDS --> Filter. > Was meinst du mit klassischem Dreieck/Rechteckgenerator? > die Kombination aus einem Schmitt-Trigger und Integrierer? Ja, genau.
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FPGA z1013 mit halber Taktfrequenz
Wie Oben zT ja schon geschrieben kannst du eine gated Clock erzeugen (z.B. per DDS oder einfach per simplen Counter). Das gilt zwar unter FPGA-Entwicklern als NoGo, da die Frequenz aber "extrem" klein ist (ein paar MHz), ist das für dein Ziel absolut akzeptabel. Denn du hast ja
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Radar Signal Erzeugung
Loop (PLL) mit einer Referenzquelle stabilisiert wird. Die Rampe kann man theoretisch mit einer DDS erzeugen. Einmal eine positive und negative Rampe. Anschließend wird der VCO mit der DDS erzeugten Rampe angesteuert, so dass der VCO eine Sinus-Signal herausgibt, welches von 79,5GHz - 80,5GHz sich
DDS braucht man glaube ich nicht für einen Sägezahn.
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Kompleete Werkstattauflösung
Nähe kommt einfach vorbei zu schauen. Messgeräte sind bereits alle weg bis auf einen PeakTech 4040 DDS-Funktionsgenerator aber der ist bereits in der eBucht, aber es sind noch Multimeter etc. da. Gruß Thomas
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Welches Linux als Windows7-Ersatz
Jahrtausendwende), einen Weg zu finden, damit die performance-hungrigen Spiele oder Anwendungen nicht auf DDS laufen müssen. Man könnte zynischerweise sagen, während Windows noch den hardwarenahen Virtual 8086 Mode einsetzen und mitoptimieren konnte, kann Linux aufgrund der starken Leistungsverbesserung
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Wie aus Rechteck im Bereich von 100KHz bis 2MHz Sinus machen (5V).
Allgemeinen ist der sinnvollere Weg in der anderen Richtung: den Sinus mit einem analogen VCO (oder DDS) erzeugen und daraus das Rechtecksignal ableiten.
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Aus ca. 0,3V Wechselspannung (Sinus) 15 V Wechselspannung machen
Hallo an alle, ein DDS-Generator liefert mir im Bereich von 500Hz bis 2,5MHz ein Sinus-Signal mit einer Spannung von ca. 0,2V. Aus dieser kleinen Spannung will ich eine Spannung machen von ca. 15V, ohne das Sinus-Signal und
leicht zu nehmen, wie es gemeint war. Weitere Daten läßt der TO wirklich auf sich warten. Was der DDS-Generator liefert, d.h. Ausgangswiderstand wäre schon von Interesse. Es wurden einige Lösungen bereits vorgeschlagen. Wenn es ein älterer DDS-Generator sein sollte, dann wäre es auch möglich, dass
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Taugen die AD9959-Radio-Frequency-RF-Signal-Source-Generator Boards etwas?
folgendem Board: https://www.ebay.com/itm/AD9959-Radio-Frequency-RF-Signal-Source-Generator-4-Channel-DDS-Module-200MHz/293119482053 Ich möchte damit ein wenig mit HF herumspielen: - mal ein klein wenig FM-Radio senden (natürlich nur gaaanz wenig Power) - mal ein wenig AM-Radio senden (natürlich
z.B. > SDR und ???) Weiss nicht. Wenn Du primär programmieren willst, kannst Du natürlich DDS und SDR fertig kaufen -- aber über HF lernst Du so meiner Meinung nach nix. Meine persönliche Empfehlung wäre, nicht immer darauf zu schielen, wie "die Industrie" irgend etwas macht. Der Amateur
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Wie PWM-Signal erzeugen?
aussieht. Wenn es darum geht, Sinussignale mit hoher Auflösung zu produzieren, würde ich eher ein DDS-IC verwenden. Das lässt sich mit recht ein- fachen Programmen ansteuern.
vorschlagen, um auf die geforderten 12 Bit >Amplitudengenauigkeit zu kommen? AD bietet etliche DDS-ICs mit 12-Bit DA-Wandler an. MfG Spess
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Eine Folge von 23 und 24 erzeugen, die im Mittel 23,572 ergibt
Erik schrieb im Beitrag #5952250: > Fractional Counter im Fixed Point Format. Oder auch der DDS-Algorithmus, den sonst Bresenham zum Linien-zeichnen verwendet, der kann nämlich auch genau eine Linie mit 23,572 Grad Steigung (und alle anderen). Er arbeitet mit ganzen Zahlen, könnte einfacher
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AD9833(DDS) - STM32 - Programmierung mittels HAL_SPI-Treiber
offensichtliche Sachen falsch gemacht habe. Ich versuche seit einigen Tagen mittels STM32 (L476RG) den DDS AD9833 über SPI anzusprechen, um ein Sinussignal zu generieren. Dies sollte theoretisch (Datenblatt AD9833) nach folgendem Muster ablaufen: STM sendet via SPI 5 16-Bit lange Befehle in Folge. Ein Word
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Rauschgenerator - Voice/Microphone Protector/Jammer
packst die in den Flash deines AVR. Dann spielst Du die mitm Highspeed Timer übers PWM Modul weider ab.DDS eben. Nur eben keine Sinus-Viertelwelle im Flash ablegen, sondern mehrere Perioden der Welle und die dann durch die RealSamples der Sprachfetzen ersetzen. _Das_ ist nun wirklich einfach. DDS ist hier
den > Flash > deines AVR. Dann spielst Du die mitm Highspeed Timer übers PWM Modul > weider ab.DDS eben. Nur eben keine Sinus-Viertelwelle im Flash ablegen, > sondern mehrere Perioden der Welle und die dann durch die RealSamples > der Sprachfetzen ersetzen. > Das ist nun wirklich einfach. DDS
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Arbiträre Signale erzeugen
Ich setze mich mit Arbiträrgeneratoren auseinander. Bisher lese ich nur das solche Generatoren mit DDS funktionieren. Gibt es auch andere Möglichkeiten arbiträre signale zu erzeugen?
, > verstärken, fertig. Hmpf. Das *ist* ein DDS.
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relocation truncated to fit - msp430
kompiliere, dann bekomme ich folgende Fehlermeldung: [code] /opt/dev/MED_Serie/MED_Bedienteil/msp430_dds/dds_brt.c:47: relocation truncated to fit: R_MSP430_16_PCREL_BYTE against symbol `reload_mod_freq' defined in .data section in objs/dds_brt.o /opt/dev/MED_Serie/MED_Bedienteil/msp430_dds/dds_brt.c:
relocation truncated to fit: R_MSP430_16_PCREL against symbol `mod_freq' defined in .bss section in objs/dds_brt.o /opt/dev/MED_Serie/MED_Bedienteil/msp430_dds/dds_brt.c:47: relocation truncated to fit: R_MSP430_16_PCREL against symbol `mod_freq' defined in .bss section in objs/dds_brt.o /opt/dev/MED_Serie
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DDS5158 digitaler Stromzähler
Hallo, ich hab den im Betreff genannten Digitalzähler von einem Kumpel bekommen, jedoch kenne ich von dem Digitalzähler nicht die Pinbelegung. Bei dem Digitalzähler gibt es folgende Pins: Pin 1 Pin 3 Pin 4 Pin 6 Pin 20 u. Pin 21 sind so denke ich mal für das Impulssignal. Wäre echt nett, wenn mir jemand die Pinbelegung erklären könnte.
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Frequenzteiler 10 MHz auf 50 Hz
sich ja noch jemand, der sich die Finger aufwärmen möchte. Das passende Verfahren arbeitet so wie DDS und liefert feinste Auflösung. Der leichte Jitter ist dabei egal. Selber habe ich auf die Schnelle nur programmierbare Timer anzubieten. Zum einen eine Schaltung mit ATtiny4313, bei der Frequenz
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Quarz für schmalbandiges DCF77-Filter
PM-to-AM-Conversion. Aktuell kommt das LO-Signal aus einem HP3325A-Synthesizer, später wäre da eine DDS angesagt, da die LO-Frequenz (aktuell 5075.765 kHz) doch recht krumm ist. Es stellt sich nun halt die Frage nach den Auswirkungen eines Phasenrauschens der LO-Frequenz. So schön und so ermutigend
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D-FlipFlop Störungen wg CLK-Signal
Die Stromversorgung der Platine kommt aus einem gesonderten Netzteil, das Signal kommt von einem DDS-Generator. Viele Grüße
Die Stromversorgung der Platine kommt aus einem gesonderten Netzteil, > das Signal kommt von einem DDS-Generator. Alle Massen verbunden?
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HF/HV-Trafo will mir nicht gelingen - zu viel Strom!!
, das wären bei ca. 13 Volt dann die 15 Ampere. Als Quelle nutze ich eine Kombination aus einem DDS-Sinusgenerator mit einem alten, modifizierten Sony-Audioverstärker, welcher bis ca. 80kHz Sinussignale problemlos verstärken kann. Nur bei ca. 15 Ampere am Ausgang schaltet er dann (verständlicherweise
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VCO diskret aufbauen? (4GHz-ca. 200 MHz Sweep)
muss im Teilungsfaktor der RF zur Vergleichfrequenz verstimmt werden. Wie macht man das? Mit einem DDS! Der kann so programmiert werden dass er einen definierten Sweep generiert. Beispiel: RF 4000MHz, Phasendetektorfrequenz 50MHz (ergibt Teilerfaktor 80) RF Hub 200 MHz ---> DDS Frequenzhub 200Mhz
im > Teilungsfaktor der RF zur Vergleichfrequenz verstimmt werden. > Wie macht man das? Mit einem DDS! Der kann so programmiert > werden dass er einen definierten Sweep generiert. > > Beispiel: RF 4000MHz, Phasendetektorfrequenz 50MHz > (ergibt Teilerfaktor 80) > > RF Hub 200 MHz ---> DDS Frequenzhub
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MEMS Mikrofone für Ultraschall
(ca. 6-8 Bit) Signal bei 96kHz aus einem Ultraschall-Lautsprecher, erzeugt mit ganzzahliger Sinus-DDS bei fs 96kHzx1024 Punkte aus meinem FPGA-Synthesizer. Allerdings ist das Signal recht schwach und stark richtungsabhängig. Es wäre sicher noch zu verbessern, wenn man das Filter als schmalen Bandbass
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Suche digitalen Takt-Generator mit Möglichkeit einer Frequenzmodulation
Das macht ein DDS-Baustein. Z.B. von Analog Devices.
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Verstärker 1-1500MHz 1Watt
anzugehen wäre, eine Integer-PLL, z.B. auf Basis eines ADF4351, zu verwenden, deren Referenz durch einen DDS-Synthesizer geliefert wird. Damit würde man die Integer Boundary Spurs der Fractional-PLL bzw. Störtöne der DDS vermeiden, und könnte gleichzeitig eine hohe Frequenzauflösung erreichen. Dem DDS-Synthesizer
wäre, eine Integer-PLL, z.B. auf > Basis eines ADF4351, zu verwenden, deren Referenz durch einen > DDS-Synthesizer geliefert wird. Damit würde man die Integer Boundary > Spurs der Fractional-PLL bzw. Störtöne der DDS vermeiden, und könnte > gleichzeitig eine hohe Frequenzauflösung erreichen. Dem DDS-Synthesizer
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Suche Chinaschach-Programm, das unter Linux läuft
gegen den Computer spielen willst gibt es im Ubuntu repo auch sjaakii und xboard http://www.eglebbk.dds.nl/program/chess-index.html
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5V Leitung hinter Tiefpass gestört
mehr an der Ausgangsbuchse raus. (Mehrfach getestet) Intern läuft die ganze Geschichte über einen DDS mit 1.25Mhz für die kleinen Frequenzschritte und für die FM Modulation, 2 VCO`s und 3 PLL`s. Ist FM abgeschalten, dann erzeugt der DDS ein 1.25 Mhz Signal. Das wird aber alles noch deutlich komplexer
dem Mixer bzw. dem Teiler keine 1.25 Mhz raus für den Vergleich in der PLL mit dem 1.25 Mhz aus dem DDS. Das Signal vom DDS fluktuiert auch noch immer von der Qualität stark, mal ist es sofort da und steht, mal ist es verrauscht, mal kaum sichtbar, egal ob warmgelaufen oder nicht.
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Xilinx Coolrunner CPLD Gesperrt
nur Ripple-Zähler. Ich hab mit CPLD's schon Grafikdisplay-Ansteuerungen, Frequenzzähler (s.o.), DDS-Generatoren und eben auch "Glue"-Logik gebaut. Mit 256 Makrozellen kann man mit sowas erstaunlich viel machen. W.S.
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Entwicklung/Eigenbau eines "RFID SDR" Dongles
damit aufs Oszi gehen. Dann solltest du schon was sehen. Für die weitere Arbeit sollten es doch DDS oder ein DAC (zum Senden) und ein nicht allzu lahmer ADC (zum Empfangen) tun. Steuerung über einen STM32 o.ä., die langweilen sich damit doch nur.