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Seltsames Verhalten im Bitfile nach Implementierung!
.. ach ja, ich gehe davon aus, dass die Synthese alle von dir vorgegebenen Constraints halten kann..
Schlumpf schrieb im Beitrag #3168865: > .. ach ja, ich gehe davon aus, dass die Synthese alle von dir > vorgegebenen Constraints halten kann.. Meine Coinstraints beziehen sich zur Zeit ausschließlich auf Clk(period) und I/O Ports (Offset In / Out). Die werden auch erfüllt soweit.
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FPGA Board zum Anfangen
lernst du eine Menge über die "Hintergründe". Literaturempfehlung: http://www.amazon.de/VHDL-Synthese-Entwurf-digitaler-Schaltungen-Systeme/dp/3486716778/ref=sr_1_1?s=books&ie=UTF8&qid=1354920998&sr=1-1 Das FPGA-Thema ist eine ganze Nummer komplexer als die Microcontrollerwelt, aber bei Problemen
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Probleme beim eintakten von Signalen
s.w. schrieb im Beitrag #4009019: > Ist das Don´t care bit wirklich nicht synthetisierbar? Sieh dir das Manual zum Synthesizer, den "XST Users Guide" an, da steht es drin: Es ist (teilweise) synthetisierbar. Allerdings stimmt dann die Simulation nicht mehr. Denn das "don't care"
Miller schrieb im Beitrag #4009119: > s.w. schrieb: >> Ist das Don´t care bit wirklich nicht synthetisierbar? > Sieh dir das Manual zum Synthesizer, den "XST Users Guide" an, da steht > es drin: Das ist ja mal ne feine Lektüre, sowas habe ich schon lange gesucht, super TIPP !!!! > Es ist (teilweise
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Hornaltes PLD Zeug.
ich aber schon vorher, ich hatte das bereits sowohl mit MAX3000A als auch mit MAX7000A als Ziel synthetisiert, das hilft mir also so nicht. Die aus Gattern nachgebauten D-FF (siehe oben) hat die SW übrigens problemlos übersetzt und mir ein JEDEC File ausgespuckt das der ALL07 auch problemlos in ein
ist noch einfacher. Ich hatte schon probiert die Schaltung in ein XC9572 und in EPM3032/64 zu synthetisieren, es gab dabei soweit kein Problem. Das Problem gab es halt in den EP610, aus den oben genannten Gründen ... und da habe ich halt nachgefragt wie es vielleicht trotzdem geht, durch Modifikation
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Pulse Generator nicht genau genug, brauche Hilfe
gefunden: The CDCE913 is a modular PLL-based low-cost, high-performance, programmable clock synthesizer, multiplier, and divider. It can generate up to 3 output clocks from a single input frequency. Each output can be programmed via an SDA / SCL, SMBus / I2C interface, for any clock frequency up
Problem dar, nur kannst du Schreiben nur von einem Prozess aus, sonst gibts Kollision, und der Synthesizer schmeißt einen Fehler.
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Probleme mit Signalgenerator
besetzt hält. Klassischer Fall ist die bedingte Synthese von Funktionen durch verschachtelte Schleifen, welche komplizierte Ablaufvorgaben darstellen, die nur in die Synthesesoftware zu Gesicht bekommt. Genau betrachtet, ist es sogar nur die erste Stufe der Synthesesoftware, die (wie früher der BAISC-Interpreter) die Befehle zyklisch abarbeitet und eine flache Vorschrift daraus baut. An der Stelle ist VHDL eine Software (nämlich ein Programm), das eine andere
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Aktuelle FPGAs in QFP
als Übergangslösung :) Derzeit hatte ich spaßeshalber für den EP4CE6 (cyclon 4 mit 6000LE) synthetisiert, weil das einer der QFP-FPGAs bei Digikey war, und voila, fast erster Treffer bei der Suche nach FPGA Dev Boards in der Bucht: http://www.ebay.de/itm/Waveshare-CoreEP4CE6-ALTERA-Cyclone-IV-EP4CE6E-FPGA-Development-Core-Board
Wenn ich mein Dualport-Ram auswähle und Customize klicke, passiert nichts :( Aber die Synthese-Geschwindigkeit ist beeindruckend ... Quartus ist da schonmal schnarchlangsam ... Vlt bau ich mir den RAM unter Windows oder so ... Muss mir das noch genauer anschauen :)
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Frostschutz-Schmiermittel für Schaltzug (von Gangschaltung) gesucht
benutzt wurde. Vorsicht > Brandgefahr. Ich verwende generell das Dynamic Kettenöl, denn dieses Synthetik-Öl ist das beste lösungsmittelfreie Schmiermittel bezüglich Schmierung (Brugger-Test), Schmutzhaftung und Kriechfähigkeit (an der Fahrradkette) laut Tour 1/2009 und Bike 2010: https://www.bike-components.de
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Welche maximale Taktrate ist ohne Oszilloskop sicher beherrschbar?
dass erst *nach* der Einschwingzeit die Daten abgetastet und weiter verarbeitet werden. Das Synthesetool kennt die Laufzeiten der Elemente und kalkuliert daraus die maximale Taktfrequenz.
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CPU in VHDL designen
benötigt man das zwingend? Die Zuweisung erfolgt dann halt erst nach einer gewissen Zeit. Wo das synthesefähig sein soll ist mir ein Rätsel. Max M. schrieb im Beitrag #5154109: > 2. Wenn ich einen Befehl "Lade Wert von Adresse xyz" mit einer > Befehlswortbreite von 8-Bit (4-Bit Opcode und 4-Bit Daten
Python kannst, sparst du mit MyHDL massiv Zeit in der funktionalen Entwicklung, der Schritt zur Synthese ist dann klein. Die Risc-V-Dinger sind in Chisel entworfen, aber ob man sich das antun will...
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Audio ausgeben mit µC
der mp3, die ich ausgeben will. chris schrieb im Beitrag #5364454: > Beitrag "17 Kanal Avr Synthesizer in Asm" Mein Problem ist das ASM. Ich kann zwar die Grundlagen, aber es ist für mich sehr anstrengend. Ich kann aber ja einmal durchschauen, ob ich nicht doch etwas finde, das ich verstehe und
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3Ph Sinus Generator
nur die Spannung für die Motoren frei von Oberschwingungen etc. sein. Und da ist die digitale Synthese deutlich im Vorteil. Ob PWM oder DAC, die Anforderungen mit max. 300 Hz lassen sich digital und mit geeignetem Tiefpaß sauber realisieren.
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Xilinx XCR22LV10 als einstieg
Was ich noch nicht verstehe was ist eine Makrozelle ? Kann man eigentlich in so CPLDs µC synthetisieren ? MFG Patrick
Eingängen je nach FPGA. Dafür kann man aber mehrere davon kaskadieren (passiert automatisch im Synthesetool) um größere Funktionen zu bauen und hat sehr viel mehr Flipflops. Die Programmierung funktioniert aber genauso (VHDL), die Unterschiede sieht man nur in der "Größe" und im Timing. Außerdem sind
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Suche Schaltplan für analogen Gong-Klang
gebaut und habe ich heute noch... Auch die Baubücher dazu... Sorry, ist ein altes Bild, der Synth steht im Moment etwas im Abseits...
wert als Gold? Warum willst Du Dein Werk zerreißen? Ohne themperaturstabilen VCOs ist das kein Synth mehr...
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Eigene *ML variation statt XML/HTML, was haltet ihr davon?
Und wie prüftst du ob dein input synthaktisch korrekt ist? Brauchste alles nicht, schon klar. Da gehts doch schon los, das liefert xml alles von Haus aus mit. Das ist selbergebastelter Müll, schon x-fach gesehen. Die Fehler die du dir damit
nach den rants. Die Spec zu dem "einfachen" Format ist länger als die von XML! Whitespace Teil der Synthax,... von Amateuren entworfen.
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Amplituden am Diodenmischer
Bereich auf einen ADC mit hinreichend Aufloesung. Nebenbei, es gibt ganze Buecher zu PLL synthesizern, einfach nur einen Chip einsetzen ist eher auf der mageren Seite. Denn der hat Spurs, Fraktionale haben viel mehr Spurs wie die Integer Synthesizer. Die stoeren vielleicht, je nach angestrebem dynamischem Bereich. Sonst muss der Synthesizer eben 2 oder sogar drei Kreise haben.
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phase Correct PWM
in meinem Kopf in Hardware umzuformen, dann bekomme ich das nicht hin. Und offenbar geht es dem Synthesizer nicht besser... Lies mal den https://www.mikrocontroller.net/topic/515845#6640802 und versuche zu verstehen, was ich dort in der zweiten Hälfte des Beitrags geschrieben habe: du zeichnest ein
Texteditor und schreibst einen VHDL-Code, der diese Schaltung beschreibt. Und dann hoffst du, dass der Synthesizer deine Beschreibung versteht und in die Schaltung umsetzt, die du dir ursprünglich ausgedacht hast. Armin D. schrieb im Beitrag #6647226: > Nun hab ich meinen Lehrer nochmal gefragt wie die Aufgabenstellung
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Eurorack PSU
Junkie XL : Modular-Synthesis - Part 1,2,3 .. Als Bastel-Anregung
Bereichsregler. Der -Gesamtwiderstand- regelt.. (Das ist das Netzteil des "ELEKTOR" 'Formant' Modular-Synthsizers ? :)
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HDL in Python / MyHDL die Zweite (unfertig)
im Beitrag #6787640: > Also wie habe ich eine Garantie, daß mein > Modell in Python richtig synthetisiert und ich nicht in der VHDL die > Fehler suchen muß. Woher hast du die Garantie, dass ein Synthese Tool den VHDL Code richtig synthetisiert? Oder das ein C-Compiler den gewuenschten Maschinencode
Tobias B. schrieb im Beitrag #6787685: > Woher hast du die Garantie, dass ein Synthese Tool den VHDL Code richtig > synthetisiert? Oder das ein C-Compiler den gewuenschten Maschinencode > produziert? ;-) > > Im Prinzip musst du wie bei allem eine Analyse und Risikobewertung >
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64-Bit Integer Beschleunigung
6-Bit-Zähler mit anderem Startwert anlegen und mit diesen vergleichen. Müssen Zähler im FPGA synthetisiert werden ob gibts die auch in HW? Ein wenig Zusatzaufwand könnte noch abfallen, da eine der drei Schleifen derzeit als rekursive Funktion mit geringer Tiefe implementiert ist. Das läßt sich aber
, welche die pipelines verwalten kann. Sie wird in einer industriellen Anwendung sowie in meinem Synthi eingesetzt. Um sie zu portieren, braucht es aber die Randbedingungen des Problems, weil die Verwaltungsstrukturen eingestellt werden müssen, also die Signale, welche die MUX an den pipe-Eingängen
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unions structs bildfields
Hegel: These gegen Antithese, Auflösung des Widerspruchs in der Synthese: Identität der Widerssprüche - Erleuchtung: es gibt sie wirklich nicht
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Überspannung bei Attiny Input Pins
sondern irgendwas zwischen +-5 und +-15. Zur Info: es handelt sich um Steuerspannung in einem Synthesizer.
freusch schrieb im Beitrag #6799411: > Zur Info: es handelt sich um Steuerspannung in einem Synthesizer. Dann erklär doch mal genauer, was damit passieren soll. Willst du die Spannung detektieren (AN/AUS?, welche Schwellen?) Willst du sie analog messen? Willst du sie beeinflussen? Willst
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Synthesizer-Netzteil: Reparatur möglich?
Synth um die Ohren gehauen. Ehrlichkeit ist manchen echt egal... Gruß Christoph
wenn du jetzt nur noch die Kühlkörpersache machst und dann den Mantel des Vergessens (Gehäuse des Synthi) wieder drüberhüllst.
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Dienstleister will Rechnung nicht zahlen
hat zukommen lassen, die mein Problem aufgriff und beschreibt, sowie den Umstand, dass es nicht synthetisiert. Nun drückt sich der Dienstleister schon sehr lange um die Zahlung der Rechnung herum und redet sich darauf raus, dass die Firma die Stunden nicht bestätigen möchte. Ob das stimmt, weiss ich
Georg Hambacher schrieb im Beitrag #3385319: > dass es nicht synthetisiert. FPGA-Projekt? >wie vorgehen Man sollte sowas langsam eskalieren und jeweils nur soviel Druck machen, wie nötig. Schreibe die nochmal an und setze eine Frist. Ansonsten würde ich aber den
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[Q] Interesse an FPGA Board
das zu testen möchte ich auch noch einmal ein größeres Design (z.B. einen Bitcoin Mining Core) synthetisieren und mal ausprobieren, ob das läuft.
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Z80 vs. 8085
der 60er Jahre und davor, als man nicht selten Befehlsnamen aus einzelnen Zeichen und Optionen synthetisierte statt sie aus Wortstämmen zu bilden. Also vorne "A" für ADD oder "N" für AND, dann "X" oder "B" für die Registergruppe und dahinter das Zielregister, so dass man einen Befehl "NX4" nur entschlüsselt
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2 Phasen Takt, Wegimpulsverzögerung
> kannst du mir ein gutes Tutorial für VHDL Einsteiger empfehlen? > 1. Reichardt&Schwarz "VHDL Synthese" > 2. anfangs zu jeder Beschreibung den erzeugten RTL Plan ansehen > 3. meine HP... ;-) danke, das Buch habe ich soeben bestellt. >> Stell dir START und STOP als jeweils einen separaten Baustein
Behavioral; [/vhdl] Was mache ich hier noch falsch, oder ist der Code so wie er da steht nicht synthetisierbar? Ich danke schon mal vorab für eure Hilfe. Schönend Abend zusammen s.w.
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Pointer auf ungültigen Wert prüfen
Werten initialisiert oder bereits wieder freigegeben > ist? Generell, unabhängig von dem synthetischen "createPoint/freePoint" Beispiel: Wenn du irgendwo auf einen bereits freigegebenen Speicherbereich zugreifst, ist das ein *Fehler*. Fehler will man idealerweise finden und beheben, nicht
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FPGA dazu geeignet?
zuführen willst, musst du selbigen allerdings wirklich an einen Clock-Eingang legen, sonst winkt die Synthese ab :-( Ja, die Pinout-Liste ist wirklich saumäßig.
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Einfaches Multithreading für ATMEGAs
langsamen "update" Funktion füllen. Das Prinzip findet sich mehr oder weniger in der Arduino Mozzi Synth Lib.
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Was ist das für ein Microcontroler?
zwei Kupfer Drähte im Kunststoff, die gehören zum Wafer. Daran kann man auch viel erkennen. Synthesizer Controller haben einige Firmen gebaut: OKI,Winbond,Yamaha...... Aber ich denke auch das ist ein Mikrocontroller. Ich meine ich habe vor kurzem sogar einen gesehen, der nur mit einem Widerstand
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Welchen Studiengang, um Mikrochips zu entwerfen
Verilog beherrschen, in DE wird aber meist > VHDL angeboten. Ich meine: wer in VHDL Schaltungen synthetisierbar beschreiben kann, kann auch schnell auf verilog umsteigen. Axel L. schrieb im Beitrag #5234942: >> Die heutigen Tools haben einiges an IP's zu bieten, für Highendsachen, >> muss man aber
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LCD mit Interrupts?
ich auch nun DDS ausprobiert, für MIDI-Noten von Nr. 0 bis Nr. 127, Fd = 50 KHz. [c]void tim2_synth(void){ // Wenn F_SYNTH = 1 if( FLAGG & (1<<F_SYNTH) ){ synth_freq += tonfrequenz[synth_note]; if(synth_freq & 0x800000){ ZV_PORT |= (1<<ZV); } else { ZV_PORT &= ~(
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Die zwei entferntesten Punkte finden
eine Einführung in Dynamisches Programmieren? Das reicht für das Grundverständnis des FW-Algo (Synthese aus Graphenalgo und DP). Wenn Du jetzt noch die Karte ein wenig aufbereitest und alle konvexe Komponenten und deren "diametrale" punkte identifizierst plus deren Zusammenhang (=Graph), dann lässt
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"GEZ"-Rechtslage Gesperrt
vorstellen. Genausowenig wie er sich vorstellen kann, dass diese "bestimmte Gruppe" zu Analyse und Synthese aus beiden Welten fähig ist. Tja, der Mensch geht immer von sich selbst aus... Und bezeichnend ist auch, dass gerade jene, die schnell dabei sind andere und ihre Threads grundlos auf ein vermeintliches
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suche Schaltplan für einfachen Dreieck-Generator 1kHz
oder einen NE5532 nehmen Problemlos. Mit dem TL084 hab ich den mal in doppelt als LFO für nen Synthi gebastelt. Geht Super. Da ist auch noch Raum für Spielereien. Ich hab zb noch ein weiteres Poti eingebaut, um die Symetrie zu verzerren. Sprich es war von steigender Säge über Dreieck zu fallender
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mein DSPIC-Synth ist fertig
man die Lautstärke exponentiall herabsetzen, um sie linear ausklingen zu lassen? (bin kein Synthesizerspezi)
> und bei beiden Stücken lese ich Andromeda oder Moog War der Andromeda wirklich ein analoger Synthesizer?
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Wer kann mir einen Wecker bauen?
Ich besitze noch nicht einmal einen Player. Ich dachte da eher, daß ein kleiner Soundgenerator/Synthesizer auch langfristig bischen Programmierspaß mitbringen würde. Wenn sich genügend Leute dafür interessieren, können später auch Sounds/Melodien getauscht werden.
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Info: Magnetron-Innenansicht
Wärmeverteilung für winzige und hochbelastete Halbleiter, wie z.B. Laserdioden, natürlichen oder synthetischen Diamant. Diamant hat eine 6-fach bessere Wärmeleitfähigkeit wie Kupfer und isoliert auch noch! Bei den gebräuchlicheren Keramikteilen in der Elektronik, auch bei Magnetrons, handelt es sich
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Microblaze Interrupt
Projekterstellung machen, so sollten solche Probleme nicht auftretten. Kriegst du Warnings bei der Synthese? Falls ein Pins nicht verbunden ist kommt normaleweise ein Warning. Hast du auch ein Linker Script, wo werden Interrupt ausgelagert?
debuggen. Ich persönlich würde die mir ein Projekt direkt im EDK erzeugen, da sonst bei jede Synthese die "hw" Verzeichnis im SDK überschrieben werden soll. Für diese Test reicht auch ein kleine Anwendung im EDK. Gruss
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Verstärker für 10 MHz
hallo, ich wird Beitrag "DDS Power Synthesizer" mal versuchen, die LT1260 hab ich grad "bestellt" :D bin zwar etwas entäuscht, das ich nicht selber was entworfen habe, aber solange es fkt ok... ist es nicht ganz so trivial bei 10 MHz? ich
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Bachelorarbeit note
Dann gibt es die Programmier-Prüfungen: Programmcode auf das Papier bringen. Meist werden Synthaxfehler sehr kulant behandelt (Was ich richtig finde). Ist das nicht der Fall, ziehen die Fehler, die jeder Compiler erkennt, den Studenten mit evtl. dafür guten Programmier-Konzepten herunter. Viel
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Mp3 Player [mega8, SD, VS1001]
rumgetippert und kläglichst versucht mir platinen zusammenzubauen die mal sowas ähnliches wie einen synthesizer darstellen. (hat natürlich nicht geklappt). hut ab und weiter so :-)
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AD-Wandler mit VHDL verwenden
Eigentlich brauchst Du nur einen Zähler und die Bits mit IF/CASE einzeln erzeugen lassen. Die Synthese baut Dir daraus schon die optimale Schaltung.
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Funktion fitting zur Phasenbestimmung – Probleme bei Drift
es driften > letztendlich beide messungen rauf und runter. Hast Du Deine Auswertung mal auf synthetisch generierte Daten losgelassen? Da kann man dann auf das ideale Signal mal Rauschen oder andere Störkomponenten draufrechnen und schaut, wie empfindlich die eigentliche Rechnung ist.
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Welchen Feuerlöscher habt ihr in eurem Hobbyraum?
bringt andere erst Recht in Gefahr. Das machst Du bitte mal vor. Du greifst "beherzt" in ein Synthetikhemd rein, die komplett in Flammen steht? Glaub ich nicht^^ Sie haben das Feuer aber wohl mit einer Decke schnell ausgekriegt. Die Brandverletzungen habe ich Jahre später selber "bewundern" dürfen
Andreas H. schrieb im Beitrag #7507974: > Das machst Du bitte mal vor. Du greifst "beherzt" in ein Synthetikhemd > rein, die komplett in Flammen steht? Glaub ich nicht^^ Wenn's ums Leben geht: Ja. DerSchmied
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RaspBerry Pi Circle
/rsta2/circle/wiki/List-of-Circle-based-projects In der Projektliste gibt's hier den Roland-Synthesizer. Das geht schon ziemlich in die Signalverabeitungsrichtung: https://github.com/dwhinham/mt32-pi
>In der Projektliste gibt's hier den Roland-Synthesizer. Das geht schon >ziemlich in die Signalverabeitungsrichtung: >https://github.com/dwhinham/mt32-pi Scheint ein Retroprojekt zu sein: https://www.youtube.com/watch?v=wYOk2CSc798
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Wozu benutzt Ihr 3D-Drucker?
der CES vorgestellt), wobei hier noch das Problem ist das die Epoxidharze ebenfalls aus Erdöl synthetisiert werden, aber das kann sich ja auch noch ändern. Oder eben Multi/Poly-Jet Modeling ala Connex 500. Momentan sind eben nur FDM für Privatpersonen bezahlbar. Aber wenns dann so weit ist dass
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Ist MyHDL für echte Anwendungen einsetzbar?
habe ernsthafte Zweife daran, ob das von MyHDL erzeugte VHDL sich wirklich verlässlich in das synthetisiert, was man zuvor getestet hat. Hat jemand Erfahrung mit MyHDL?
schrieb im Beitrag #3169895: > ob das von MyHDL erzeugte VHDL sich > wirklich verlässlich in das synthetisiert, was man zuvor getestet hat. Das ist bei VHDL nicht anders: nicht alles, wass sich simulieren lässt, lässt sich auch synthetisieren. (Eher sogar: nur das Wenigste von dem, was tadellos simuliert
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Pinbelegung Notenerzeugung mit FPGA (Altera DE2-115) mit VHDL Code
Was für Fehler? Was heisst "Überspielen"? Was meinst du mit "Kompilieren" - Synthese? Wie hast du die Pinbegelegung jetzt realisiert? Gruss
Antwort. > Was für Fehler? > Was heisst "Überspielen"? > Was meinst du mit "Kompilieren" - Synthese? Ich arbeite mit "Quartus II" als Software. Damit kann man den Quellcode erst kompilieren und dann mit Hilfe des "Programmers" den von der Software erstellten Assembler-Code auf den Speicher des