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Signalübertragung IR LED -> Photodiode
Pseudozufallszahlengenerator eingespeist werden und das Ausgangssignal am Fototransistor oder an der Fotodiode als Augendiagramm bewertet werden. https://de.m.wikipedia.org/wiki/Augendiagramm
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Verständnisfrage Tonband
Nachdem ich die HF-Vormagnetisierung bei der Aufnahme deutlich reduziert > hatte, waren die Augendiagramme bei der Wiedergabe um ein vielfaches > besser als vorher und das Lesen funktioniert viel zuverlässiger. Heißt: > die Gruppenlaufzeitverzerrungen waren deutlich geringer. > > (Ich hoffe,
Nachdem ich die HF-Vormagnetisierung bei der Aufnahme deutlich reduziert > hatte, waren die Augendiagramme bei der Wiedergabe um ein vielfaches > besser als vorher und das Lesen funktioniert viel zuverlässiger. Bei Digitalaufnahmen spielt der Klirrfaktor und die Dynamik keine Rolle, da ist eine
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Differentielles Signal VCSEL Treiber
Signal um das VCSEL entsprechen anzusteuern bzw 'modulieren'. Um meinen Aufbau zu testen und auch Augendiagramme aufzeichnen zu können, suche ich nach einer Gelegenheit ein solches Signal für Versuchszwecken zu erzeugen. Dabei sollte die Lösung so simple wie möglich sein, evtl. mit einem Funktionsgenerator
Da ich mal davon ausgehe ("Augendiagramme"), dass es sich um Frequenzen über 100MHz handelt, würde ich ein FPGA hernehmen, z.B. MachXO2 Breakout board. Mit den Gearboxen bekommst du hohe Raten hin. Ansonsten kannst du unter Beachtung der
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Power Line Communication Signalqualität
ausreichend, da dadurch nicht sichtbar wird wie gut die Signalqualität ist. Mein Ansatz war ein Augendiagramm aufzunehmen. Problem bei bpsk war dann, dass die Amplitude bei den bei den Phasenverschiebungspunkten abgesackt ist......wäre es eine ideale Kommunikation wäre das nicht der Fall. Das Augendiagramm
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HILFE! SPI macht mich fertig!
sich am besten mit einem Augenmusterdiagramm feststellen. https://de.m.wikipedia.org/wiki/Augendiagramm Die steigende Flanke des Clocksignals sollte möglichst weit vom linken und rechten Rand der Augen entfernt sein.
am besten mit einem Augenmusterdiagramm > feststellen. > > https://de.m.wikipedia.org/wiki/Augendiagramm > > Die steigende Flanke des Clocksignals sollte möglichst weit vom linken > und rechten Rand der Augen entfernt sein. Allein mit dem Beitrag von Wikipedia verstehe ich das gerade nicht
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4k HDMI in auf Xilinx Framebuffer
---------------------------------------- Zu der HDMI Dynamischen Therminierung via Kabel ... Augendiagramm für 20 Meter Kabel. Bei der hohen Bitrate ... wenn da was nicht stimmt ist der HDMI Bildschirm duster. Analog Devices macht da aktiv Thermnierung via 10mA Stromschnittstelle ... Bild poste
Holger schrieb im Beitrag #6639546: > Augendiagramm und AXI4 Stream MIPI CSI Controller Subsystems https://www.xilinx.com/products/intellectual-property/ef-di-mipi-csi-rx.html MIPI Reference Design (2016.3) suche ich noch. Gruss Holger
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100 MBit Ethernet differentielles Routing
], welche durch die Leitungskodierung bestimmt wird. Am Ende geht es um ein möglichst gutes [[Augendiagramm]].
Lothar. Er sah bei 5cm > für ein 10m Kabel noch kein Problem. Stimmt, er hat aber auch kein Augendiagramm gemessen. Auch 1cm vor dem Abgrund steht man noch ;-) > @Lothar, Du hast es vermutlich nicht symmetrisch in beiden Richtungen > getestet, sondern immer nur die eine Litze gekürzt, richtig?
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Fragen zu Platinen Layouts
Wechsel zwischen den Zuständen erfolgen muss, bevor es zu Bitfehlern kommt. Schau dir mal ein Augendiagramm an, dann sollte klar werden, warum du bei höheren Taktraten auch höhere Flankensteilheiten benötigst. > brachte, waren solche und weitaus höhere Frequenzen nebst entsprechenden > Beobachtungen
weitgehend uninteressant" übrigens nur auf die Betrachtung von Reflexionen bezogen. Das mit dem Augendiagramm ist eine andere Baustelle. 90° schrieb im Beitrag #5797770: > Ich finde es schön, dass du einerseits anzweifelst, dass es zu > Reflexionen kommt, andererseits möchtest du jetzt Oberflächenrauhigkeit
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WLAN Antennenverstärker - nicht töten!
irgendwelche Phasen und Amplitudenschritte, aber eine Minimalleistung gibts immer, (wenn das Augendiagramm keine Nulldurchgänge hat, was man aus Linearitätsgründen vermeidet).
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Ethernet Phy zum Senden bewegen Gesperrt
andere Phasen-Verschiebungen des vom FPGA ausgegebenen Taktes ausprobiert ? Kannst du ein Augendiagramm des Taktes messen ? Vielleicht hast du ein Jitter-Problem ... Gibst du den Takt auf einem dafür vorgesehenen FPGA-Pin aus ?
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Sowas fürs zu Hause
im Display gerade > sieht? Ja, du nicht? @Xeraniad: http://de.wikipedia.org/wiki/Augendiagramm
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Leiterplatte und Reflektionen
finden leider Erfolglos. Könnt Ihr mir da mehr helfen. Könnt Ihr mir vielleicht auch Infos über Augendiagramm geben? Gruß und danke
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Wie nennt man diese Art der Signaldarstellung auf dem Oszi?
Also beim "Augendiagramm" wird das ja auch so gemacht. Auf Wikipedia ist diese darstelungsform nicht speziell betitelt. "grafische Überlagerung von mehreren Messungen desselben Signals zu unterschiedlichen Zeitpunkten
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Widerstände in USB-Datenleitungen
10-22 ohm für den Anfang -> Augendiagramm aufnehmen und optimieren (natürlich zusammen mit Kap., was noch in der Leitung hängt)
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RS485 Busbelegung berechnen
Sofern es um die rein elektrische Belastung geht: Oszilloskop & Augendiagramm.
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Messen am 100Mbit Switch
Jahr. Ich hab die Polaritäten korrigiert, aber immer noch keinen Connect. Beim Anschauen vom Augendiagramm wurde es mir dann irgendwie schon gruselig, zwischen Switch-Magnetic sieht es ja noch ganz gut aus, aber auf der anderen Seite vom Übertrager sieht es dann nicht mehr so toll aus. Die Leiterbahnen
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parasitäre Größe (Induktivität,Kapazität) durch Via, Pa
10GHz hab ich mal irgendwo im Netz gelesen. Gemessen hat er AFAIK mit Patterngenerator und Oszi (Augendiagramm). Welchen Oszi genau, keine Ahnung, ich nehme an ein 10 GHz+ Modell von TEK. MFG Falk
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LTspice: Phasenwinkel auf X-Achse möglich?
durch eigene Formeln ersetzen. Oder du nutzt die Funktion baudrate eigentlich gedacht für Augendiagramme.
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SPI Taktleitung nicht sauber
. Eine Methode ist die Darstellung von Augenmusterdiagramme. https://de.m.wikipedia.org/wiki/Augendiagramm
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ESD/EMI USB Beurteilung Schaltplan
Ja wirklich interessant ... wobei mich das "Augendiagramm" bei Verwendung einer Gleichtakt-Drossel interessiert hätte. Hatte da irgendwo gelesen, dass solche Drosseln die Signalintegrität negativ beeinflussen.
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USB-Hub Design
differentiellen Leitungen und auch der Paare untereinander. Hast du ein passendes Scope, um dir das Augendiagramm bei den Datenraten anzeigen zu lassen? Wenn nicht können dich die ersten Layouts ordentlich Lehrgeld kosten. Ansonsten ist der TI schon ein ganz brauchbarer Chip.
differentiellen Leitungen und auch der Paare untereinander. Hast du ein > passendes Scope, um dir das Augendiagramm bei den Datenraten anzeigen zu > lassen? Wenn nicht können dich die ersten Layouts ordentlich Lehrgeld > kosten. Ne, habe ich alles nicht (Software-Entwickler halt). Ich denke aber, dass
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Ethernet, LWIP, STM32F107 - no RX packets?
daraufhin beantwortet mit einem ARP Response. Dieser kommt nur nie am Laptop an. Spannungspegel, Augendiagramme, Takte habe ich geprüft und alles ist in Ordnung. Ich werde demnächst wohl erstmal mein PHY allein an eine andere Hardware hängen und testen.
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IBIS Modelle in SPICE nutzen
4967225 Wozu braucht man dann IBIS überhaupt und wie stellt es z.B. HyperLynx an daraus ein Augendiagramm zu berechnen?
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2x hdmi auf 1x dvi
die sogenannten "Augen" beginnen sich zu schließen. Wen es interessiert, der kann ja mal nach "Augendiagramm" googeln. Genau diese Impedanz ist übrigens der Grund (neben dem Übertragungsprotokoll was dem natürlich Rechnung trägt) weshalb es kein Y-Kabel geben kann. Man würde immer einen entsprechend
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Messung eines Differenzsignals
halben > Pegel, weil die Kapazität des Tastkopfes die Leitung zu stark belastet. Du kennst das Augendiagramm, dass du "gemessen" hast. Daran kannst du rasch einschätzen, ob und welchen Einfluss die Kapazität deines Tastkopfes hat. Wenn das Auge so groß wäre, wie spezifiziert und nur die einzelnen Bits
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Bandbreite RS485-Schnittstelle berechnen
aussehen, sondern die Augen müssen nur weit genug offen sein. https://de.wikipedia.org/wiki/Augendiagramm
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STM32 / USB / 1k5-Connect-PullUp
die Kondensatoren wie gesagt die Flankensteilheit verändern. Die optimalen Werte, um ein gutes Augendiagramm zu bekommen, hängen aber auch von anderen Faktoren wie dem Layout ab - hier kann man also nur Empfehlungen geben. Fazit: Ein GPIO-Pin mit Widerstand dran reicht - ich setze das selber auch bei
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TTL auf ECL mit 10124
ich mal ein Pseudozufallssignal durchschicken und am Ende mal schauen was rauskommt und ggf. n Augendiagramm messen. Leider ist mein Generator auf TTL getrimmt und eine Änderung bzw. Offset gibt es nicht. Da bin ich auf die Idee gekommen einen TTL<->ECL Translator zu benutzen. Seperat aufgebaut habe
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[V] HP 54645D MSO, 2 + 16 Kanal, 100 MHz, 200 MS/s
Oszis erweitert. Ein Autostore-Modus zum automatischen Übereinanderlegen von Messungen (zB für Augendiagramme) ist auch vorhanden. Lieferumfang: - HP 54645D Oszilloskop mit Tragegriff - HP 54658A Measurement & Storage Modul - 2x HP 10074A 150 MHz 10:1 Tastkopf mit komplettem Zubehör - 1x HP
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Kameramodul verwenden?
Leiterbahnenpaare, Einhalten der Impedanzen, etc etc. Für die messtechnische Überprüfung der Augendiagramme solltest Du ein Oszilloskop mit mindestens 11GHz Bandbreite griffbereit haben. Die MIPI-Standards sind nicht öffentlich und kosten $$$$. Zum Basteln also definitiv ungeeignet. Vergiss es.
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usb galvanisch getrennt -> usb zu usb device <-
TestID).( irgendwo in belgien oder niederlande ist eins ) und die testen so schöne sachen wie augendiagramme, 500 enumerations in folge, Chapter 9 Test, Test an OHCI EHCI UHCI controllern, mit 30 Meter kabel und 5 Hubs dazwischen (Golden Tree Test), ... Was du ausser der VID zum beantragen der TestID
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PSK 31 Modlulation im Mikrocontroller
upload.wikimedia.org/wikipedia/commons/7/78/Bpsk31bits.png Vielleicht ist es ja falsch. >Du mußt Dir das Augendiagramm mit der Phase auf der Ordinate >("Y-Achse") ansehen (B_P_SK!). Hast Du gerade einen Link?
Hallo Marc, wenn Du nach 'Augendiagramm BPSK' suchst, findest Du etliche Bilder. Leider steht immer Amplitude und nicht Phase auf der Ordinate, obwohl es sich um die Phase handelt. Leider ist damit die Amplitudeninformation nicht dargestellt
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USB hardwareseitig schalten
mit Transistoren auch nicht ohne weiteres ein paarhundert MHz schaltet auch? Schonmal was von Augendiagramm gehört?
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Welches Protokoll/Format könnte das sein?
uart-a-hardware-communication-protocol.html an. Eine für manche Belange bessere Darstellung nennt sich Augendiagramm. Anhand dessen kannst du gewisse Eigenschaften des Signals besser (und einfacher) bewerten und Hiweise auf die verwendete Leitungs-Codierung gewinnen. Kuck hier, wie man sich das per DSO anschauen
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LVDS Platine
Kannst du eine Testplatine anfertigen lassen, wo beide Schemata verwirklicht sind, und dann das Augendiagramm ansehen? Darauf kommt es bei LVDS doch an. mf
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Sniffer für serielle Schnittstelle, die Fehler lesen kann
Leitung zum PC auf der fallenden Flanke triggert, dann sieht man 3 Bitzeiten später im Oszi ein Augendiagramm des Signals für 1 Bit. c) Falls ein Rechteck-Generator zur Verfügung steht (und kein Oszi), dann den Empfänger (im µC) bei 0xe0 eine LED blitzen lassen. Die minimale und maximale Frequenz bestimmen
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500MHz+ CPLD/FPGA gesucht
die besten Ergebnisse. Ist immer noch keine substanzielle Aussage. WAS ist KONKRET besser? Augendiagramme? Max. Taktfreqeunz? >Probiert habe ich selber nix mit den SC. Aha. > Aber die 2Gbps läuft nicht über Tranceiver. Das ist ja das schöne dabei... Hast du einen Link zu Datenblatt. Kann
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suche VCO für 20 Mhz
, wenn die erkannte Flanke in dieses Fenster fällt. Den Nutzen dieser Erweiterung kann man im Augendiagramm sehr gut erkennen. Grüße Thomas
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[S] Tastköpfe Tektronix P6137
zu verbessern, wo mein halb kaputtes 60MHz Hameg nicht weiterkommt. Analog ist z.B. prima für Augendiagramme. Da erhoffe ich mir auch was von der Brighteye-Röhre. Die Agilent-Tastköpfe finden Google und ich nicht, hättest du mal einen Link? Das mit dem Taster ist nützlich, um das 2467B wieder aufzuwecken
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wie richtig messen? Radio-signal 868MHz IEEE802.15.4
kann ich das messen? Ich denke an ein Messgerät, was die Demodulation benutzt und mir dann ein Augendiagramm oder die QPSK-Demodulation auf dem Kreisdiagramm mit den 4 Punkten (heisst das so) darstellt. Was gibt es da für sinnvolle Messmittel? Vielen Dank für euere Anregungen, Adib. --
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RAM übertakten - Latenszeiten
Chipsatz und Speicherbausteinen, Versorgungsspannungen dieser Komponenten, usw.. Ggf. musst Du noch Augendiagramme der relevanten Signale mit entsprechenden Prüfadaptern aufnehmen. Bis Du damit fertig bist, ist der Computer eh so veraltet, dass Du diese Tests mit dem dann neu angeschafften Rechner gleich
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LVDS-Signale messen, wie?
prüfen, ob Setup- und Holdzeiten überhaupt stimmern und wie die Signale ganz allgemein aussehen (Augendiagramm). Damit kommt man schon mal SEHR weit. Die reine Logik kann man auch IM FPGA messen, Chipscope & Co lassen grüßen.
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interne differentielle Signale
eedbacksysteme für blinde Hunde? Das ist mit den "Augen" gemeint: https://de.wikipedia.org/wiki/Augendiagramm
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Differentielle Leitung zu Single Ended Leitung umwandeln
irgendwelche Skews macht. Warum machst du die Messung nicht zweistufig. Erster Schritt: Augendiagramm jedes LVDS Kanals ermitteln. Wenn da die Augen gut sind, dann kannst du davon ausgehen, dass die Phase zwischen LVDS+ und LVDS- Null ist. Wenn das bei allen Kanälen zutrifft, dann vergleichst
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Qualität CAN Analog Digital
ADC: Auflösung Genauigkeit Referenzquelle CAN: Augendiagramm o.ä. Was hast du vor? Es gibt eigentlich keine ICs mit "schlechten" I/Os. Entweder die passen zu deiner Spec, oder eben nicht. Wenn sie die Specs vom Datenblatt nicht einhalten ist das Teil
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2,4GHz Bandsperre
"sehr hohe" Dämpfung haben, aber so hoch das in der nachgeschalteten VSA - Software sich das Augendiagramm schließt (Auge muss nicht gänzlich geschlossen sein).
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Verständnissfrage Digitaloszilloskop
durch das nachgebildete Nachleuchten statistische Eigenschaften des Signals darstellen (z.B. Augendiagramm). MfG Falk
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2 Spartans verbinden, welcher IO Standard
das Layout nicht) besitzen einfach eine niedrige Störfestigkeit. Da hilft es nur die Größe des Augendiagramms aufzureißen - mit Schwellenwerten (low/high) die möglichst weit auseinander liegen. Die 24mA sind nicht notwendig, ich betreibe meine 400MBit/s (DDR) mit 2mA ohne Probleme. Du hast ja pro Leitung
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RS485 (Modbus Protokoll) mit mehreren Slaves
Wissenschaft draus machen. Man kann natürlich auch damit anfangen, dann aber sollte man sich auch mit Augendiagrammen beschäftigen.
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FPGA Clock Verteilung
Pfeile: > Input-Terminierungen? Die Farben der Pfeile beziehen sich auf die Farben der Augendiagramme aus einer Hyperlynxsimulation an dieser Stelle. Wird so in der verlinkten Appnote aus der auch, der Screenshoot stammt. In der Appnote werden die Auswirkungen der Terminierungsoptionen bei Xilinx