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Signaltabelle für DDS-Signalgenerator
Hallo, ich bin gerade dabei, einen kleinen Signalgenerator zu bauen, der nach dem DDS-Prinzip arbeitet. Meine frage ist, gibt es eine Art "Malprogramm" für diverse Signalformen, das einem eine 256 byte Wertetabelle erstellt? Danke!
Wertetabelle erstellt? Kann man mit Excel schnell selber machen. Oder einfach kopieren. Siehe [[DDS]].
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Delta-Sigma Antwortzeit/Samplerate
schon eine andere Hausnummer. Falls man einzelne Frequenzen erzeugen will, waere allenfalls ein DDS angesagt. Die kommen dann quarzgenau, mit einer naehzu beliebigen Aufloesung raus. Uns kosten auch nicht alles Geld.
Das riecht nach ewigem Abgleichen und unendlich viel Frust. Ich würde dir raten, einen einfachen DDS-Chip z.b. den AD9833 zu nehmen oder dich mit den steinalten OPL oder den etwas neueren OPL2-Chips von Yamaha bekannt zu machen. Das ist alles zielführender als das, was du geschildert hast. W.S.
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Wie viele Logicelemente braucht mein FPGA?
Erfahrungswerte. Reicht schon ein kleiner preiswerter EP2C5? Ich denke mal ein einfacher IQ Modulator (DDS, zwei Multiplikationen - 1*mit 90 Grad Phasenversatz und eine Addition) wird nur einen kleinen Bruchteil an Logicelementen verbrauchen, die für eine Ethernet-Schnittstelle nötig wären. Reichen schon
klein verpackt. Günther schrieb im Beitrag #6064860: > Ich denke mal ein einfacher IQ Modulator (DDS, zwei > Multiplikationen - 1*mit 90 Grad Phasenversatz und eine Addition) wird > nur einen kleinen Bruchteil an Logicelementen verbrauchen, die für eine > Ethernet-Schnittstelle nötig wären. Ja
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AD9958 nimmt Frequenzwort nicht an
Hallo zusammen, fuer meine Forschungsarbeit an der Uni muss ich mich mit dem DDS-Baustein AD9958 auseinandersetzen. Dafuer habe ich bereits eine Platine nach dem Schaltplan des Eval-Boards erstellt. Diese Platine wird dabei auf ein Arduino Mega 2560 aufgesteckt und via SPI ueber Pegelwandler angesteuert. Grundsaetzlich funktioniert antwortet mit der DDS auch. Im channel select register CSR habe ich beide Channels eingeschaltet und auf 3-Wire SPI umgestellt. Auch habe ich im function register 1 FR1 die wichtigsten Einstellung eingetragen. Wenn ich
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DDS AD9834/ PIC SPI Problem
den AD9834 von 2.048MHz und die SPI - Schnittstelle läuft auch über 2Mhz. Mein Problem ist, dass die DDS konstant einen Sinus mit 192.123kHz liefert. Ich habe versucht diverse Frequenzworte an den Chip zu senden, aber die Frequenz ändert sich nur im Bereich von 192kHz bis 214kHz. Ich habe mich an die Spezifikationen
Invertierter Clock ANSC.RC9 = 0; TRISC.RC9 = 0; set_peripheral_pps_pins(); DDS_Init(); Delay_ms(1); } [/c] [c] void DDS_Init(){ SPI1_Write(0x20); //Daten werden im FREQ0 angenommen für den Phasenakkumulator while(SPITBE == 0){} //solange der Buffer nicht
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DDS-Schaltung mit AD9834; Frequenz überlagert
Möglichkeit offen gehalten einen Analogen Buttworth TP 4. Ordnung zwischen die Ausgangstufe und den DDS zu schalten. Da die Ausgangsstufe (kombination aus LT106 und LT1210) aber selbst schon ein einen Tiefpass bildet, nehem ich diesen Filter momentan nicht her. Vor den Eingang der Endstufe musst ich nochmal
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ADF4351 et al. : Performance Messungen und Diskussion
ganz erfüllt werden, um es mal vorsichtig auszudrücken. Jetzt könnte man drüber nachdenken, ob ein DDS synthesizer besser geeignet wäre. Die Tage notiere ich mal die Konfiguration des Frickelmoduls. Nebenbei bemerkt macht es fast kein Unterschied ob ich fractional/n oder Integer wähle. Aber es
stabilsten ist, wo auch immer. Ein 2. Oszillator liefert die Ausgangsfrequenz und ist über einen DDS an den 1. angebunden. Man kann ihn also digital ziehen. Pegel und Nebenwellen sind ein Bastelobjekt für die Feiertage. Gruß, Gerhard
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BPSK-Signal Generierung
dass ich mit Matlab semuliert habe. ich möchte dieses Signal über Sendekarte,die aus FPGA,DAC und DDS besteht,senden. Das BPSK-Signal : Sbpsk(t) = dk(t)Acos(2π f0t) und dk(t) bei BPSK-Modulation ist dk(t) =0 oder 1. cos(2*pi*f0*t) kann ich mit hilfe DDS erzeugen aber wie kann ich die
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Frage zu DDS AD9858 - Versorgungsspannung
, ich hoffe, jemand kennt sich mit dem AD9858 aus. Und zwar - sind die Betriebsspannungen dieses DDS vollkommen unabhängig voneinander? Frage soll dahin abzielen, ob AVdd, DVdd, CPVdd beliebig hoch zueinander sein dürfen innerhalb der jeweils individuellen max. Grenzen (also die eine hat noch 0V, die
sondern genau das, was Du als erstes schriebst: blablabla Und keine Angst - bei mir läuft schon ein DDS bis 90MHz - ich glaube nicht, daß ich da mit dem AD9858 größere Probleme haben werde, die ein generelles "zum laufen bringen" verhindern würden. @ Josef Huber >also das mit den Spannungen. Wer wirklich
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Schaltplan-Kritik für "saubere" Versorgung bitte
Hallo Leute, für einen DDS-Wobbelgenerator bastle ich gerade an einer "sauberen" Versorgung. Versorgt wird (alternativ aus einer Batterie oder einem Akku-Paket) mit 6-12 Volt. Wegen Batterie möchte ich einen "Push-Butten-Controller
läuft ein AVR mit 12..20 MHz (Taktfrequenz wird sich erst ergeben) und der 50 MHz Oszillator für den DDS. Dieser soll dann 0..20 MHz möglichst sauber bringen. Analog gibts dann noch einen OPV (vermutlich AD8138) und eine VGA (vermutlich AD8370, gesteuert vom AVR) Ob das alles etwas "overkill" ist, sei
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Sinusgenerator mit PSoC 4
, der zum CY8CKIT - 049-42xx gehört. Zielstellung: *Sinussignal im NF- Bereich erzeugen* (8 Bit DDS) Darüber hinaus kann ein *Doppelton* erzeugt werden, 1100 Hz + 700 Hz Mittels Drehencoder kann eine Einzelfrequenz eingestellt werden. Auch die *Ausgabe eines Sweeps* (50 Hz .. 1800 Hz) ist
/5LP wurde ein gleichartiges Projekt erstellt, welches allerdings beim Doppelton mit 2- mal 8 Bit DDS arbeitet. PSoC 4 hat nur einen 8- Bit IDAC, der zweite kann nur 7 Bit. Das Projekt enthält außerdem einen *Bootloader*.
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Funktionsgeneratoren eBay
Aber ist es denn nicht erstaunlich das die kleinen Funktionsgeneratoren für 81€ weggehen, während DDS Generatoren neu, viel weniger kosten?
Vielleicht wissen die nicht was DDS Generatoren sind??
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3 Clock-Signale erzeugen
müsste mal schauen, welche Frequenzen der kann, er ist für höhere ausgelegt. Oder es geht, per DDS Sinussignale zu erzeugen, deren Nulldurchgänge gefilterst werden die also nicht an den Taktgrenzen des Erzeugers liegen, und dann per Komparator aus den Sinussignalen wieder Rechtecksignale zu machen
480Hz stufenlos in 1Hz Schritten >verstellbar sind. Es wird ein ATMega 169 eingesetzt. Nimm eine [[DDS]], die kann man auch in Software programmieren bei den Frequenzen. Und damit hat man eine SEHR hohe Frequenzauflösung und SEHR kleine Einschwingzeiten. MFG Falk
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Synthesizer mit Sinus Ausgang
ist schwierig zu realisieren. Naja, Sinus mit großer Frequenzvariation geht halt i.W. nur über DDS oder Abwärtsmischung -- wobei DDS bei den Frequenzen ja ausfällt. > Zudem wird das Phaserauschen durch den LO bestimmt. Rauscharmer Oszillator und Vervielfachung. Ist zwar Aufwand, aber
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Werkstatt einrichten (Prototypenbau im bereich Hobby)
ist nützlich aber ich würde da lieber Geld in Strippen investieren... Sonst würds so ein billiger dds-generator von ebay auch tun (13.- aus china) 73
steigt mit den Anforderungen. Von 50€ bis 50000€ ist alles möglich. >> Funktionsgenerator [...] DDS-Funktionsgeneratormodul, jenach Anforderungen 20-200€ >> Logic Analyzer [...] USB-Logicanalzer, ca. 20€ einfachste Version reicht hier für den Anfang >> Labornetzgerät.. Was könnt ihr hier empfehlen
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Frequenz generieren in C
Bereich noch eine Fallunterscheidung für den Prescaler einbauen und Timer kaskadieren. Alternative: DDS (direkte digitale Synthese) http://www.mikrocontroller.net/forum/1?filter=dds* http://www.mikrocontroller.net/forum/1?filter=freque* http://www.mikrocontroller.net/forum/1?filter=ton*
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Genaue Stromquelle mit Temperaturkompensation
NE555-Lösung? Oder gibts nen einfachen Baustein zur Sinuserzeugung? Ich wüsste nicht, womit ich ein DDS erzeugen könnte.
einen Funktionsgenerator und kümmere Dich um den Leistungsteil. Später kannst Du dann immernoch einen DDS oder sonstwas verwenden.
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Phasenverschobene Clockstreams erzeugen
freuen. Man kann auch einen CPLD/FPGA nehmen, da hat man noch mehr Möglichkeiten. Oder einen [[DDS]]-IC, viele haben zwei Kanäle und Möglichkeiten zur Phasenmodulation. Das macht die Anwendung noch einfacher.
Denkfehler? Zu den Alternativvorschlägen: CPLD/FPGA erfordern erstmal eine Einarbeitung und ein DDS-IC scheidet aus, da ich die Beschreibung etwas verainfacht habe, es handelt sich nicht um Rechteck-Taktsignale sondern um eine etwas andere Form, die man besser mit einer UART oder dergleichen realisiert
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Selbstständig machen Gesperrt
Produkte die sich sehr gut verkaufen ließen. Funktionsgeneratoren: Von Analog Devices gibt es sog. DDS Synthesizer IC s ,damit läßt sich eine Bandbreite von 0-300 MHZ erzeugen, fast jede Modulationsart ist möglich und alles schön Digital einstellbar(Frequenz,Ampiltude,Phase). Die Elektronik des komletten
habe ich das Projekt vorerst als gescheitert erklärt:-( Habe mir auch schon mal ein paar von diesen DDS Teilen geordert, nur liegen sie schon fast 4 Monate bei mir im Schrank:-( Magnetkartenschreibgeräte wie MAKINTERFAKE: http://www.makinterface.de/index_d.php3 Dieses spezielle Konzept existiert
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Sender 25khz Transponder
bewirkt die Ansteuerstufe mit dem Transistor und wozu ist > diese genau nötig? Du kannst ja mit dem DDS Ausgang nicht direkt die Spule beschicken. Erstens kommt da so gut wie keine Leistung raus und zweitens riskierst du eine Überlastung des Ausganges des teuren Chip. Da ist ein Emitterfolger genau
Matthias Sch. schrieb im Beitrag #3786621: > Du kannst ja mit dem DDS Ausgang nicht direkt die Spule beschicken. > Erstens kommt da so gut wie keine Leistung raus und zweitens riskierst > du eine Überlastung des Ausganges des teuren Chip. > Da ist ein Emitterfolger
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Seltsamer Frequenzzähler
einen sehr merkwürdigen Fehler gestoßen: Wenn ich die Frequenz nur sehr geringfügig ändere, z.B. mit DDS20 von 100,05kHz auf 100,06kHz dann wird anscheinend das Display nicht aktualisiert. Gate Time habe ich auf Minimum (100ms) gestellt.
Fehler sondenr Systembedingt korrekt. > Wenn ich die Frequenz nur sehr geringfügig ändere, z.B. mit DDS20 von > 100,05kHz auf 100,06kHz dann wird anscheinend das Display nicht > aktualisiert. Dann stell mal 100.05 und 100.07 ein. > Gate Time habe ich auf Minimum (100ms) gestellt. Laß mich raten
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Schnittbandkern Trenntrafo Wickeln "was muss ich noch beachten"
@dds5 Danke, sehr interessant :-) Da ich ja 4 Hälften habe, muss ich die Fläche wohl noch verdoppeln, in meiner Formel, denke ich!? nn UU @HW >>gerade Kilovolt-Potentiale anlegen willst
nicht reicht, schalte den Rechner mal aus und mach mal einen Spaziergang an der frischen Luft. @dds5 Ich finde das Thema ganz schön heftig, wenn ich überlege das ein 1,5mm² Kabel für 16A ausreichend ist. Klar ist es hier sehr sehr schlecht belüftet in vielen Schichten aufgetragen, aber hui... Nun
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FY6600 Sweep Sync
unabgeschirmte Wellenschleuder ist. Ich moechte und werde jedenfalls nicht tauschen. Einen 2-kanaligen DDS-Funktionsgenerator von HP haette ich auch noch. Da braucht man zum Einstellen definitiv laenger.
die horizontale mit der vertikalen logarithmischen Achse. Oder du musst mal einen Lehrgang in Sachen DDS machen. Ob du es glaubst oder nicht der FY kann das über den ganzen Frequenzbereich. HP schrieb im Beitrag #6686531: > Mein Groesster ist 19" breit, etwa 3 HE hoch, 80 cm lang > und wiegt ca.
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KiCad Funktionsgruppen
der richtige Begriff ist- in KiCad zeichnen. www.electronics-lab.com/wp-content/uploads/2015/04/dds_schematics-1024x664.png (erst bester Schaltplan) Ich meine z.B. links oben den Rahmen "DC 12V Input". Bis jetzt habe ich nur KiCad in die Möglichkeit gefunden "Grafische Line oder Polygon zeichen
Du hierarchische Schaltpläne. Das geht. > > www.electronics-lab.com/wp-content/uploads/2015/04/dds_schematics-1024x664.png > (erst bester Schaltplan) > > Ich meine z.B. links oben den Rahmen "DC 12V Input". Die "lang" gestrichelte olivfarbene Linie kann mit einem KiCad vom 22 November 2016
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Verständnissfrage zu Filtern am Ausgang von DDS basierten Signalgeneratoren
Hallo zusammen, ich möchte gerne für einfache Experimente einen DDS basierten Signalgenerator mittels des SI5351 Chips aufbauen. Dieser soll in den Bereichen um 40m (~7MHz), 20m (~14MHz), 1MHz und 10MHz arbeiten. Der SI5351 gibt ein Rechtecksignal an seinem Ausgang
der Grundwelle. Ein > BPF wäre in diesem Fall vorteilhaft. Der Bandpass, der diese Seitenbänder (DDS Jitter) heraus filtern kann, muss erst noch erfunden werden.
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Algorithmische Ebene Sinus VHDL
Guten Abend, ich habe die Aufgabe, einen DDS-Sinus-Generator zu programmieren und dazu die RT-Ebene größtenteils fertig. Allerdings komme ich bei der algorithmischen Ebene, die auch verlangt ist, nicht voran. In Skripten meiner Uni und online
abweichende Haltung haben. Du weisst ja: 3 Digital-Theoretiker: 5 Meinungen! In Deinem Fall könnte die DDS so aussehen: Y(PHASE) = INT (AMPLITUDENAUFLOESUNG x SINUS(INT (2 x PI x INT ((PHASENAUFLOESUNG x PHASENVEKTOR + 0,5) / PHASENAUFLOESUNG + 0,5) / TABELLENLAENGE + (0,5 / TABELLENLAENGE))) + 0,5) /
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24 bit Rechtgenerator mit feiner Auflösung
Einen ähnlichen Nonsense kann man sehen bei den Leuten, die sich mit nem Atmel AVR unbedingt ein DDS basteln wollen, mit nur 8 Bit Amplitudenauflösung, wo es doch einen billigen DDS von AD gibt, der mit 25 MHz Takt Sinus, Dreieck und Rechteck mit 10 Bit Auflösung und 24 Bit Phasenakku gibt? Bastelfieber
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Breitband-NF-Phasenschieber, DSP mit AVR
SSB-Sender auf einem Chip. Ein Mischer aus vier Analogschaltern 74HC4066 und ein 74HC74 und ein DDS-Rechteckgenerator und fertig ist der Kurzwellen-SSB-Sender, sozusagen ein SDT= software-defined transmitter. Ich habe mal das Filter in Scicos als Blockschaltplan eingegeben, bisher kommt noch
im free running ADC-Interrupt laufen, dann hat der Atmega immer noch einige Zeit für irgendwelche DDS/Drehgeber/Displayansteuerung übrig. Deinen PSK31-Decoder im AATIS Praxisheft habe ich gesehen.
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2 Channel Signalgenerator - Entwicklungsprojekt
werden, auch wenn dabei die Auflösung etwas geringer wird. Für nur Sinus gibt es auch gleich fertige DDS ICs - da reicht dann ein kleiner 8 Bit µC für die Steuerung und Anzeige.
Ulrich schrieb im Beitrag #2827893: > Für nur Sinus gibt es auch gleich > fertige DDS ICs - da reicht dann ein kleiner 8 Bit µC für die Steuerung > und Anzeige. Da kann er aber nicht die Phase von 2 Signalen einstellen. Soundkarte fällt vermutlich wegen unterer Grenzfrequenz
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[S] ASCEL AE20125 Firmware
Funktionsgenerator nicht mehr. Dieser hier: http://www.ascel-electronic.de/bausaetze/1/ae20125-10mhz-wobbel-dds-funktionsgenerator Die ausgegebene Frequenz stimmt nicht mehr mit dem Display überein(viel zu hoch und nicht linear). Also hab ich heute den SPI Bus mitgelesen und folgendes bemerkt: - die Daten
Have anyone find the dds generator dump for the atmega 168
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DCF77 Uhr, zum X.ten Mal, jetzt mit SAF
Soll hingegen nur die Frequenz auf lange Sicht gesehen so genau sein, so kannst Du das sehr genau per DDS (Direkter Digitaler Synthese) erreichen. Das funktioniert ungefähr so. Stell Dir einen Kreis vor. Du möchtest jetzt, dass sich ein Punkt gleichmäßig auf dem Kreis bewegt. Da Du in einem zeitdiskreten
Moin Christian, an DDS habe ich natürlich nicht gedacht - vielleicht auch, weil mir nicht klar war, dass auch ein "einfacher" Sinus reichen würde... Hier könnte nur schwierig werden, diesen (dann ja analogen Wert) auszugeben
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Dreieck-Spannung mit AD9833 DDS IC
>erzeugen kann ? Wenn du ein GUTES Dreiecksignal mit 10 MHz erzeugen willst, brauchst du einen DDS-IC mit DEUTLICH mehr Takt, so 200 MHZ würde ich mal ansetzen.
MHz als obere Grenze. Je nach Anforderungen wären auch 200 kHz als Grenze für den Dreieck passend. DDS ist eben keine gute Methode um einen höherfrequenten Dreieck zu erzeugen. Vermutlich ist das Dreieck vom XR2206 / ICL8038 noch besser oder wenigstens vergleichbar.
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Quartzoszillator für 4,1943 MHz
es sein? Ich wette, dass der Reichelt-Oszillator auch mit 3,3V schwingt. Warum willst Du den DDS mit gerade dieser Frequenz betreiben? Das ist doch gerade der Vorteil dieser ICs, dass man aus jeder nahezu beliebigen Frequenz eine nahezu beliebige andere Frequenz erzeugen kann. Warum erzeugst
Wissentlich die Spec verlassen kann ich mir nicht leisten. eProfi schrieb: > Warum willst Du den DDS mit gerade dieser Frequenz betreiben? > Das ist doch gerade der Vorteil dieser ICs, dass man aus jeder nahezu > beliebigen Frequenz eine nahezu beliebige andere Frequenz erzeugen kann. Siehe ganz
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Atmel ISR mehrere Ansprünge
Ein Pulsgenerator erzeugt mittels Timer-IRQ (192k/s) einen Impuls bei Überlauf eines Akkumulators (DDS-Prinzip). Dass hier kein Aufruf ausgelassen werden darf leuchtet ein. Abhängig davon, ob ein Puls erzeugt wurde, wird eine neue Berechnung des Frequenzwortes fällig. Es werden zwei Differenzen gebildet
Pulsgenerator erzeugt mittels Timer-IRQ (192k/s) einen Impuls bei > Überlauf eines Akkumulators (DDS-Prinzip). Jobst M. schrieb im Beitrag #6868158: > Es > werden zwei Differenzen gebildet, eine Entscheidung getroffen, eine > Multiplikation durchgeführt, eine Wurzel gezogen und eine Begrenzung
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Technisat Satboxx HD+ Schaltplan?
denken können. Ich gehe mal davon aus das es sich dabei um ein Sinus handelt. Ich habe mal mit mein DDS Funktionsgenerator ein halbwegs "schönen" Sinus erzeugt. Der Um die 22 KHz hat mit ein Vpp von 0,55 bis 0,75 Vpp. Ist ja noch im Toleranz Bereich. Mit einem LM358 Operationsverstärker und ein 220nF
kann. Mit meiner Konstruktion ist es möglich alle Ebenen anzusteuern. Halt per Hand Betrieb. Mein DDS Sinus scheint wohl noch Sauber genug zu sein. Die Nicht Abgeschirmten Bedienungen lasse ich hier mal weg. Das einzige was mich so ein bisschen Stutzig macht ist die Signalstärke die bei 27 % liegt
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Poljakow-Direktmischempfänger
klarkommen. Die 'I'-'Q' Phasenleute nehmen das 4-fache der Oszillatorfrequenz. Das ist ja heute dank DDS und PLL auch kein Problem mehr. Für einen einfachen RX gibt es für mich nur einen, den: 'Minimalist' aus EMRFD(*) Kapitel 8 S.5 Das Grundgerüst ist ein 2-Dioden Balance-Mischer und 2 NF Stufen
der Empfängerplatine erfordert eine Einstellmöglichkeit, egal wie. Ich habe viel mit einem separaten DDS von ELV gemacht; der Pegel ist nur in etwa bekannt. Mit einem Messsender geht es genauso. Wenn du dann aber weisst, dass +2dBm der optimale Wert ist...; schön zu wissen, aber es bringt dich auch nicht
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High End Mischer gesucht
mir das Service Manual vom Icom IC-7000 angesehen, mann die gehen da echt knall hart ran, alles mit DDS aufgebaut, womit man eine vielzahl von Filtern braucht. Aber der Noise Floor bleibt halt bei -80dBm. Die SSB Aufbereitung scheinen die eleganter zu machen. Die Mischen das Audio Signal auf 16,16KHz
halt einen Quarzfilter für 124,487MHz hat ist das gut. Aber ich sehe etwas zu viel Mischerei und DDS probleme. So gehe jetzt mal auf die Suche im WEB nach einer eleganteren SSB Aufbereitung. Gruß Sascha
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35MHz Scan-Empfänger auswerten
Beispielsweise Simprop SCAN 7 V2, oder ACT DDS-8/10. Kommt natürlich darauf an, zu welchem Empfänger ich die entsprechenden Informationen finde. Gruß Sebastian
die Fernsteuerempfänger von Hause aus hergeben. Na wurde ja auch Zeit, das PLL (oder gar tatsächlich DDS, wie der Name suggeriert) Einzug gehalten hat und das Quarzzeitalter endlich abgelöst wird. Ich ging davon aus, dass Du einen Tisch/Handscanner im Frequenzbereich einsetzen willst. Die haben meist
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H-Bridge 50Hz Sinus - LC Filter dimensionieren
; } [/c] Wenn du irgendwann aber mal flexiblere Frequenzen erzeugen willst, muss du das [[DDS]] Prinzip nutzen. Das ist so einfach wie clever. https://www.mikrocontroller.net/topic/291069?goto=3098563#3098563
So geht es mit DDS. https://www.mikrocontroller.net/topic/291069?goto=3098563#3101643
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Fragen zur Sinusmodulation (Anfänger)
scheitere dabei, den Sägezahn richtig zu dimensionieren. Das funktioniert nach dem Prinzip der DDS, d.h. die Sägezahnfrequenz entspricht der PWM-Frequenz. Über die Integration der Phase im Phasenakkumulator bestimmst du die Phase des Ausgangssinus und damit das Tastverhältnis vom PWM-Signal.
Michael schrieb im Beitrag #2752911: > Das funktioniert nach dem Prinzip der DDS, d.h. die Sägezahnfrequenz > entspricht der PWM-Frequenz. Über die Integration der Phase im > Phasenakkumulator bestimmst du die Phase des Ausgangssinus und damit das > Tastverhältnis vom PWM-Signal
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Rechen-Framework für VHDL
man mit der Rechnung bezweckt? Es kann ja sein, dass der Überlauf gewollt ist, wie z.B. bei einer DDS, einer digitalen PLL oder ähnlichen Anwendungen. Es gibt also hinsichtlich des Überlaufverhaltens (passiert / passiert nicht) und der Intention (gewollt, ungewollt) eine Kombination von 4 Fällen
man den z.B. nicht, kommen 2n-2 Bits heraus, bei händischer Berücksichtigung des Vorzeichens wie bei DDS 2n-1. Unterlässt man den Extremwert "-n" am Eingang, kommen immer maximal nur 2n-2 heraus und im Fall der Füllung des Wertes von nur z.B. 70% kommt 2n-3 heraus. Beispiel: die 5 Bit Zahlen zwischen
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Varicap Dioden bei Reichelt ?
Referenzperioden um einzurasten, bei 1Hz Referenz wären das eigentlich bis zu 20 Sekunden. Ich tippe eher auf DDS. Gruß Jadeclaw.
>Was für ein Synthesizer ist das denn? HP 8660C >Ich tippe eher auf DDS. 1975 gabs sowas noch nicht, und schon garnicht bis 1.3 GHz >PLL-Schleifen brauchen normalerweise minimal 8 - 20 Referenzperioden um > einzurasten, bei 1Hz Referenz wären das eigentlich bis
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Kommunikation mit AD-Wandler ADS1255
praktisch mein erstes Python-Programm und mein erstes auf dem Raspberry. Vor dem ADS1256 kam schon der DDS, der im Programm auch erwähnt ist. Der hat auch erst mal keine Reaktion gezeigt, ich stand praktisch an allen Fronten am Anfang - waren es Hardwarefehler, Softwarefehler oder hatte ich das Datenblatt
mit Hard- und Software anderer im Web konnte ich schließlich eine erste Reaktion an einem Pin des DDS feststellen, damit war der Durchbruch geschafft. Mit dem ADS1256 ging dasselbe nochmal los. Wenigstens kann ich jetzt etwas Python, kommt mir vor wie ein würdiger Nachfolger von BASIC, speziell für
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verschwundene MIDI-Synth-Boards: Nachfolgetechnik?
damals aus den 4 MB Samples viel rausholen können. Aber letzten Endes waren das Sample Player mit einer DDS, nachgeschaltetem digitalen Tiefpass-Filter und einer Effekt Sektion. Die Kunst war dann, aus denen gute Sounds rauszuholen, also eben mit dem Trick, zwei Oszilatoren mit ähnlichen Samples leicht zu
und > Rechenkapazität, um einen DAC zu treiben und wenn ich nur Sinus möchte, > ginge auch jeder DDS-Baustein. Auf der Zeitlinie, wo der SAM8905 seine Existenzberechtigung hatte, gab es keine grossen 20 Euro FPGAs. Eher Zwerge aus heutiger Sicht. > Soweit es die MIDI-fähigen Chips aus dieser
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Closed-Loop Stepper Motor
Schrittmotorsteuerungen. Dafür hat man natürlich den Zusatzaufwand mit der Verdrahtung des Encoders. Die digitalen DDS1-Controller von LAM sind ein Beispiel dafür, die sind noch relativ neu am Markt [1]. Mit freundlichen Grüßen Thorsten Ostermann [1] https://www.mechapro.de/pdf/DDS1_Flyer_DE.pdf
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Hochpass/Tiefpass mit OpAmp und single supply
pass Filter dabei soweit ich das sehe. Der hier ist schlauer: https://www.elektronik-labor.de/AVR/dds/Noise.html Hier hab ich mir das PDF nicht angeguckt: https://www.electronicdesign.com/technologies/analog/article/21799090/build-a-simple-precision-pinknoise-generator
MaWin schrieb im Beitrag #6535067: > Der hier ist schlauer: > https://www.elektronik-labor.de/AVR/dds/Noise.html ja, uC basierte PRNGs gibts viele, aber ich hatte Lust mal wieder ein TTL-Grab zu bauen :-) (ok, CMOS-Grab...) MaWin schrieb im Beitrag #6535067: > Hier hab ich mir das PDF nicht angeguckt
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DDS Channel Auswahl (CORE Generator)
Hallo zusammen, ich habe mit dem CORE Generator (ich benutze noch 10.1) einen DDS erzeugt mit 10 Kanälen. Nun möchte ich zwischen den verschiedenen Kanälen welche verschiedene Frequenzen haben wechseln. Leider funktioniert gerade dieses nicht. Ich setze im den Channel Port die
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AVR Synthesizer mit ATxmega128A1
Jitter (siehe Bild ca. 3Khz) in meinem Synthesizer verringern. Für die Klangerzeugung benutze ich die DDS Synthese. Das Phasen Jitter beträgt in allen erzeugten Frequenzen 25usec. Das entspricht genau der Abtastrate im Synthesizer. Code Beispiel DDS-Synthese in meinem Synth [c] //——————————————————
sind aber nicht viele Stützstellen, um mit verschiedenen Frequenzen in die Tabelle zu gehen. Gute DDS-Bausteine arbeiten mit 2Mio grossen Tabellen.
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VFD-Anzeige des HP 34401A Multimeters
dass es sich um ein Ersatzteil für ein Multimeter handelt: http://ec.europa.eu/taxation_customs/dds2/taric/measures.jsp?Lang=de&Taric=90303100&SimDate=20120923 4,2 % Ist es dagegen ein reines Display, dann könnte man bei passender Deklaration wohl ohne Zoll davon kommen: http://ec.europa.eu/taxation_customs/dds2/taric/measures.jsp?Taric=8531802090&Lang=de&SimDate=20120928
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Real Time Sortieren im FPGA
mit mehr Werten, als nur mit 2en. Ich habe das irgendwo hier schon mal im Zusammenhang mit den DDS-Funktionen erwähnt, wo es um die Erzeugung von Daten > Taktfrequenz ging, finde es aber ad hoc nicht. Damals wurden z.B. aus 250MHz DDS Sinus aus dem FPGA 1GHz Daten gewonnen. Dabei wird dann nicht