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AD Converter Timing Problems
Duke: 1) Das Augendiagramm habe ich nicht ermittelt. Das würde mir - falls ich an den Pins des AD-Wandlers direkt messe - ja auch nur zeigen, ob die Werte korrekt ausgegeben werden. AD liefert eine zum Kit passende Software
Vorgehen wäre hilfreich. Sagt mir, was ich dazu ausprobieren bzw. posten soll. Duke: Arbeite am Augendiagramm ;)
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Kompakte FPGA-Boards - Erfahrungen
ist die blaue auge wirklich extrem gross und eckig :) Weiß jemand, wie bei Xilinx diese Art Augendiagramme erstellt wird? Irgendwie sehen die so anders aus, als die vom Scope. Duke
und der daraus kommenden BER wird das Augendiagramm erstellt. Man kann so recht schnell die optimale Einstellung für den MGT finden. Hat die VIVADO 2014.4 eigentlich immer noch den Bug, dass das Augendiagramm nur funktioniert, wenn die Windows Systemsprache
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USB 3.0 Analyzer (für FX3, ARM)
gut im Griff. Wir hatten aber auch bei 2.0 schon kniffelige Sachen, da hat der geholfen. Tür Augendiagramme bringt das aber nix, dsa brauchst diu ein richtig schnelles Oszi und die passende Software drauf.
> Griff. Wir hatten aber auch bei 2.0 schon kniffelige Sachen, da hat der > geholfen. Tür Augendiagramme bringt das aber nix, dsa brauchst diu ein > richtig schnelles Oszi und die passende Software drauf. Ja, dessen bin ich mir bewusst. In einem ersten Schritt geht es mir auch drum, den USB 3.0
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Datenleitungen USB und SATA bei zweilagiger Platine: Standardempfehlungen?
klappt, muss man probieren und wenn möglich mit einem TDR, Netzwerkanalysator oder schnellen Oszi (Augendiagramm) messen.
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Netzwerk auf Cat5 prüfen
Augendiagramm messen (lassen).
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Was ist ein Kabel Equalizer?
betreiben hier 5GBit/s über ein 1m PCIe Kabel ohne Redriver und das geht Fehlerfrei mit weit offenem Augendiagramm am Empfänger.
5GBit/s über ein 1m PCIe > Kabel ohne Redriver und das geht Fehlerfrei mit weit offenem > Augendiagramm am Empfänger. Auch über 400m Koaxkabel? Die 270 MBit/s werden bei SMPTE SD und DVB-ASI verwendet. Der verlinkte Baustein kann auch die HD Varianten von SMPTE (1.5 GT/s und 3 GT/s) mit
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LVDS-Signale messen, wie?
prüfen, ob Setup- und Holdzeiten überhaupt stimmern und wie die Signale ganz allgemein aussehen (Augendiagramm). Damit kommt man schon mal SEHR weit. Die reine Logik kann man auch IM FPGA messen, Chipscope & Co lassen grüßen.
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Filter für SDH / SONET
. Auch findet man diese Darstellung recht häufig in Büchern und anderen Quellen im Bezug aufs Augendiagramm. Auf der anderen Seite aber verschlechtern sich dadurch einige Messwerte (u.a. Rise-/Fall time). Google lieferte zu diesem Thema nur eine halbwegs sinnvolle Antwort, hätte dazu aber eigentlich mehr erwartet. In der dort genannten ITU G.957 wird das Augendiagramm auch das eher harmonische Signal erzeugt. Siehe: http://www.home.agilent.com/en/pd-29270-pn-87441D/stm-16-oc-48-filter?&cc=DE&lc=ger
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Messen eines differenziellen Signals (Sampling Oszilloskop)
Augenhöhe, Extinction Ratio, Bitrate, usw. messen. In meinen Augen funktioniert die Erzeugung des Augendiagramms nicht (richtig). Im angehängten Bild ist einmal ein Ausschnitt des Signals im Oszilloskop-Modus und einmal im Eye/Mask Modus. Von t_0 bis t_n sehe ich immer nur die selben Bits, in diesem Fall
als Mode "Data", nach dem das dann auf "Pulse" umgestellt wurde, erschien auch das gewünschte Augendiagramm. Danke :)
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Verschiedene USB Spannungen (Vcc & GND) schalten
welche > bei den Augendiagrammmessungen sehr schlechte Werte erziehlt hatte. Was hat das Augendiagramm mit den Versorgungsleitungen zu tun? Das ist für die Datenleitungen …
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byzantinische Takterzeugung
Beschreibumg sind nicht so gut. Aber Bit-Fehler, Timing-Fehler in der App. (Bit Legastheniker ) Das Augendiagramm ()()()()() wurde erfunden um solche Metha-Stable Fehler zu finden. Is all Digital ... No its "Analooooog" you see via a Clock Modell. Die Prüf-Experten haben uns den Externen Quarz beharkt
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Emitterfolger, Ausgangsimpedanz, LED niederohmig treiben
@ Robin (Gast) > AUGENDIAGRAMM_60Mhz-60mBIT.png Sieht aus wie Mike Tyson nach 12 Runden, also die Augen ;-) >Als Bandbreite kommt bei mir 30MhZ raus. Das heißt dass man ca 60Mbit >über optische Strecke übertragen kann
Die Schaltung ist auf einer Leiterplatte gelötet und es wurde mit Hilfe eines Empfängers das Augendiagramm untersucht.
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Ethernet Signale messen mit Oszi
. Was mich stört ? Ich habe erwartet, dass die Signale Rechteckformen haben, die auch für ein Augendiagramm geeignet wären. Kennt jemand eine gute Literatur oder Link etc, in der diese Signalcharakteristik gut beschrieben wird ? Google bringt mich nicht weit. Danke
//www.tek.com/dl/61W_17381_3.pdf, da findest du reichlich interessantes, auch was es mit den Augendiagrammen auf sich hat. Was auch noch interessant ist, ist https://en.wikipedia.org/wiki/Autonegotiation. LG, Sebastian
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Zulässige kapazitive Belastung für Datenübertragungsleitungen?
googel mal unter "Augendiagramm". Mit einem Oszi kannst du dann die Übertragungsstrecke beurteilen. Grüsse
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Messen am 100Mbit Switch
Jahr. Ich hab die Polaritäten korrigiert, aber immer noch keinen Connect. Beim Anschauen vom Augendiagramm wurde es mir dann irgendwie schon gruselig, zwischen Switch-Magnetic sieht es ja noch ganz gut aus, aber auf der anderen Seite vom Übertrager sieht es dann nicht mehr so toll aus. Die Leiterbahnen
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USB hardwareseitig schalten
mit Transistoren auch nicht ohne weiteres ein paarhundert MHz schaltet auch? Schonmal was von Augendiagramm gehört?
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RAM übertakten - Latenszeiten
Chipsatz und Speicherbausteinen, Versorgungsspannungen dieser Komponenten, usw.. Ggf. musst Du noch Augendiagramme der relevanten Signale mit entsprechenden Prüfadaptern aufnehmen. Bis Du damit fertig bist, ist der Computer eh so veraltet, dass Du diese Tests mit dem dann neu angeschafften Rechner gleich
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USB Switch 2:16 Multiplexer
sich bringt habe ich bei Maxim erstmal ein EV-Kit des MAX4899AE bestellt und gleich mal eine Augendiagramm Messung durchführen lassen als diese an kamen. Das Ergebnis ist nicht grade berauschend (siehe Anhang). Dazu ist zu sagen, das der Test NUR mit EINEM EV-Kit, also mit nur einem MAX4899AE durchgeführt
gewünscht. HF-Relais ist nicht wirklich eine Lösung. Diese wurden schon einmal verwendet, das Augendiagramm war dabei auch nicht wirklich toll (gerade bei Apple Produkten, die haben eine ganz üble Anforderung). Zudem würde ich sehr gerne mit CMOS Technik arbeiten. Ich hoff das Thema warum kein HUB
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Kameramodul verwenden?
Leiterbahnenpaare, Einhalten der Impedanzen, etc etc. Für die messtechnische Überprüfung der Augendiagramme solltest Du ein Oszilloskop mit mindestens 11GHz Bandbreite griffbereit haben. Die MIPI-Standards sind nicht öffentlich und kosten $$$$. Zum Basteln also definitiv ungeeignet. Vergiss es.
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Xilinx vs. Altera - The battle
Moment (12:48), wo präsentiert wird wie geil der Xilinx Transceiver läuft, indem man kurz ein Augendiagramm und Textfelder mit Nullen präsentiert, sollten die beiden aufspringen und einen Voodootanz zeigen. Ähnlich wie dieser: http://www.youtube.com/watch?v=4sIXDKMh_gk Dann würde der Zuschauer
Schirm. Bei 2:00 sieht man Kabel an Kanal 2 und 4, aber nur Kanal 4 ist aktiviert (LED). Das Augendiagramm (2:02) ist aber auf Kanal 1 aufgenommen worden (bei 50 ps Timebase?) Duke
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APIX2 Chip - Simulation mit Berechnung des Augendiagramms
www.inova-semiconductors.de/en/products_apix2.html) ausgehendes Signal soll simuliert und das zu erwartende Augendiagramm an der Datensenke auf Basis der S-Parameter berechnet werden. Die Simulation und Berechnung soll zudem mit CST Microwave-Studio bzw. CST Design-Studio erfolgen. Scheinbar habe ich hier noch ein
166,5 ps, Fall time = 166,5 ps sowie eine Pulse length von 333 ps erhalte ich das beigefügte Augendiagramm. Die Pulsebreite fällt jetzt aber deutlich kleiner aus bzw. werden innerhalb der 666 ps zwei Augen inkl. der Anstiegs- und Abfallzeit dargestellt. Wie ist der Zusammenhang zu verstehen?
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Impedanz: Unterschiedliche Leiterbahnbreiten oder 60 statt 50 Impedanz
liest ein Muster aus, z.B. 1010... dann hast du auch in den Daten den Takt. Beim Aufzeichnen des Augendiagrammes macht man es ja ähnlich. Man schaut sich die Datenleitungen eine gewisse Anzahl von Taktzyklen an und schreibt die Signalformen immer übereinander. Je höher die Freuqenz, destor kleiner das Auge
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Kennt ihr auch solche Fälle?
auch so ein Fall wie mein Kommilitone. Er musste einmal den Laboring. vertreten und sollte ein Augendiagramm zeigen und hat nicht mal ein stehendes Bild auf den Schirm bekommen. Schon dumm, wenn man nicht einmal die Physiker-Taste (Autoscale, damit versetzt man das Scope wieder in einen benutzbaren Zustand
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Problem mit Xilinx SERDES bei EMV Störung
Kannst du vor Ort ein Augendiagramm aufnehmen? Vielleicht ist es schon relativ geschlossen, so dass es in einer rauhen Umgebung kurzzeitig "geschlossen" wird. (Hilft es die "pre-emphasis" zu ändern?) Kannst Du die Auswirkungen
SuperWilly schrieb im Beitrag #3101565: > Kannst du vor Ort ein Augendiagramm aufnehmen? > Vielleicht ist es schon relativ geschlossen, so dass es in einer rauhen > Umgebung kurzzeitig "geschlossen" wird. > (Hilft es die "pre-emphasis" zu ändern?) > > Kannst Du die
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Messen von seriellen HighSpeed Signalen (USB2, Sata)
> wie man eventuell > eine Tendenz sehen kann (Signal: besser, schlechter) Geräte die nen Augendiagramm darstellen können sind ja noch teurer.
40GS/s. Hat allerdings selbst mit Rabatt schon 70k€ gekostet icl. 2 6GHz Differenz-Proben. Die Augendiagramm Software kostet allerdings auch nochmal etwa 10k€ Aufpreis.
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Verbindungsleitung Digitalausgang 75 Ohm / 50 Ohm
spürbar. Mit entsprechender Meßtechnik sieht man bei solchen Kabeln gleich ein schlechteres Augendiagramm mit weniger weit geöffneten Augen bei ansonsten gleichen Bedingungen. > 2. Alternativ könnte ich auch ein Kabel basteln aud > 75-Ohm-Leitung-Meterware und zwei Cinch-Stecker. Dann hätte
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Layoutüberprüfung: Ethernet PHY
Bei den parallelen TXN,TXP,RXP,RXN gibts keine Probleme ESD-Schutz ist drin Simulierten Augendiagramm passt Ich lass übermorgen ne Prototypenplatine fertigen...
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Sowas fürs zu Hause
im Display gerade > sieht? Ja, du nicht? @Xeraniad: http://de.wikipedia.org/wiki/Augendiagramm
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Datei:Eye-pattern-explain4.gif
Erklärung der Entstehung eines Augendiagramms anhand von 4 Punkten - Teil4
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Artikel
Datei:Eye-pattern-explain3.gif
Erklärung der Entstehung eines Augendiagramms anhand von 4 Punkten - Teil3
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Artikel
Datei:Eye-pattern-explain2.gif
Erklärung der Entstehung eines Augendiagramms anhand von 4 Punkten - Teil2
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Artikel
Datei:Eye-pattern-explain1.gif
Erklärung der Entstehung eines Augendiagramms anhand von 4 Punkten - Teil1
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DDR2 Design mit Eagle?
(ich weiß nicht, ob es schon genannt wurde) Um das Augendiagramm bei den genannten Frequenzen aufzunehmen, benötigst Du zudem ein hochwertiges Oszilloskop. Und damit ist jetzt kein Gerät im unteren vierstelligen Bereich gemeint...
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Wittig(welec) DSO W20xxA Hardware (Teil 2)
sich das Videobild auf den Bildschirm erahnen, es wird in Echtzeit 1:1 angezeigt. Und auch die Augendiagramme sehen echt geil aus, zumind. beim ersten mal. Zu den 3 Bildern: das erste ist aus einer echten Messung (Digitalschaltung mit zufälligen 0/1-Wechseln), das Array wurde dann per UART an den
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Transistor der ca: 100MHZ verträgt
"Halbkugelnähnliche Signale" die da > ankommen... Und dann arbeitet man mit den Begriffen "Augendiagramm" und "Jitter" usf.
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VOLTCRAFT DSO-3062C 60 MHz = baugleich mit?
günstigen Rigol-Oszis unterstützen edge-triggering auf beide Flanken gleichzeitig, z.B. für Augendiagramme. Wäre das auch auf den tekway/hantek-Geräten möglich? * Die Cursor funzen jetzt auch im stop-Mode, haben jedoch wie schon angedeutet Probleme beim Umschalten der scales. Zudem habe ich das Gefühl
günstigen Rigol-Oszis > unterstützen edge-triggering auf beide Flanken gleichzeitig, z.B. für > Augendiagramme. Wäre das auch auf den tekway/hantek-Geräten möglich? technisch möglich auf jeden fall, Rigol trigger hardware ist nicht unbedingt anders als die von HanTekway (ausser FPGA inhalt). Evt. sollte
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USB 2.0 Design-Rules
man die je nach Layout auch weglassen. Das Optimum kann man sowieso nur bestimmen, wenn man ein Augendiagramm aufnimmt und dafür fehlt den meisten das Equipment - ist aber auch fast nie im Hobby-Bereich notwendig.
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Kaufberatung Oszilloskop der gehobenen Klasse
Fehlersuche. Er ist definitiv kein Werkzeug, um Signalqualitäten en detail zu messen, wenn man mal von Augendiagrammen absieht. Natürlich kann man damit ein Audiosignal anschauen und grobe Fehler sehen, also Anschlag irgendwo wegen Übersteuerung oder falschem Arbeitspunkt, aber bei der Suche nach Glitches oder
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USB Design verbessern? Augendiagramm schlecht
Widerstände und leider auch einige Vias. Die Leiterplatte ist berechnet worden und korrekt. Das Augendiagramm sieht bei 4m Kabel schon recht mager aus. Gerade im vorderen Bereich ist das Auge schon recht eingeschnürt. Im Gegesatz dazu sieht ein USB-Stick mit gleicher Kabellänge viel besser aus. Ich habe
Das kommt darauf an, woher die Störungen und Probleme kommen. Das [[Augendiagramm]] lässt sich zumindest dahingehend nutzen, um zu sehen, ob der Empfänger überhaupt eine Chance hat, jederzeit sauber zu erkennen.
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Beurteilung Signalqualität 10Mbit 100Mbit Gbit Ethernet
habe ich in einer Vorlesung gehört, dass zur Beurteilung ,z.B. des Signal Rauschverhältnisses, Augendiagramme eingesetzt werden können. Welche Messgeräte kennt / verwendet ihr für diesen Zweck? (Bei Tektronix habe ich ein Oszilloskop gesehen, dass dessen mächtig ist) Welche weiteren Verfahren gibt es?
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Hochfrequenzte Lasermodulation
@ Fabian S. (jacky2k) >auch wunderbar. Im Anhang ist ein Augendiagramm des Empfängers bei ca. >500kBaud und 8 Stufiger Übertragung, also 1,5MBit/s. Dein Augendiagramm ist unbrauchbar. Du triggerst falsch. >Den Laser habe ich dafür mit einer steuerbaren Konstantstromquelle
> das funktioniert auch wunderbar. Im Anhang ist ein Augendiagramm Welches Augendiagramm ? Da funktioniert eher nichts. > Nach was regelt man denn nun so eine Diode? Sie ist normalerweise für den Datenstrom nicht schnell genug, obwohl normal ja eher
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Oszi für USB 2.0 und PCIe 2.0 compliance testing
Um PCIe 2.0 ordentlich zu messen und die Augendiagramme zu bewerten reicht ein Oszi mit 6GHz BB vorne und hinten nicht. Das wird schon mit 1.1 knapp, sind ja immerhin schon 2,5GHz Signal. Hinzu kommen die sauteuren Proben für solche Frequenzen. Ich
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Messung eines Differenzsignals
halben > Pegel, weil die Kapazität des Tastkopfes die Leitung zu stark belastet. Du kennst das Augendiagramm, dass du "gemessen" hast. Daran kannst du rasch einschätzen, ob und welchen Einfluss die Kapazität deines Tastkopfes hat. Wenn das Auge so groß wäre, wie spezifiziert und nur die einzelnen Bits
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2x hdmi auf 1x dvi
die sogenannten "Augen" beginnen sich zu schließen. Wen es interessiert, der kann ja mal nach "Augendiagramm" googeln. Genau diese Impedanz ist übrigens der Grund (neben dem Übertragungsprotokoll was dem natürlich Rechnung trägt) weshalb es kein Y-Kabel geben kann. Man würde immer einen entsprechend
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Entwurf eines Laborversuchs zu High Speed Digital
Signalen mit höherer Flankensteilheit und dem Einsatz von (P)ECL zu erweitern. Dabei sollen Augendiagramme die Einwirkung von Jitter (bedingt durch Crosstalk und weitere ungewollte Einflüsse) verdeutlichen. Unsere Überlegung ist es, ein Versuchsboard zu entwickeln, welches in mehrere Module gegliedert
Infos zu Herzen genommen und nochmal über den Aufbau des Versuches nachgedacht! Über Augendiagramme sollen nun die Kabeleigenschaften weiter verdeutlicht werden. Um die Augendiagramme darzustellen, dachten wir uns, mittels eines Microcontrollers eine PRBS zu erzeugen, die auf das Kabel gegeben
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LVDS Platine
Kannst du eine Testplatine anfertigen lassen, wo beide Schemata verwirklicht sind, und dann das Augendiagramm ansehen? Darauf kommt es bei LVDS doch an. mf
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STM32 / USB / 1k5-Connect-PullUp
die Kondensatoren wie gesagt die Flankensteilheit verändern. Die optimalen Werte, um ein gutes Augendiagramm zu bekommen, hängen aber auch von anderen Faktoren wie dem Layout ab - hier kann man also nur Empfehlungen geben. Fazit: Ein GPIO-Pin mit Widerstand dran reicht - ich setze das selber auch bei
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Bytefehler beim Schreiben ins DDR2
sollte drinstehen, wie das geht. Zum Augentraining siehe z.B. http://de.wikipedia.org/wiki/Augendiagramm - man sucht sich die Stelle mit der weitesten Augenöffnung. Die Frage nach der Hardware hätte ich jetzt auch gestellt: Eval-Board von Xilinx oder einem Dritten? Eine eigene Entwicklung? Sind
