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Suche großes LCD/TFT für STM32F4Discovery
Controller. Die gibts aber max. bis 4 Zoll. Ich habe hier so etwas mit einem 2.4" Display und einem XC9572XL gemacht. Zur Weichware bin ich noch nicht gekommen, da sind dringendere Projekte dazwischen gekommen. fchk
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CPLD mit NEXYS3 Board Programmieren
das NEXYS3 Board zugreifen kann und dann mithilfe der rausgeführten JTAG Schnittstelle einen z.b. XC9572XL programmieren kann?
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8086 Beschaltung Speicherlogik (BHA A0 MR MW)
Hier kommen ja richtige gute Ansätze. Auf der CPU-Seite sieht es bisher wie folgt aus: ein XC9572 generiert die Clocksignale (8284) und stellt den Buscontroller (8288). An dem sind noch genug I/Os frei. Alles was hier generiert wird, geht auf einen Leiterplattenverbinder. Momentan ist der Datenbus
Interrupts sind Platzhalter...da habe ich noch keine richige Idee...wahrscheinlich wird es noch ein XC9572 werden. Grundidee war, alles auf die kleinste Funktionseinheit herunterzubrechen um nicht die Komplexität der "Kuchenbleche" zu haben... Außerdem lassen sich Europlatinen zur Not noch selber ätzen
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BreadBoard mit SMD
bei 0.4mm (0.25 breiter Kanal,0.15x2.0mm Steg) genauso wie bei meinem TQFP-Adapter für einen XC9572-100.
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Gibt es irgendwo ein günstiges Programmiergerät (für Xilinx CPLDs XC9572)?
Hallo Forum, ich habe in meiner Bastelkiste mehrere CPLDs von Xilinx (XC9572) und möchte damit irgendwas basteln - weiss noch nicht genau was. Früher habe ich sie über die parallele Schnittstelle programmiert - mein PC ist nun defekt und ich habe keine Rechner mit paralleler
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Schaltung mit 4068
ausprobieren. Man kann dann auch die Funktion der Schaltung erstmal simulieren. Als CPLD wäre der XC9572 geeignet. Er ist 5V-fest und hat ein PLCC-44 Gehäuse, d.h. man kann ihn in einen Sockel auf ne Uniplatine stecken. Er hat 72 Macrozellen. Jede Macrozelle besteht aus einer (fast) beliebig verschaltbaren
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FPGA-Porterweiterung durch 74HC595
Warum nimmst du nicht einen kleinen XC9536XL/XC9572XL als Erweiterung. Ist flexible konfigurierbar und ebenfalls 5V-tolerant. Falls du DIP-Gehäuse brauchst: Bei Ebay gibts 36er mit 40erDIP ab 8 Euro inkl. Quarz..
@ Bert (Gast) >Warum nimmst du nicht einen kleinen XC9536XL/XC9572XL >als Erweiterung. Ist flexible konfigurierbar und >ebenfalls 5V-tolerant. >Falls du DIP-Gehäuse brauchst: Bei Ebay gibts 36er >mit 40erDIP ab 8 Euro inkl. Quarz.. Seit wann gibt es CPLDs von
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Logiksignale nur durchlassen, falls nicht mehr als eine 1
Die Logik umzusetzen wäre doch was für einen kleinen CPLD wie z.B. XC9536, XC9572.
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Altium JTAG Programmer + XC9572xl CPLD
Hallo zusammen, ich habe hier auf meinem Experimentierboard einen Xilinx XC9572XL, der sich nicht mit dem Altium JTAG Programmer ansprechen lässt. Die JTAG Leitungen sind nur an die JTAG Buchse angeschlossen und 1:1 an den JTAG Programmer von Altium Designer angeschlossen. GND
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Problem mit Xilinx Platform Cable USB clone
mir dazu auf ebay ein Xilinx Platform Cable USB (DLC9G) china clone gekauft. Versucht hab ich ein XC9572XL auf dem Experimentier Board von Ulrich Radig (welches ich auf 3,3V angepasst habe) zu programmieren. Leider schlägt dies immer fehl. Das DLC9G wird von Windows XP erkannt. Wenn ich in iMPACT neu
/cpld_test.jed' ... done. INFO:iMPACT:1777 - Reading e:/Xilinx/13.1/ISE_DS/ISE/xc9500xl/data/xc9572xl.bsd... INFO:iMPACT:501 - '1': Added Device xc9572xl successfully. ---------------------------------------------------------------------- -------------------------------------------------------
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XC9572XL kein CLK?
all zu simple ist - ich bin nämlich blutiger Anfänger. Im folgenden Beispiel brennt die LED am XC9572XL (VQ44): [c] NET "CLK" LOC = "P43"; NET "LED1" LOC = "P20"; NET "RESET" LOC = "P33"; entity alogic is Port ( CLK : in STD_LOGIC; RESET : in STD_LOGIC
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welcher controller für retro Spielkonsole
dort solche Aufgaben wie das bitblitting unterzubringen, davon hab ich hier noch welche rumfliegen XC9572 15ns, XL95144 10ns.
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Probleme mit der Erstellung eines Automaten
VHDL-Neuling und habe zwei Probleme beim unten stehenden Automaten. Ich nutze folgenden Baustein: Xilinx XC9572XL. 1. Kommen mehrere Warnungen darüber, dass ich Latches eingebaut habe: Found 8-bit latch for signal <data_to_CPLD>. Latches may be generated from incomplete case or if statements. We do not recommend
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USB-Blaster CPLD-Design
Hallo, ich habe mir einen USB-Blaster selber gebaut (FT245RL + XC9572XL) Das, was Sie brauchen, habe ich angehängt! MfG aus Westerwald
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ByteBlaster2 Installation
M. Schwaikert, ich habe meinen USB_Blaster selber gebaut. Ist nicht viel drin: FT245RL und XC9572. Wird als Original "Altera USB Blaster" erkannt und läuft sein ca. 1.5 Jahre ohne Probleme. Schaltplan, Platinenlayout, Sources u.s.w. kann ich natürlich, wenn Interesse besteht, hier hochladen
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Cache-RAMs als Logikanalyzer
>Eher 74AC161 oder 74AC163... Ich würde einen CPLD ala XC9572 oder grösser nehmen und da die Zähler und Triggereinheit reinbauen. Den kann man dann recht frei programmieren, aber da liegt dann auch schon das Problem. Man muss ihn programmieren;)
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FPGA über serielle Schnittstelle programmieren
einen Altera USB Blaster-Nachbau selber gebastelt habe. Es ist wirklich nicht viel drin. FT245RL + XC9572XL. Sehr einfache schaltung und es klappt tadellos! MfG
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Frequenzzähler mit ICM7226
Leider gibt es das Frequenzzähler IC ICM7226 nicht mehr. Würde das in ein XC9572 passen? Wie schreibe ich das in VHDL?
Global Bläher schrieb im Beitrag #2187463: > Würde das in ein XC9572 passen? Nein. Zuwenige Maktozellen/Flipflops. Allein schon der Zwischenspeicher für die Anzeige braucht 8x4 Register, dazu diverse Vorteiler und etliche Ausgänge... > Wie schreibe ich das in VHDL
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Hardware beschaffen - lohnt das?
bin eben ind er Bucht auf folgendes Angebot gestoßen und bin ECHT verwirrt: Reichelt bietet ein XC 9572XL TQ100, 10 ns für 3.30 an. Ich frage mich, ob der schnellere speed grade, also eba# sind ja 5 ns, so teuer wird, oder ob die Auktion einfach nur ..naja 'frech teuer' ist. Für mein Vorhaben sollte
Die Reichelt-Preise scheinen wilkürlich ausgewürfelt zu sein, zwischen 19€ und 3.30€ für eine XC9572-Variante... Wenn der billige Typ passt (Speed, Versorgungsspannung, 5V-tolerante Eingänge?, ...), dann nimm den einfach.
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shift reg + akkumulator, optimierungen möglich?
Platz sparen. ben schrieb im Beitrag #2147368: > Leider passt das ganze nur knapp nicht in einen XC9572XL Was fehlt denn? Wo klemmts? Flipflops sollten eigetnlich ausreichend da sein... Zeig doch mal dein ganzes Design.
passt das Design dann in den 9572XL: [pre] Design alles has been optimized and fit into device XC9572XL-5-PC44. [/pre]
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USB oder FW Interface chip mit AES/SPDIF in,out
einen XC3S50AN, Der hat deutlich mehr Flipflops bei > vertretbaren Preis und Verilog ;-) > Der XC9572XL ist vollkommen ausreichend um einen FIFO zu bedienen. Den Spartan würde ich nehmen, wenn ich einen eigenen USB Media Access Controller schreiben würde. Ist zwar mit ULPI kein Ding, aber die Baustelle
dem Foto von oben nach unten und links nach rechts: CY7C68013A CDCE913 I2C EEPROM CS8422 XC9572XL Früher(tm) konnte man die auch mal auf den Chips lesen. Vielleicht war die Farbe nicht umweltverträglich.
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Teiler durch 1,953125
zusammen 1000. Ich habe da einen Schaltplan mit TTL-IC's, möchte das aber lieber in einem CPLD XC9572 machen. Wie kann ich das in VHDL programmieren?
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Zu wenig Makrozellen: Code Optimierung
Waveform-Generator werden. Soweit klappt alles ganz gut, aber jetzt sind mir die Makrozellen des XC9572XL ausgegangen. Wie optimiere ich den Code denn am besten auf eine geringe Nutzung der Zellen hin (siehe Anlage)? Als blutiger Anfaenger und Hobbyist wuerde mich auch interessieren, wie man den VHDL
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Mein erstes richtiges Board
drinnen? Jeder Ratschlag willkommen! Das ganze ist ein CPLD Development Board fuer den Xilinx XC9572XL im PLCC44 Package. Es fuehrt eigentlich nur die PINS der CPLD nach aussen und hat eine Pierce Schaltung die als Clock dient. Ein LC33CV dient als Spannungsregler (im Schema als 78xx, konnte das Bauteil
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XC9572XL PLCC Eagle files?
Hallo, ich suche ein lib das den XC9572XL im PLCC Package enthaelt. Ich habe jetzt einige Xilinx libs von cadsoft geladen und nirgends ist der drin! Hat jemand vielleicht ein lib mit dem Bauteil und kann es mir zur Verfuegung stellen?
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Wie kann ich gezielt Register im CPLD nutzen?
Beim Erstellen des VHDL-Codes mit vielen Latches (Steuerregister) für einen XC9572 ist mir aufgefallen, dass ich trotz der Tatsache dass insgesamt intern 64bit für Latches verwendet werden, die Registernutzung bei nur 5% liegt (3 von 72). Macht es nicht Sinn, diese Latches in die
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Tristate Ausgänge im CPLD verbinden?
1.es ist ein XC9572 2.ein CPLD hat keine Tristate Buffer ? Muss ich dann extra extern einen Tristate Buffer anbringen?
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Fitterproblem
Veknüpfungen doch wieder gleich sind. Konkret die Frage... Wie passe ich die Logik an die Ressourcen des XC9572XL an ?
Ich setz bisher den XC9572XL also die 5V Variante ein, hab aber das ganze Projekt auch schon erfolgreich mit dem XC95108 kompiliert. Da ich den XC9572 aber da hab, wollte ich nicht die teurere Variante (19€ grrr) wählen. Außerdem
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FPGA wirtschaftlich betrachtet
beides zugleich. Für einen Spartan 3AN (den kleinsten) bezahle ich irgendetwas um die 5 €. Ein XC 9572 Xl kostet so um die 1,4 €. Was bitte ist daran teuer? Das eine unbedingt gegen das andere austauschen zu wollen, spricht nicht gerade von geballtem Sachverstand - oder man ist ein Ing, den man auch
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Codecheck Erstlingswerk VHDL Newbie :)
Hallo, anbei stelle ich mal den fertigen VHDL Code für einen XC9572 zur Kontrolle. Es ist mein Erstlingswerk in Sachen CPLD & VHDL. Der Code stellt eine 1:1 Hardwarenachbildung eines Bildwiederholspeichers dar und funktioniert auch in der realen Schaltung, aber ich
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Impuls kürzer als Takt erzeugen
Ich benutze einen XC9572-15 und habe nicht ein Pin mehr übrig :-( Mal gucken ob die Lösung ein Ansatz ist.. aber leider erst heute abend. Danke Euch !!
@ Ralph H. (guru) >Ich benutze einen XC9572-15 und habe nicht ein Pin mehr übrig :-( >Mal gucken ob die Lösung ein Ansatz ist.. aber leider erst heute abend. Ich wette mal, dass dein Problem locker ohne einen solchen unsinnigen Puls auskommt
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CPLD XC9572 in Schlatung programmieren
Was muss ich beachten, wenn ich einen CPLD XC9572 in einer bereits aufgebauten Schaltung, also quasi in Betrieb, mittels JTAG-Schnittstelle umprogrammieren möchte? Ich will damit Fehler aus der Programmierung entfernen ? Die Schnittstelle hab ich
@ Ralph H. (guru) >Was muss ich beachten, wenn ich einen CPLD XC9572 in einer bereits >aufgebauten Schaltung, also quasi in Betrieb, mittels JTAG-Schnittstelle >umprogrammieren möchte? Dass die IOs dann auf Tristate gehen. Wenn davon einige als Ausgang kritische
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Arbeiten mit RS 232
nachgeschaut und bin auf ne relativ gute Lösung gekommen (meiner Meinung nach). Du kannst einen Xilinx XC9572 oder XC95108 CPLD im PLCC82 Package. Das heißt du kannst alles schön selber löten (also der Sockel ist ja though hole und so). Außerdem läuft das ding mit 5V. Also nochmal zusammengefasst: auf der
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Xilinx Fitter Pinzuweisung festschreiben
vorgegebene PINZUWEISUNG (die ich übernommen habe) nicht mehr ändert!!!! Ich hab Angst das mein XC9572 bei ner noch zu machenden Codeänderung wieder ne andere Pinzuweisung bekommt. Beste Grüße von Ralph
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2 Incrementalgeber koppeln
zu einem externen Takt zählte, mit noch zusätzlicher Logik und SPI-Interface zum Auslesen, in ein XC9572XL reinbekommen, den man für 2 Euro bekommt. FPGAs sind teurer und auch meist komplizierter in der Anwendung, wegen der unterschiedlichen Spannungsversorgungen, meist noch externem notwendigen Konfig-Flash usw. Im XC9572XL ist das Flash schon eingebaut, allerdings nur per externen Prorgammer änderbar. Das Teilerverhältnis könnte man aber per DIP-Switch einstellbar machen.
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CPLD im DIL ?
, aber evtl. eine Lösung für dein Problem, z.B. http://www.oho-elektronik.de/index.php?c=1&s=gop_xc9572xl, oder ähnliches ;-)
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hardware-pwm mit variabler auflösung in xilinx cpld
Anbei der VHDL-Code für einen PWM-Generator, den ich in einem XC9572 untergebracht habe. Der Code beruht zum größten Teil auf der Atmel AppNote 2324.pdf http://www.atmel.com/dyn/resources/prod_documents/DOC2324.PDF Hintergrund: Als hartgesottener 8051-Fan will ich
ISE, Version 8 Servicepack 3, compiliert. Das JED-File passt geradeso in einen XC9536, in einem XC9572 könnte man vermutlich 2 PWM-Module unterbringen. Wie bereits erwähnt wird der CPLD von einem 8051, in diesem speziellen Fall von einem DS89C450, angesteuert. Der Baustein ist mit der zweiten seriellen
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Anfängerfrage cpld, Geschwindigkeiten..
der CPLD und FPGA einarbeiten und hab da noch ein paar grundlegende Fragen. Ich hab von xilinx ein XC9572-15ns und ein XC95144XL-5ns cpld zum spielen. So, was sagen jetzt eigentlich diese 15ns bzw. 5ns genau aus? In welcher Verbindung steht das zur eigentlichen Clock (Quartzoszilator)? (hab da ein 40 und
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Bastelidee ascii text auf PAL TV
mal selbst was überlegt da ich grad passende Bauteile noch rumfliegen habe wie z.B ein paar avrs, XC9572-15 cpld, ein paar 8KB15ns srams. Meine Idee wäre eine 40x25 ascii Symbol Anzeige mit 16 Vordergrund- und 16 Hintergrundfarben auf einem PAL TV (720x576). Die ascci Symbole sollen 8x8 Pixel sein aber
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Suche ketten AND GATE
74'er Logik. Wenn es schneller sein muß oder bei vielen solcher Eingänge, dann wäre z.B. ein XC9572XL CPLD geeignet. Gibt es im 44 TQFP Gehäuse (für 1,62 Euro bei Digikey), mit 9,8 x 9.8 mm^2. So klein wie möglich gäbe es den auch noch in BGA-Bauform, wenn du dir das antun willst oder es bestücken
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Grundsätzliche Frage zur Realisation von Mathe im FPGA
end if; end loop; end process; end architecture rtl; [/vhdl] Für den langsamsten XC9572XL implementiert braucht das ca. 7% an Resourcen bei den 16 Bit und läuft bis zu ca. 90 MHz laut Timing Report (11 ns worst-case von input zu output). Es berechnet den Logarithmus zur Basis 2, jeweils
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Theorie: Xilinx selbstbau JTAG Programmer
svnroot/xc3sprog/trunk/devlist.txt #XC95XL 09602093 8 0xfe XC9536XL 09604093 8 0xfe XC9572XL 09608093 8 0xfe XC95144XL 09616093 8 0xfe XC95288XL #XC95 09502093 8 0xfe XC9536 09504093 8 0xfe XC9572 09506093 8 0xfe XC95108 09508093 8 0xfe XC95144
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Einstieg in programmierbare Logik
EPM3064A nehmen Blöd nur, dass man die fast nirgends bekommt.... :-/ Da wären dann so XC9536 / XC9572 schon einfacher zu beschaffen. Bei EBAY sogar komplett mit Programmieradapter...
gerade bei Reichelt geguckt. Im Angebot sind folgende Xilinx CPLDs: - XC9536XL (36 Macrocells) - XC9572XL (72 Macrocells) - XC95144XL (144 Macrocells) Wie viele Macrocells brauche ich für den Anfang? Ich finde ja den XC9572 ganz schön (Gibts auch in PLCC, also sockelbar!). Das Programmierkabel
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RS232 TX mit einem CPLD
Hallo, ich habe ein XC9572 CPLD. Kann ich über eine einzige Leitung, nur TX, RS232-Botschaften an einen PC senden? Wie würde man soetwas in VHDL schreiben? Oder ist das Quatsch?
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[V] Aus Hobby-Auflösung: MCUs,FPGA, Speicher, etc.
Microchip, MCU) inkl. Sockel 40pol. 1x XC2S100-5TQ144C (Xilinx, Spartan 2 FPGA) EUR 15,00 1x XC9572-15 PC84C (Xilinx, CPLD PLCC84) EUR 5,00 1x ADV7125KST140 (Analog Devices, 8-Bit High Speed Video DAC) 1x ADV7125JST140 (Analog Devices, 8-Bit High Speed Video DAC) 1x FMS3818KRC (Fairchild, 8-
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XC9572 auslesen und?
aus einen alten Netgear Switch eine LED Anzeigeneinheit mit 48 LEDs, diese werden irgendwie mit 2x XC9572 angesteuert. Meine Frage, wenn ich es schaffe die 2 XC9572 auszulesen, kann man dann mit den jed File wieder einen Quellcode und dann einen Schaltplan generieren lassen? Will die Platine für meine
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ISE Warnungen Fehlermeldungen
fehlerfreie Compilation bestätigt (no Errors, no Warnings). Bei meinen Versuchen habe ich einen XC9572 zugrunde gelegt, allerdings noch keine Daten in den Baustein übertragen. Im allgemeinen funktioniert die Simulation sowohl im ISE-Simulator als auch unter Modelsim, aber nicht immer (liegt's an ISE
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Xilinxs Fehlermeldung CPLD
Webpack sagen? Werde daraus einfach nicht schlau habe quasi nur einen process auf dem Ding (XC9572) laufen ungefähr so process (Error1, Error2, CLK) begin if (Error1 = '1' or Error2 = '1') then PORT <= (others => z); elsif (CLK'event and CLK = '1') then if (Schalter = '