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Was ist das für eine HDL?
passenden Treiber existieren. Es muß doch möglich sein das obige passend umzusetzen. Wenn es ein XC9572 nichts schafft muß ich halt den XC95108 nehmen. Gruß, Holm
@Holm Tiffe Hallo ! Ich kann doch noch ABEL mit XILINX machen. XC2C64A XC9572XL XC2C32A XC9536 oder ??? Tolle Homepage, und Project. Erst mal das Datenblatt analysieren. ------------------------------------------------------------------- Hier das ist der Hersteller
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Verständnisproblem Xilinx XC9572 CPLD
Hallo Kollegen, Ich benötige mal Hilfe zum Thema I/O - Pins vom XC9572. Momentan werde ich aus dem Ganzen noch nicht richtig schlau! Das Datenblatt zeigt 4 Funktionsblöcke mit á 18 Macrozellen. Die Pin´s sind mit I/O beschriftet. Soll ja 36V18 sein -?????? Was
Testprojekt zeigen (Quelltext, Screenshots). Duke P.S.: Schau Dir mal lieber die XL-Variante an (XC9572XL). Die ist vom Stromverbrauch erträglicher.
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XC9572XL Macrozellen in den Lowpower Mode schalten
Alle, ich mache mein erstes Projekt mit CPLDs und benutze dafür ISE Webpack. Verwende 2 Stück XC9572XL, im Datenblatt steht das man die Macrozellen individuell in einen Lowpowermode schalten kann. Ich denke das falls sie dadurch langsamer werden keine Probleme auftauchen, ich würde es zumindest
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3,3V CPLD XC95288XL in 5V Umgebung
zwecks Nachbau eines C64 alle wesentlichen 65xx-Chips und div. LS74er (allesamt 5V VCC) an einem XC9572XL durchgetestet (simpler Logik-Analyzer), lief ohne Probleme.
Blöde Frage, wieso nimmst du nicht den XC95288 (ohne XL), der ist für 5V gedacht.
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Forum: Nicht mehr auszuhalten, Handlungsbedarf! Gesperrt
@ Clemens M. (panko) >Beitrag "XC9572XL Macrozellen in den Lowpower Mode schalten" hmm. >Hier z.B. ist doch eine ordentliche Frage gestellt... Natürlich ist die >Antwort so wie sie ist unbefriedigend. Es ist keine Silbertablettantwort
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Frage zu Machbarkeit bzgl. CPLD
Ein mittlelgrosses CPLD ist haeufig teuer als ein kleines FPGA, wie ein XC3S50A(N) und hat trotzdem deutlich weniger Resoucen...
CPLDs als das von dir gefundene 544-1964-ND EPM240T100C5N gleicher Preis, mehr Inhalt 122-1448-ND XC9572XL-10VQG44C, billiger, etwa gleich viel Inhalt. Suche immer 3,3 Volt Typen, die 5 Volt tolerant sind. 5V CPLDs werden mit Gold aufgewogen. Wenns dein Budget hergibt nimm ca. 500 LE und externes
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Umgang mit CPLD's lernen ( Altera od XILINX) via Dev Kit
unterschreiben wollen. Wie immer "kommt darauf an" Bei meinem "8086 from scratch" Projekt setze ich einen XC9572 ein: Hier geht es nur um die Ersetzung von TTL-Gräbern, Adressdekodierer und anderen "Kleinkram".(...und das alles mit 5V) Einfach in eine PLCC Fassung und ab aufs Lochraster. Gut: die Kosten für
die XC95xx(XL)-Reihe auch als FPGA? (3,3V / 5V tolerante I/Os, kostenlose IDE, kein Konfigurationseprom) Ziel ist es die direkte Peripherie um den 8086 im FPGA nachzubilden. (Bustreiber, Buscontroller, Clock
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Einstieg in CPLD &FPGA
habe ich gefunden: - Lattice IspLSI 1016 - PLCC44 - 64 Cells - 2000 Gates - 32 I/Os - 15ns - Xilinx XC95xx - Xilinx XC9572XL - PLCC44 - 72 Cells - 1600 Gates - 38 Is/34 Os - 10ns Altera bietet Reichelt nicht an, deshalb kann ich da keinen vergleichbaren CPLD listen. Wo kann ich dann nach Evaluationsboards
den internen Aufbau der Bausteine! >...bevor Du mit dem "alten Kleinkram" (sorry) wie ispLSI und XC95 >anfängst, Mit neuen CPLDs (sofern es von der Grösse her reicht) sind (von In-Out an gerechnet) schnellere Logic machbar als mit FPGAs.
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Suche großes LCD/TFT für STM32F4Discovery
Controller. Die gibts aber max. bis 4 Zoll. Ich habe hier so etwas mit einem 2.4" Display und einem XC9572XL gemacht. Zur Weichware bin ich noch nicht gekommen, da sind dringendere Projekte dazwischen gekommen. fchk
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CPLD mit NEXYS3 Board Programmieren
das NEXYS3 Board zugreifen kann und dann mithilfe der rausgeführten JTAG Schnittstelle einen z.b. XC9572XL programmieren kann?
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8086 Beschaltung Speicherlogik (BHA A0 MR MW)
Hier kommen ja richtige gute Ansätze. Auf der CPU-Seite sieht es bisher wie folgt aus: ein XC9572 generiert die Clocksignale (8284) und stellt den Buscontroller (8288). An dem sind noch genug I/Os frei. Alles was hier generiert wird, geht auf einen Leiterplattenverbinder. Momentan ist der Datenbus
ebenfalls sehr schlecht aussieht und der Innenaufbau sehr überschaubar ist, habe ich mich für den XC95xx entschieden, da dieser noch 5V tauglich ist. Kosten bei Angelika 5,55 (9572 in PC44) FPGA ist für mich noch kein Thema. Damit habe ich mich noch nicht auseinandergesetzt. (Bis auf das Projekt,
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BreadBoard mit SMD
liegt bei 0.4mm (0.25 breiter Kanal,0.15x2.0mm Steg) genauso wie bei meinem TQFP-Adapter für einen XC9572-100.
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Gibt es irgendwo ein günstiges Programmiergerät (für Xilinx CPLDs XC9572)?
Hallo Forum, ich habe in meiner Bastelkiste mehrere CPLDs von Xilinx (XC9572) und möchte damit irgendwas basteln - weiss noch nicht genau was. Früher habe ich sie über die parallele Schnittstelle programmiert - mein PC ist nun defekt und ich habe keine Rechner mit paralleler
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Schaltung mit 4068
ausprobieren. Man kann dann auch die Funktion der Schaltung erstmal simulieren. Als CPLD wäre der XC9572 geeignet. Er ist 5V-fest und hat ein PLCC-44 Gehäuse, d.h. man kann ihn in einen Sockel auf ne Uniplatine stecken. Er hat 72 Macrozellen. Jede Macrozelle besteht aus einer (fast) beliebig verschaltbaren
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FPGA-Porterweiterung durch 74HC595
Warum nimmst du nicht einen kleinen XC9536XL/XC9572XL als Erweiterung. Ist flexible konfigurierbar und ebenfalls 5V-tolerant. Falls du DIP-Gehäuse brauchst: Bei Ebay gibts 36er mit 40erDIP ab 8 Euro inkl. Quarz..
@ Bert (Gast) >Warum nimmst du nicht einen kleinen XC9536XL/XC9572XL >als Erweiterung. Ist flexible konfigurierbar und >ebenfalls 5V-tolerant. >Falls du DIP-Gehäuse brauchst: Bei Ebay gibts 36er >mit 40erDIP ab 8 Euro inkl. Quarz.. Seit wann gibt
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Logiksignale nur durchlassen, falls nicht mehr als eine 1
Die Logik umzusetzen wäre doch was für einen kleinen CPLD wie z.B. XC9536, XC9572.
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Altium JTAG Programmer + XC9572xl CPLD
Hallo zusammen, ich habe hier auf meinem Experimentierboard einen Xilinx XC9572XL, der sich nicht mit dem Altium JTAG Programmer ansprechen lässt. Die JTAG Leitungen sind nur an die JTAG Buchse angeschlossen und 1:1 an den JTAG Programmer von Altium Designer angeschlossen.
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Problem mit Xilinx Platform Cable USB clone
mir dazu auf ebay ein Xilinx Platform Cable USB (DLC9G) china clone gekauft. Versucht hab ich ein XC9572XL auf dem Experimentier Board von Ulrich Radig (welches ich auf 3,3V angepasst habe) zu programmieren. Leider schlägt dies immer fehl. Das DLC9G wird von Windows XP erkannt. Wenn ich in iMPACT
file 'F:/cpld_test/cpld_test.jed' ... done. INFO:iMPACT:1777 - Reading e:/Xilinx/13.1/ISE_DS/ISE/xc9500xl/data/xc9572xl.bsd... INFO:iMPACT:501 - '1': Added Device xc9572xl successfully. ---------------------------------------------------------------------- ---------------------------------------
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XC9572XL kein CLK?
all zu simple ist - ich bin nämlich blutiger Anfänger. Im folgenden Beispiel brennt die LED am XC9572XL (VQ44): [c] NET "CLK" LOC = "P43"; NET "LED1" LOC = "P20"; NET "RESET" LOC = "P33"; entity alogic is Port ( CLK : in STD_LOGIC; RESET : in STD_LOGIC
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welcher controller für retro Spielkonsole
dort solche Aufgaben wie das bitblitting unterzubringen, davon hab ich hier noch welche rumfliegen XC9572 15ns, XL95144 10ns.
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Probleme mit der Erstellung eines Automaten
VHDL-Neuling und habe zwei Probleme beim unten stehenden Automaten. Ich nutze folgenden Baustein: Xilinx XC9572XL. 1. Kommen mehrere Warnungen darüber, dass ich Latches eingebaut habe: Found 8-bit latch for signal <data_to_CPLD>. Latches may be generated from incomplete case or if statements. We do not
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USB-Blaster CPLD-Design
Hallo, ich habe mir einen USB-Blaster selber gebaut (FT245RL + XC9572XL) Das, was Sie brauchen, habe ich angehängt! MfG aus Westerwald
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ByteBlaster2 Installation
Hallo M. Schwaikert, ich habe meinen USB_Blaster selber gebaut. Ist nicht viel drin: FT245RL und XC9572. Wird als Original "Altera USB Blaster" erkannt und läuft sein ca. 1.5 Jahre ohne Probleme. Schaltplan, Platinenlayout, Sources u.s.w. kann ich natürlich, wenn Interesse besteht, hier hochladen
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Cache-RAMs als Logikanalyzer
>Eher 74AC161 oder 74AC163... Ich würde einen CPLD ala XC9572 oder grösser nehmen und da die Zähler und Triggereinheit reinbauen. Den kann man dann recht frei programmieren, aber da liegt dann auch schon das Problem. Man muss ihn programmieren;)
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FPGA über serielle Schnittstelle programmieren
Hallo chewabob, hier ist mein letztes Projekt mit Spartan 3 XC3S400TQ144. http://speccyland.net/index.php?option=com_content&view=article&id=4:aeon-20-&catid=2:avr-a-pic&Itemid=19 Da kannst du Schaltpläne, Sources u.s.w. runterladen. In meinem Fall wird Spartan
einen Altera USB Blaster-Nachbau selber gebastelt habe. Es ist wirklich nicht viel drin. FT245RL + XC9572XL. Sehr einfache schaltung und es klappt tadellos! MfG
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Frequenzzähler mit ICM7226
Leider gibt es das Frequenzzähler IC ICM7226 nicht mehr. Würde das in ein XC9572 passen? Wie schreibe ich das in VHDL?
Global Bläher schrieb im Beitrag #2187463: > Würde das in ein XC9572 passen? Nein. Zuwenige Maktozellen/Flipflops. Allein schon der Zwischenspeicher für die Anzeige braucht 8x4 Register, dazu diverse Vorteiler und etliche Ausgänge... > Wie schreibe ich das in
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Hardware beschaffen - lohnt das?
cpld kaufen möchte und eine kleine Platine eben mit cpld und Motortreiber anfertigen werde. Xilinx xc95xxx ist ausgewählt und nun durchforste ich. Reichelt hat ihn ja, aber ich bin eben ind er Bucht auf folgendes Angebot gestoßen und bin ECHT verwirrt: Reichelt bietet ein XC 9572XL TQ100, 10 ns für
Die Reichelt-Preise scheinen wilkürlich ausgewürfelt zu sein, zwischen 19€ und 3.30€ für eine XC9572-Variante... Wenn der billige Typ passt (Speed, Versorgungsspannung, 5V-tolerante Eingänge?, ...), dann nimm den einfach.
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shift reg + akkumulator, optimierungen möglich?
vorschlag mit den getrennten prozessen umgesetzt. Das Design benötigt nach wie vor 78 Macrocells, der XC9572XL hat aber nur 72. Der nächst größere ist XC95144XL, den gibts aber nur als TQ100 (VQ44 währe schon schöner) Im Anhang das vollständige Design... Das ganze muss übrigens nur bis 3Mhz laufen
meiner Änderung und der Fitter-Option -exhaust (Exhaustive Fit Mode) passt das Design dann in den 9572XL: [pre] Design alles has been optimized and fit into device XC9572XL-5-PC44. [/pre]
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USB oder FW Interface chip mit AES/SPDIF in,out
bringen muß. Das braucht Flip Flops. Geschrieben ist das CPLD >> in VHDL. > > Ich bevorzuge da einen XC3S50AN, Der hat deutlich mehr Flipflops bei > vertretbaren Preis und Verilog ;-) > Der XC9572XL ist vollkommen ausreichend um einen FIFO zu bedienen. Den Spartan würde ich nehmen, wenn ich einen eigenen
auf dem Foto von oben nach unten und links nach rechts: CY7C68013A CDCE913 I2C EEPROM CS8422 XC9572XL Früher(tm) konnte man die auch mal auf den Chips lesen. Vielleicht war die Farbe nicht umweltverträglich.
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Teiler durch 1,953125
zusammen 1000. Ich habe da einen Schaltplan mit TTL-IC's, möchte das aber lieber in einem CPLD XC9572 machen. Wie kann ich das in VHDL programmieren?
Allerdings hat diese elegante Lösung einen etwas höheren Ressourcenverbrauch: [pre] Device Used XC9536XL-5-PC44 Macrocells Pterms Registers Pins Function Block Inputs 10/36 (28%) 36/180 (20%) 9/36 (25%) 2/34 (6%) 17/108 (16%) [/pre]
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Zu wenig Makrozellen: Code Optimierung
Waveform-Generator werden. Soweit klappt alles ganz gut, aber jetzt sind mir die Makrozellen des XC9572XL ausgegangen. Wie optimiere ich den Code denn am besten auf eine geringe Nutzung der Zellen hin (siehe Anlage)? Als blutiger Anfaenger und Hobbyist wuerde mich auch interessieren, wie man den
Ein Impulsformer (Trigger rein, eine einfache Signalform raus), mit Zählern realisiert. Auf einem XC9536XL-10C, offiziell spezifiziert mit bis zu 100 MHz. Duke
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Mein erstes richtiges Board
Fehler drinnen? Jeder Ratschlag willkommen! Das ganze ist ein CPLD Development Board fuer den Xilinx XC9572XL im PLCC44 Package. Es fuehrt eigentlich nur die PINS der CPLD nach aussen und hat eine Pierce Schaltung die als Clock dient. Ein LC33CV dient als Spannungsregler (im Schema als 78xx, konnte das
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XC9572XL PLCC Eagle files?
Hallo, ich suche ein lib das den XC9572XL im PLCC Package enthaelt. Ich habe jetzt einige Xilinx libs von cadsoft geladen und nirgends ist der drin! Hat jemand vielleicht ein lib mit dem Bauteil und kann es mir zur Verfuegung stellen
Ich brauche leider den PLCC44 und den gibts nirgendwo. ISt der zufaellig pinkompatibel mit dem XC9536 PLCC44?
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Wie kann ich gezielt Register im CPLD nutzen?
Beim Erstellen des VHDL-Codes mit vielen Latches (Steuerregister) für einen XC9572 ist mir aufgefallen, dass ich trotz der Tatsache dass insgesamt intern 64bit für Latches verwendet werden, die Registernutzung bei nur 5% liegt (3 von 72). Macht es nicht Sinn, diese Latches in
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Tristate Ausgänge im CPLD verbinden?
1.es ist ein XC9572 2.ein CPLD hat keine Tristate Buffer ? Muss ich dann extra extern einen Tristate Buffer anbringen?
Source) Exception in thread "main" Design fpga_project1 has been optimized and fit into device XC95288XL-6-TQ144. CpldFit - Completed Successfully ---------------------
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Fitterproblem
Veknüpfungen doch wieder gleich sind. Konkret die Frage... Wie passe ich die Logik an die Ressourcen des XC9572XL an ?
Ich setz bisher den XC9572XL also die 5V Variante ein, hab aber das ganze Projekt auch schon erfolgreich mit dem XC95108 kompiliert. Da ich den XC9572 aber da hab, wollte ich nicht die teurere Variante (19€ grrr) wählen.
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FPGA wirtschaftlich betrachtet
Meist beides zugleich. Für einen Spartan 3AN (den kleinsten) bezahle ich irgendetwas um die 5 €. Ein XC 9572 Xl kostet so um die 1,4 €. Was bitte ist daran teuer? Das eine unbedingt gegen das andere austauschen zu wollen, spricht nicht gerade von geballtem Sachverstand - oder man ist ein Ing, den man
aufhängen, wenn man tatsächlich FPGAs in Serienstückzahlen braucht. Bei einem Design Ende 2007 war zB. der xc3s1600e drin. Bei digikey ca. 60Euros. Bei Avnet dann AFAIR so 12Euros... Die xc6s sind jetzt schon einzeln bei digikey richtig billig, etwas dem 3s1600 vergleichbares wird in Stückzahlen wohl dann bei
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Codecheck Erstlingswerk VHDL Newbie :)
Hallo, anbei stelle ich mal den fertigen VHDL Code für einen XC9572 zur Kontrolle. Es ist mein Erstlingswerk in Sachen CPLD & VHDL. Der Code stellt eine 1:1 Hardwarenachbildung eines Bildwiederholspeichers dar und funktioniert auch in der realen Schaltung, aber
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Impuls kürzer als Takt erzeugen
Ich benutze einen XC9572-15 und habe nicht ein Pin mehr übrig :-( Mal gucken ob die Lösung ein Ansatz ist.. aber leider erst heute abend. Danke Euch !!
@ Ralph H. (guru) >Ich benutze einen XC9572-15 und habe nicht ein Pin mehr übrig :-( >Mal gucken ob die Lösung ein Ansatz ist.. aber leider erst heute abend. Ich wette mal, dass dein Problem locker ohne einen solchen unsinnigen Puls auskommt
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CPLD XC9572 in Schlatung programmieren
Was muss ich beachten, wenn ich einen CPLD XC9572 in einer bereits aufgebauten Schaltung, also quasi in Betrieb, mittels JTAG-Schnittstelle umprogrammieren möchte? Ich will damit Fehler aus der Programmierung entfernen ? Die Schnittstelle hab ich
@ Ralph H. (guru) >Was muss ich beachten, wenn ich einen CPLD XC9572 in einer bereits >aufgebauten Schaltung, also quasi in Betrieb, mittels JTAG-Schnittstelle >umprogrammieren möchte? Dass die IOs dann auf Tristate gehen. Wenn davon einige als Ausgang kritische
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Arbeiten mit RS 232
will aber ich würde wohl eher nicht zur Schieberegisterlösung greifen. Wieso kein CPLD, zB den Xilinx XC2C64A. Der hat 64 I/Os. Ich weiß, dass sowas schon wieder in einer relativ komplizierten Schaltung ausartet aber es gibt doch bei eBay immer diese Module dafür. Das einzige Problem ist, dass er einen
nachgeschaut und bin auf ne relativ gute Lösung gekommen (meiner Meinung nach). Du kannst einen Xilinx XC9572 oder XC95108 CPLD im PLCC82 Package. Das heißt du kannst alles schön selber löten (also der Sockel ist ja though hole und so). Außerdem läuft das ding mit 5V. Also nochmal zusammengefasst: auf
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Xilinx Fitter Pinzuweisung festschreiben
selbst vorgegebene PINZUWEISUNG (die ich übernommen habe) nicht mehr ändert!!!! Ich hab Angst das mein XC9572 bei ner noch zu machenden Codeänderung wieder ne andere Pinzuweisung bekommt. Beste Grüße von Ralph
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2 Incrementalgeber koppeln
zu einem externen Takt zählte, mit noch zusätzlicher Logik und SPI-Interface zum Auslesen, in ein XC9572XL reinbekommen, den man für 2 Euro bekommt. FPGAs sind teurer und auch meist komplizierter in der Anwendung, wegen der unterschiedlichen Spannungsversorgungen, meist noch externem notwendigen Konfig-Flash usw. Im XC9572XL ist das Flash schon eingebaut, allerdings nur per externen Prorgammer änderbar. Das Teilerverhältnis könnte man aber per DIP-Switch einstellbar machen.
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VHDL Newbie -->Kontrolle VHDL COde
Ralph H. schrieb im Beitrag #1978515: > bereits 55% der Termressourcen des XC9536 belege. Ja, nimm ein 9572... ;-) Das 9536 ist das kleinste CPLD von Xilinx, da passt nicht viel rein. > Geht das besser? Überleg dir, ob du den Reset wirklich brauchst...
Ralph H. schrieb: > Was mir auffällt ist, das ich bereits 55% der Termressourcen des XC9536 > belege. Geht das besser?, denn ich muss noch einiges unterbringen.. Die XC95xx CPLD haben keine Latches sondern nur Flipflops, somit wird eine Latch-Beschreibung auf viele PTs umgesetzt.
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CPLD im DIL ?
. :-o Oder probiers mit sowas: http://cgi.ebay.de/Xilinx-CPLD-JTAG-Development-Board-IC-Xilinx-XC9536-/330365392990?pt=Wissenschaftliche_Ger%C3%A4te&hash=item4ceb4fd85e
direkt, aber evtl. eine Lösung für dein Problem, z.B. http://www.oho-elektronik.de/index.php?c=1&s=gop_xc9572xl, oder ähnliches ;-)
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hardware-pwm mit variabler auflösung in xilinx cpld
Anbei der VHDL-Code für einen PWM-Generator, den ich in einem XC9572 untergebracht habe. Der Code beruht zum größten Teil auf der Atmel AppNote 2324.pdf http://www.atmel.com/dyn/resources/prod_documents/DOC2324.PDF Hintergrund: Als hartgesottener 8051-Fan will
Code habe ich mit der ISE, Version 8 Servicepack 3, compiliert. Das JED-File passt geradeso in einen XC9536, in einem XC9572 könnte man vermutlich 2 PWM-Module unterbringen. Wie bereits erwähnt wird der CPLD von einem 8051, in diesem speziellen Fall von einem DS89C450, angesteuert. Der Baustein ist mit
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Anfängerfrage cpld, Geschwindigkeiten..
der CPLD und FPGA einarbeiten und hab da noch ein paar grundlegende Fragen. Ich hab von xilinx ein XC9572-15ns und ein XC95144XL-5ns cpld zum spielen. So, was sagen jetzt eigentlich diese 15ns bzw. 5ns genau aus? In welcher Verbindung steht das zur eigentlichen Clock (Quartzoszilator)? (hab da ein 40 und ein 50 MHz teil liegen) Z.B. Ich möchte mit dem 9572-15ns lesend auf ein 15ns sram zugreifen. 15ns vs 15ns hört sich ja schonmal gut an, kann ich das jetzt z.B. mit einem mikrocontroller vergleichen und sagen, der cpld könnte also in einem "Instructioncycle
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Bastelidee ascii text auf PAL TV
mal selbst was überlegt da ich grad passende Bauteile noch rumfliegen habe wie z.B ein paar avrs, XC9572-15 cpld, ein paar 8KB15ns srams. Meine Idee wäre eine 40x25 ascii Symbol Anzeige mit 16 Vordergrund- und 16 Hintergrundfarben auf einem PAL TV (720x576). Die ascci Symbole sollen 8x8 Pixel sein
muss ich mir wohl erstmal n paar gute tutorials zu cpld und vhdl zu genüge führen. Gibt es für diese XC95xx von xilinx eigentlich eine etwas schlankere IDE als das 3,2GB Monster DesignSuite Teil?
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Suche ketten AND GATE
konventionelle 74'er Logik. Wenn es schneller sein muß oder bei vielen solcher Eingänge, dann wäre z.B. ein XC9572XL CPLD geeignet. Gibt es im 44 TQFP Gehäuse (für 1,62 Euro bei Digikey), mit 9,8 x 9.8 mm^2. So klein wie möglich gäbe es den auch noch in BGA-Bauform, wenn du dir das antun willst oder es bestücken