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AX82 - ZX Spectrum Emulator mit AVR + CPLD
Außerdem sollte es auch möglich sein, einen KC85/2 (oder/3) zu emulieren. Mit einem ATMega1284P und einem XC9572 sollte sich das sogar umschaltbar realisieren lassen. Jörg
the atmega and set the fuses. Problem. I dont have xilinx software. Can anyone program the xc chip for me in exchange for a pcb ?
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CPU aus CPLDs aufbauen?
Auf Opencores gibts eine 'CPU' die in ein XC9536 geht, da ist dann ein XC9572 schon ein Dualcore ;) Wobei man ja ggf. auch mit 4,5 oder 6 Bit Wortbreite hinkommen könnte und um Register zu sparen eine 'registerlose' Stackarchitektur wählt. Aber
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2 Incrementalgeber koppeln
zu einem externen Takt zählte, mit noch zusätzlicher Logik und SPI-Interface zum Auslesen, in ein XC9572XL reinbekommen, den man für 2 Euro bekommt. FPGAs sind teurer und auch meist komplizierter in der Anwendung, wegen der unterschiedlichen Spannungsversorgungen, meist noch externem notwendigen Konfig-Flash usw. Im XC9572XL ist das Flash schon eingebaut, allerdings nur per externen Prorgammer änderbar. Das Teilerverhältnis könnte man aber per DIP-Switch einstellbar machen.
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SN74ABTH16460 4-to-1 Multiplexed/Demultiplexed Transceivers with 3-State Outputs
selectiv anzusteuern. Dabei bin ich auf den SN74ABTH16460 gestossen. Die Logic wird in einem XC9536 or XC9572 sein. Fragen: - Erfahrungen mit dem SN74ABTH16460 ? - Anregungen fuer eine alternativ Loesung ? - Machbarkeit / Empfehlung die SN74ABTH16460 logic im XC95XX umzusetzen ? Vielen
schlicht nur ein Set and 8bit Datenleitungen verwendet. Auf der Ansteuerungsseite nach dem uC um XC95XX habe ich bereits funktionierende Logik fuer RAS/CAS/rw/D0-D7/A0-A11 (row und column). Im Moment steuere ich aber nur 4x 8Mbitx4 DRAMs an... die haben nur D0-D7.
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Auslesen von inout Pins bei Konflikt?
hi Hagen! Ich arbeite mit einem Xilinx CPLD XC9572XL und dem Webpack. Ne Schlatung mit dem Schematics Editor aufzubauen krieg ich nicht hin. Bin noch Anfänger... Aber es muss doch auch irgendwie in VHDL gehen. Sonst bringt doch der inout typ
den Ordner C:\Xilinx\doc\usenglish\de\libs\ dir die PDF's genauer an. Echte PullUps gibt bei den XC Typen nicht. Gruß Hagen
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Problem mit Flankendetektor (VHDL + Hardware)
einwandfrei funktioniert: Ein kurzes Signal am Beginn für en_rise. Hardware: Design Kit, Coolrunner II (mit XC2C256, (XC9572XL)) process (clk_n) -- Synchronisation begin if rising_edge(clk_n) then taste1 <= btn; taste2 <= taste1; end if; end process; en_rise <= taste1 and not taste2;
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Bastelidee ascii text auf PAL TV
mal selbst was überlegt da ich grad passende Bauteile noch rumfliegen habe wie z.B ein paar avrs, XC9572-15 cpld, ein paar 8KB15ns srams. Meine Idee wäre eine 40x25 ascii Symbol Anzeige mit 16 Vordergrund- und 16 Hintergrundfarben auf einem PAL TV (720x576). Die ascci Symbole sollen 8x8 Pixel sein
muss ich mir wohl erstmal n paar gute tutorials zu cpld und vhdl zu genüge führen. Gibt es für diese XC95xx von xilinx eigentlich eine etwas schlankere IDE als das 3,2GB Monster DesignSuite Teil?
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CPLDs sind tot es lebe?
stirbt aus, ausser ATF15xx von Atmel, mal sehen wie lange > es die noch gibt. Oops, die Xilinx XC9500 sind auch schon tot!? https://www.xilinx.com/support/documentation/customer_notices/xcn11010.pdf Schön das man jetzt die TTL-Gräber mit Levelshifter-Friedhöfen um einen 3V3 CPLD ersetzen muß
Und zu alten Footprint compatible Module basteln: http://oho-elektronik.de/index.php?c=1&s=gop_xc9572xl
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8-bit Bus: Wie geht das elegant?
Hallo, ich würde in dem Fall der Flexibilität wegen auf Programmierbare Logik (z.B. Xilinx XC9536XL oder XC9572XL) setzen. Da kannst Du nachher noch beinahe beliebig verändern (nur durch die Chipgröße beschränkt). Die Software gibt's von Xilinx, die Chips vom Reichelt (kostet sehr wenig) und
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[XC95 CPLD] Zähler mit einigen Zusatzfunktionen realisieren
kaskadierten ICs zunehmend problematischer wurde, wollte ich folgenden Zähler gerne mittels Xilinx XC9572XC CPLD realisieren. - 16-Bit Auflösung/Breite, nur Aufwärtszählen nötig - Impulse (Pulse-Eingang) treten unvorhersehbar und zufälllig, aber mit einer maximalen Frequenz < 90 MHz auf - Zählerüberlauf
"-Register hat aber weder einen positiven noch einen negativen Effekt gehabt, außer dass damit der XC9572 nahezu vollständig belegt ist. Vielleicht ist auch ein Denkfehler meinerseits drin, dass es gar nicht helfen kann. Alles in Allem treten nach Optimierung des Aufbaus und Erhöhung der Latch-Frequenz
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einfacher programmierbarer Logikbaustein
Hm, die Xilinx XC9500XL Serie würde mir da spontan einfallen. Schön schnell, im PLCC Gehäuse für Sockel verfügbar. USB Programmer gibts natürlich auch.
Nimm den Xilinx XC9572XL; das ist der groesste dieser Serie, der im PLCC-Gehauese erhaeltlich ist - dann kannst Du einen Sockel mit 0.1-Zoll Pinabstand verwenden (gleich gross wie bei DIP und passt daher in jede Lochrasterplatine
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555 7805 usw. Dauerbrenner nur noch bei den Hobbyisten und Kleinentwicklern
öfteren als Multivibrator für irgendeinen Hilfstakt eingesetzt, um Resourcen in kleinen CPLD wie dem XC9536XL zu sparen (Teilerkette). XC9536XL und XC9572XL sind bei mir auch Dauerbrenner, die dann im 800er Pack günstig eingekauft werden. Die Kunden bezahlen mich nicht für die ingeniöse Schönheit der
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ISE 7.1i ->Schematic ->Komisches UND-Verhalten + beim Counte
Hi! Ich beschäftige mich gerade mit dem XC9536, dass ich auf einem Steckbrett (mit Adapter) aufgebaut habe. Nach schlechten Ergebnissen, weil immer irgendwas passierte, aber nicht das Gewollte, hatte ich einfach mal ein einfaches "AND"
In meiner CPLD-Schaltung (auch mit XC9572XL) hatte ich das aelbe Problem. Habe dann die Schaltung soweit runtergebrochen, daß ein Eingang des PLD's direkt mit einem Ausgang verschaltet war. Ergebnis: Low am Eingang ergab High am Ausgang
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Wie optimieren um weniger Produktterme zu bekommen?
Makrozellen ist ok. 14 Stück. Nur die Produktterme, mein WebPack sagt er hätte 188 Stück erzeugt. In einen XC9536 den ich gerne benutzen will passen aber nur 180 Stück. Kann mir jemand einen Tip geben wie ich es hinbekomme weniger erzeugen zu lassen. Meinetwegen können dafür auch noch ein paar Makrozellen draufgehen
Synthese etwas zu pushen. In meinem CPLD-Projekt für den 7-stelligen 200 MHz Frequenzzähler (1x XC9572 zu 99% voll) habe ich mit folgenden Parametern experimentiert: "Collapsing PTERM Limit" (z.B. 26) "Collapsing Input Limit" (z.B. 36) "Use Multilevel Logic Optimization" (ON) "Optimization
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Newbie-Frage zu CPLD / FPGA
Konfigurationsspeicher) und die Eingaenge sind nicht 5 Volt tolerant. Aber wenn man mehr Logik braucht als ein XC9572XL, dann sollte man jetzt an einen XC3E denken.
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Welcher FPGA für den Einstieg mit VHDL?
Ich würde mal klein anfangen, XC9500 oder MaxII CPLD, ist übersichtlicher und einfacher zu wechseln, wenn kaputt. Ansosten kann man eigentlich alle FPGAs nutzen, mit ein wenig Suchen findet man diverse "zurechtgepatchte" Altera/Xilinx
TQFP Chip für 5-10$ auf ebay/ali etc, haben 5V tolerate I/O und für vielerlei Kleinkram reicht ein XC9572 oder EPM240, falls ein bisschen grösser. Und man kann das Board grad ins Projekt einbauen, wenn man fertig ist, da billig und ohne sonstige Komponenten. So ein fetter Spartan7 ist für das meiste
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GPIB Controller
mir einen GPIB Controller designen. Als Treiber mit kleiner Verarbeitung dachte ich an drei Stück XC9536XL oder 9572XL von Xilinx. Mit drei Pins für eine Leitung kann man die abschaltbaren Pullups realisieren und hat auch genügend Strom für den Bus. Den Datenpfad habe ich 7bittig designt. Das achte
Die 7Bit passen genau in einen XC9536XL inkl. Adressvergleicher für TALK/UNTALK bzw. LISTEN/UNLISTEN. Den Teil habe ich fertig. Das achte bit kann man sonstwo hinpacken, da es nicht verarbeitet werden muß. Wichtig ist, daß es die gleiche
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Tristate Ausgänge im CPLD verbinden?
1.es ist ein XC9572 2.ein CPLD hat keine Tristate Buffer ? Muss ich dann extra extern einen Tristate Buffer anbringen?
Source) Exception in thread "main" Design fpga_project1 has been optimized and fit into device XC95288XL-6-TQ144. CpldFit - Completed Successfully ---------------------
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[s] cpld breakout board mit altera cpld oder fpga mit speicher
weil ich was dazulernen möchte. für das vorhaben hätte ich http://dangerousprototypes.com/docs/XC9500XL_CPLD_breakout_board entdeckt. doch ich denke mir dass das verwendete CPLD zu klein ist für das projekt? weiters frage ich mich wie es mit dem takt aussieht? weiters kenne ich mich nur mit den
experimentieren. Habe ich mal so gemacht: http://www.dasrotemopped.de/bilder/EB2_Extender.jpg Atmega325p + XC9572XL + Altera Cyclone FPGA Board. Kannst ja später abspecken wenn du willst. Der Einfachheit halber vielleicht CPLD und FPGA vom gleichen Hersteller wählen. Gruß, dasrotemopped.
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Grundsätzliche Frage zur Realisation von Mathe im FPGA
end if; end loop; end process; end architecture rtl; [/vhdl] Für den langsamsten XC9572XL implementiert braucht das ca. 7% an Resourcen bei den 16 Bit und läuft bis zu ca. 90 MHz laut Timing Report (11 ns worst-case von input zu output). Es berechnet den Logarithmus zur Basis 2, jeweils
Ich habe es mal ohne UCF-Datei und für XC95* laufen lassen (also ISE sucht die Pins, Speed Grade und den konkreten Typ selbst aus) und da geht es laut Timing Report dann bis 166 MHz. Für Spartan 6 (xc6slx25) nur bis 82 MHz, aber vielleicht habe
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fragen zu fsm, verilog modulen und probleme.
ein bit erweiter gibt es probleme. in der behavioral simulation gehts einwandfrei. auf der hardware (xc95144) leider nicht. oder sagen wirs so es funktioniert meisstens. nur halt manchmal nicht. ich hab mir die rtl schematic mal angesehen. die ist schon recht gross nur fuer den counter weil die ffs
aender ich noch auf ein pin) da der 95144 voll war hab ich das syncen fuer den bildschim in ein xc9572 ausgelagert . der xc95144 bekommt nun zwei signale vSync und wenn noBorder (sprich wenn man im sichtbaren bereich sich befindet). seither ich das ausgelagert habe tritt der fehler immer auf.
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Umgang mit CPLD's lernen ( Altera od XILINX) via Dev Kit
unterschreiben wollen. Wie immer "kommt darauf an" Bei meinem "8086 from scratch" Projekt setze ich einen XC9572 ein: Hier geht es nur um die Ersetzung von TTL-Gräbern, Adressdekodierer und anderen "Kleinkram".(...und das alles mit 5V) Einfach in eine PLCC Fassung und ab aufs Lochraster. Gut: die Kosten für
die XC95xx(XL)-Reihe auch als FPGA? (3,3V / 5V tolerante I/Os, kostenlose IDE, kein Konfigurationseprom) Ziel ist es die direkte Peripherie um den 8086 im FPGA nachzubilden. (Bustreiber, Buscontroller, Clock
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Funktionsgenerator 7706 - Sweep reparieren
Motherboard und dort dann wohl zum Sweepboard. Auf dem CPU-Board sitzt neben der CPU auch noch ein XC9572XL-7VQ64C im TQFP64-Gehäuse mit JTAG-Interface. Der wird wohl als Frequenzzähler genutzt. > Wenn die Daten für den 12 Bit AD sind, dann wohl als 4 Pulse für den > FPGA (um zu zeigen das es
Bei ebay gibt's zahlreiche billige XC2064s. http://www.ebay.com/sch/i.html?_from=R40&_trksid=p2050601.m570.l1313.TR0.TRC0.H0&_nkw=xc2064&_sacat=0 Wieso nicht einfach mal ein paar davon kaufen und die testhalber tauschen? Da die Xilinx-Dinger
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FPGA wirtschaftlich betrachtet
Meist beides zugleich. Für einen Spartan 3AN (den kleinsten) bezahle ich irgendetwas um die 5 €. Ein XC 9572 Xl kostet so um die 1,4 €. Was bitte ist daran teuer? Das eine unbedingt gegen das andere austauschen zu wollen, spricht nicht gerade von geballtem Sachverstand - oder man ist ein Ing, den man
aufhängen, wenn man tatsächlich FPGAs in Serienstückzahlen braucht. Bei einem Design Ende 2007 war zB. der xc3s1600e drin. Bei digikey ca. 60Euros. Bei Avnet dann AFAIR so 12Euros... Die xc6s sind jetzt schon einzeln bei digikey richtig billig, etwas dem 3s1600 vergleichbares wird in Stückzahlen wohl dann bei
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CPLD/FPGA Plazierung/Routing
voll ausnutze) recht gut beeinflussen. Und: In EAGLE ist der CPLD, um den es geht (Beispiel: XC9572), als PLCC 84 vorhanden. Nun, nach einem Platzieren der Bausteine auf der Platine würde sich erst die günstigste Zuordnung "Echt-Pin" zu "Funktions-Pin" ergeben, die ich beim CPLD constraints
ich rausdestilliert: 1. Man lasse im CPLD genug Raum für den Kompromiss zwischen "Balance" (beim XC95288 offensichtlich in Kombination mit "Low/High Power" eine Möglichkeit, ihn abrauchen zu lassen...) und Density zu haben. Dann kann man einige Pins gut "verschieben". 2. Zu viele Änderungen auf
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FPGA Einstieg ohne fertiges Board möglich?
und ob ein einfaches cpld genügt (hört sich stark danach an). Das größte Xilinx-cpld bei Reichelt (XC9572XL im TQFP100-Gehäuse) kostet grade mal 5.30EUR, hat aber insgesamt nur 72IOs plus Clockeingänge, und wenn du noch ein paar Pins zusätzlich für den seriellen Ein/Ausgang brauchst... Die größeren Teile mit mehr IOs (und auch Makrozellen) gibt es z.B. bei segor.de (XC 95144XL ab ca. 13EUR.) Gruß, Stefan
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128kByte Ram an AVR
nicht schon ausreichen? So ein CPLD kostet ja mindestens das doppelte. Oder reicht zumindest ein XC9572? Gibt es dafür kostenlose Software und Selbstbau Programmer oder muß/sollte man sich da ein Entwicklertool kaufen? Ich danke dir für die ausführliche Antwort. Gruß Markus
Devices. Fertig compiliert passt es mit 27 Makrozellen und 34 Pins exakt in einen kleinen Xilinx XC9536XL PLCC44 oder TQPF44 rein. Bei Reichelt kannst du diesen für 1,80 Euro kaufen. Die 5V Version gibts dort auch ist aber bischen teurer. Der Addressdekoder im VHDL ist angepasst auf den ATMega162
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Die Krux mit dem vhdl und den dev boards
Elektronik, insbesondere auch vhdl zu beschäftigen. dazu habe ich noch ein paar Fragen: Habe mir ein xc9572 Platinchen gebaut mit paar Leds und 2 tastern. Das kann ich programmieren - alles prima. Aber ist dennoch ein wenig eine Sackgasse. Ich denke noch etwas dazu zu bauen wäre mir recht nur was weiß
allerdings 2 Versionen mit unterschiedlich großen FPGAs. Ich würde dir die 1000er Version empfehlen. Ein xc3s200 wird relativ schnell zu klein.
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CMOS Sensor MT9P031
gesteckten Platinen. Die eine Platine enthält den Bildsensor, die zweite den CY7C68013A mit einem CPLD (XC9572XL). Ein Speicherbaustein ist nicht zu sehen, das Datenblatt des CPLD sagt nichts über einen internen Speicher. Ich denke, der CPLD ist dafür da, um verschiedene Bildsensoren anzupassen. Das heißt
was für einen FPGA/SDRAM Baustein hast du benutzt? Auf dem DevBoard von Aptina wird ein VIRTEX-II XC2V250FG256 (ohne extra RAM) eingesetzt. Gruß, Julius
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Xilinx Impact x9536 CPLD
ging das Störungseinfangen über die Pgm-Leitungen von Löschen des Schaltkreises bis Totalausstieg (9572XL).
evtl. eine Strombegrenzung drin? Ich hab jetzt die Werte nicht im Kopf (siehe Datenblatt), der XC9536 könnte so um die 100 mA brauchen + deine LEDs. Duke
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CPLD 95xxx o.ä. als digitaler Tiepass nutzbar ?
Nun wollte ich fragen ob jemand eine Möglichkeit kennt diese in fertigen Blöcken graphisch in einen XC95108, 9572 oder 9536 zu programmieren. Oder gibt es vielleicht fertige Codes dafür, oder eine Möglichkeit mit einem FPGA? Hat evtl. jemand einen Lösungsansatz für dieses Problem? Mein Hauptanliegen
die Zeitverzögerung programmieren sollte? >Wichtiger wäre erst einmal die Zeitverzögerung im CPLD XC9536, das andere >könnte ich >dann mit meinem OSZI und in der Firma kontrollieren. 1.) Du weisst noch gar nicht so recht was du machen willst. Dir fehlen WICHTIGE Grundlagen. Also such dir ein Buch
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[S] suche alte Atmel und Altera CPLDs
und die jeweilige Gehäuse TQFP oder PLCC, ist im Prinzip egal) Zum Tausch stehen z.b. neue Xilinx XC9572XL-5C(TQFP100), XC9536XL-10C(VQ44), XC2S100-5C(TQ144), Altera EP1C3T144C8N, EPM240T100C5N, auch diverse weitere CPLDs/FPGAs in BGA, etc. Der Hintergrund der Suche: ich baue z.zt. mehrere Adapter
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Logikcracks gefragt! Job für µC oder Logik-Ic? Schrittmotor ansteuern
irgendeinem Logik-Ic zu machen Anstatt Digitalschaltung würde es natürlich auch ein kleines CPLD tun: XC9572 5V 44 pins 2 EUR XC2C64 3.3V 44 pins 2 EUR Aber immer noch teurer als ein kleiner uC ...
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alu , 74181, CPU, IC
Ein XC9572 oder ähnliches könnte bestimmt das gleiche schaffen...
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Aufgabe des 74HCT541
Ich habe eine Schaltung bekommen, an der hinter den I/O-Pins eines CPLD XC9472XL ein 74HCT541 sich befindet. Welche Aufgabe hat der 74HCT541? Verstärkt er das Signal nur oder welche Aufgabe hat er? Welche Aufgabe hat ein oktal busdriver? Ein Datenblatt habe ich mit angehangen
@ Jens Denkst du etwa, dass der 9572 XL keine IOs hat, die man in den Tristate schicken könnte?
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[V] Aus Hobby-Auflösung: MCUs,FPGA, Speicher, etc.
1x PIC16F84A-20/P (Microchip, MCU) 1x PIC16F877-04/P (Microchip, MCU) inkl. Sockel 40pol. 1x XC2S100-5TQ144C (Xilinx, Spartan 2 FPGA) EUR 15,00 1x XC9572-15 PC84C (Xilinx, CPLD PLCC84) EUR 5,00 1x ADV7125KST140 (Analog Devices, 8-Bit High Speed Video DAC) 1x ADV7125JST140 (Analog Devices,
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Frage zu Machbarkeit bzgl. CPLD
Ein mittlelgrosses CPLD ist haeufig teuer als ein kleines FPGA, wie ein XC3S50A(N) und hat trotzdem deutlich weniger Resoucen...
CPLDs als das von dir gefundene 544-1964-ND EPM240T100C5N gleicher Preis, mehr Inhalt 122-1448-ND XC9572XL-10VQG44C, billiger, etwa gleich viel Inhalt. Suche immer 3,3 Volt Typen, die 5 Volt tolerant sind. 5V CPLDs werden mit Gold aufgewogen. Wenns dein Budget hergibt nimm ca. 500 LE und externes
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Leistungsaufnahme von FPGA/CPLD
steht in den Datenblättern, für die CPLDs gibts exakte Diagramme. Da ich grade gemessen habe: XC9572XL halbvoll mit 1 MHz Takt (also sehr langsam) zieht ca. 10 bis 20 mA.
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BUCHSUCHE VHDL (Reichardt / Schwarz)
gelesen, das das Buch toll ist, deswegen dachte ich, das Buch sollte es sein. Habe auch schon mehrere XC9572 durch, teilweise mit "ABEL" oder "PLAN". Weil fast alle empfehlen es mit VHDL zu versuchen. Deswegen. CL
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suche 64Bit Schieberegister
XC9572XL?
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Portierung vhdl
Hallo, ich habe mal vor einiger Zeit eine Schaltung als Schaltbild für einen XC9572 CPLD von Xilinx mit der ISE Web Software erstellt. Der Projektnavigator erzeugt automatisch eine Datei mit dem Eintrag "VHDL Funktional Model". In dieser Datei ist die VHDL Beschreibung von meinem
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CPLD kaputt ???
Hallo. Ich habe hier einen Xilinx XC9572-15 verwendet. Dieser zeigt aber ein äußerst merkwürdiges Verhalten. Versorgt wird er mit 5V. Programmiere ich ihn (mit iMPACT), so funktioniert dies einwandfrei. Auch verifizieren und löschen
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Einstiegsboard Spartan-6
folgenden Artikel gestossen: http://www.ebay.de/itm/Xilinx-FPGA-USB-Development-Learning-board-Spartan-6-XC6SLX9-Remote-controller-/141762290694?hash=item2101b0e406 Für Gehversuche mit CPLD habe ich mir einen XC9572XL auf DIL zugelegt. Ist das einigermaßen brauchbar für die ersten Gehversuche? Hab mich
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RGB-LED mit PWM
> lösung - ich habe mich noch nicht mit solchen dingern beschäftigt - > gibts da was? Xilinx XC9500-Serie... in PC44/84 Gehäuse, mit 50ct Sockel auch auf Lochraster zu verwenden. Läuft mit 5V oder 3.3V. Programmierung über Parallelport-Adaptor. (Drei Widerstände könnten reichen, sonst kommt noch
, der nicht in >einem bga steckt, únd sich mit 3 widerständen an einem pc mit ... >Xilinx XC9500-Serie... in PC44/84 Gehäuse, mit 50ct Sockel auch auf >Lochraster zu verwenden. Läuft mit 5V oder 3.3V. Programmierung über Genau! Wobei die NICHT mit variabler Spannung arbeiten wie die AVRs
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Latch mit CPLD
Hallo! Ich versuche zur Zeit mir ein Latch mit dem XC9572XL von Xilinx aufzubauen. Den Quelltext habe ich hier definiert. Fällt jemanden dabei irgendwas auf, was nicht in Ordnung ist? Das Ale soll bei der negativen Flanke, die Anweisung ausführen! Danke
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LED am CPLD anklemmen
ich habe mal einen XC9572XL ( 3,3V Betriebsspannung ) dazu gebracht, als Stromquelle für diverse LEDs zu dienen ( alle LEDs auf der linken Seite auf dem Steckbrett ). Gab keine Probleme. Auch der ATmega325 (5 V) konnte die
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Cache-RAMs als Logikanalyzer
>Eher 74AC161 oder 74AC163... Ich würde einen CPLD ala XC9572 oder grösser nehmen und da die Zähler und Triggereinheit reinbauen. Den kann man dann recht frei programmieren, aber da liegt dann auch schon das Problem. Man muss ihn programmieren;)
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Downloadkabel
der Homepage geben, wo ich den Bauplan für diese Downloadkabel und das Downloadprogramm für xilinx XC9572 CPLDs finde. Es ist so ein ganz einfaches Kabel für die LPTx Schnittstelle am Computer, auf der anderen Seite ist ein JTAG-Anschluss. Es enthält keine weiteren Bauteile. Ich ahb schon gegoogle, finds