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Wie optimieren um weniger Produktterme zu bekommen?
Makrozellen ist ok. 14 Stück. Nur die Produktterme, mein WebPack sagt er hätte 188 Stück erzeugt. In einen XC9536 den ich gerne benutzen will passen aber nur 180 Stück. Kann mir jemand einen Tip geben wie ich es hinbekomme weniger erzeugen zu lassen. Meinetwegen können dafür auch noch ein paar Makrozellen draufgehen
Synthese etwas zu pushen. In meinem CPLD-Projekt für den 7-stelligen 200 MHz Frequenzzähler (1x XC9572 zu 99% voll) habe ich mit folgenden Parametern experimentiert: "Collapsing PTERM Limit" (z.B. 26) "Collapsing Input Limit" (z.B. 36) "Use Multilevel Logic Optimization" (ON) "Optimization
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Newbie-Frage zu CPLD / FPGA
Konfigurationsspeicher) und die Eingaenge sind nicht 5 Volt tolerant. Aber wenn man mehr Logik braucht als ein XC9572XL, dann sollte man jetzt an einen XC3E denken.
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Welcher FPGA für den Einstieg mit VHDL?
Ich würde mal klein anfangen, XC9500 oder MaxII CPLD, ist übersichtlicher und einfacher zu wechseln, wenn kaputt. Ansosten kann man eigentlich alle FPGAs nutzen, mit ein wenig Suchen findet man diverse "zurechtgepatchte" Altera/Xilinx
TQFP Chip für 5-10$ auf ebay/ali etc, haben 5V tolerate I/O und für vielerlei Kleinkram reicht ein XC9572 oder EPM240, falls ein bisschen grösser. Und man kann das Board grad ins Projekt einbauen, wenn man fertig ist, da billig und ohne sonstige Komponenten. So ein fetter Spartan7 ist für das meiste
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GPIB Controller
mir einen GPIB Controller designen. Als Treiber mit kleiner Verarbeitung dachte ich an drei Stück XC9536XL oder 9572XL von Xilinx. Mit drei Pins für eine Leitung kann man die abschaltbaren Pullups realisieren und hat auch genügend Strom für den Bus. Den Datenpfad habe ich 7bittig designt. Das achte
Die 7Bit passen genau in einen XC9536XL inkl. Adressvergleicher für TALK/UNTALK bzw. LISTEN/UNLISTEN. Den Teil habe ich fertig. Das achte bit kann man sonstwo hinpacken, da es nicht verarbeitet werden muß. Wichtig ist, daß es die gleiche
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Tristate Ausgänge im CPLD verbinden?
1.es ist ein XC9572 2.ein CPLD hat keine Tristate Buffer ? Muss ich dann extra extern einen Tristate Buffer anbringen?
Source) Exception in thread "main" Design fpga_project1 has been optimized and fit into device XC95288XL-6-TQ144. CpldFit - Completed Successfully ---------------------
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[s] cpld breakout board mit altera cpld oder fpga mit speicher
weil ich was dazulernen möchte. für das vorhaben hätte ich http://dangerousprototypes.com/docs/XC9500XL_CPLD_breakout_board entdeckt. doch ich denke mir dass das verwendete CPLD zu klein ist für das projekt? weiters frage ich mich wie es mit dem takt aussieht? weiters kenne ich mich nur mit den
experimentieren. Habe ich mal so gemacht: http://www.dasrotemopped.de/bilder/EB2_Extender.jpg Atmega325p + XC9572XL + Altera Cyclone FPGA Board. Kannst ja später abspecken wenn du willst. Der Einfachheit halber vielleicht CPLD und FPGA vom gleichen Hersteller wählen. Gruß, dasrotemopped.
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Grundsätzliche Frage zur Realisation von Mathe im FPGA
end if; end loop; end process; end architecture rtl; [/vhdl] Für den langsamsten XC9572XL implementiert braucht das ca. 7% an Resourcen bei den 16 Bit und läuft bis zu ca. 90 MHz laut Timing Report (11 ns worst-case von input zu output). Es berechnet den Logarithmus zur Basis 2, jeweils
Ich habe es mal ohne UCF-Datei und für XC95* laufen lassen (also ISE sucht die Pins, Speed Grade und den konkreten Typ selbst aus) und da geht es laut Timing Report dann bis 166 MHz. Für Spartan 6 (xc6slx25) nur bis 82 MHz, aber vielleicht habe
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fragen zu fsm, verilog modulen und probleme.
ein bit erweiter gibt es probleme. in der behavioral simulation gehts einwandfrei. auf der hardware (xc95144) leider nicht. oder sagen wirs so es funktioniert meisstens. nur halt manchmal nicht. ich hab mir die rtl schematic mal angesehen. die ist schon recht gross nur fuer den counter weil die ffs
aender ich noch auf ein pin) da der 95144 voll war hab ich das syncen fuer den bildschim in ein xc9572 ausgelagert . der xc95144 bekommt nun zwei signale vSync und wenn noBorder (sprich wenn man im sichtbaren bereich sich befindet). seither ich das ausgelagert habe tritt der fehler immer auf.
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Umgang mit CPLD's lernen ( Altera od XILINX) via Dev Kit
unterschreiben wollen. Wie immer "kommt darauf an" Bei meinem "8086 from scratch" Projekt setze ich einen XC9572 ein: Hier geht es nur um die Ersetzung von TTL-Gräbern, Adressdekodierer und anderen "Kleinkram".(...und das alles mit 5V) Einfach in eine PLCC Fassung und ab aufs Lochraster. Gut: die Kosten für
die XC95xx(XL)-Reihe auch als FPGA? (3,3V / 5V tolerante I/Os, kostenlose IDE, kein Konfigurationseprom) Ziel ist es die direkte Peripherie um den 8086 im FPGA nachzubilden. (Bustreiber, Buscontroller, Clock
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Funktionsgenerator 7706 - Sweep reparieren
Motherboard und dort dann wohl zum Sweepboard. Auf dem CPU-Board sitzt neben der CPU auch noch ein XC9572XL-7VQ64C im TQFP64-Gehäuse mit JTAG-Interface. Der wird wohl als Frequenzzähler genutzt. > Wenn die Daten für den 12 Bit AD sind, dann wohl als 4 Pulse für den > FPGA (um zu zeigen das es
Bei ebay gibt's zahlreiche billige XC2064s. http://www.ebay.com/sch/i.html?_from=R40&_trksid=p2050601.m570.l1313.TR0.TRC0.H0&_nkw=xc2064&_sacat=0 Wieso nicht einfach mal ein paar davon kaufen und die testhalber tauschen? Da die Xilinx-Dinger
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FPGA wirtschaftlich betrachtet
Meist beides zugleich. Für einen Spartan 3AN (den kleinsten) bezahle ich irgendetwas um die 5 €. Ein XC 9572 Xl kostet so um die 1,4 €. Was bitte ist daran teuer? Das eine unbedingt gegen das andere austauschen zu wollen, spricht nicht gerade von geballtem Sachverstand - oder man ist ein Ing, den man
aufhängen, wenn man tatsächlich FPGAs in Serienstückzahlen braucht. Bei einem Design Ende 2007 war zB. der xc3s1600e drin. Bei digikey ca. 60Euros. Bei Avnet dann AFAIR so 12Euros... Die xc6s sind jetzt schon einzeln bei digikey richtig billig, etwas dem 3s1600 vergleichbares wird in Stückzahlen wohl dann bei
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CPLD/FPGA Plazierung/Routing
voll ausnutze) recht gut beeinflussen. Und: In EAGLE ist der CPLD, um den es geht (Beispiel: XC9572), als PLCC 84 vorhanden. Nun, nach einem Platzieren der Bausteine auf der Platine würde sich erst die günstigste Zuordnung "Echt-Pin" zu "Funktions-Pin" ergeben, die ich beim CPLD constraints
ich rausdestilliert: 1. Man lasse im CPLD genug Raum für den Kompromiss zwischen "Balance" (beim XC95288 offensichtlich in Kombination mit "Low/High Power" eine Möglichkeit, ihn abrauchen zu lassen...) und Density zu haben. Dann kann man einige Pins gut "verschieben". 2. Zu viele Änderungen auf
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FPGA Einstieg ohne fertiges Board möglich?
und ob ein einfaches cpld genügt (hört sich stark danach an). Das größte Xilinx-cpld bei Reichelt (XC9572XL im TQFP100-Gehäuse) kostet grade mal 5.30EUR, hat aber insgesamt nur 72IOs plus Clockeingänge, und wenn du noch ein paar Pins zusätzlich für den seriellen Ein/Ausgang brauchst... Die größeren Teile mit mehr IOs (und auch Makrozellen) gibt es z.B. bei segor.de (XC 95144XL ab ca. 13EUR.) Gruß, Stefan
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128kByte Ram an AVR
nicht schon ausreichen? So ein CPLD kostet ja mindestens das doppelte. Oder reicht zumindest ein XC9572? Gibt es dafür kostenlose Software und Selbstbau Programmer oder muß/sollte man sich da ein Entwicklertool kaufen? Ich danke dir für die ausführliche Antwort. Gruß Markus
Devices. Fertig compiliert passt es mit 27 Makrozellen und 34 Pins exakt in einen kleinen Xilinx XC9536XL PLCC44 oder TQPF44 rein. Bei Reichelt kannst du diesen für 1,80 Euro kaufen. Die 5V Version gibts dort auch ist aber bischen teurer. Der Addressdekoder im VHDL ist angepasst auf den ATMega162
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Die Krux mit dem vhdl und den dev boards
Elektronik, insbesondere auch vhdl zu beschäftigen. dazu habe ich noch ein paar Fragen: Habe mir ein xc9572 Platinchen gebaut mit paar Leds und 2 tastern. Das kann ich programmieren - alles prima. Aber ist dennoch ein wenig eine Sackgasse. Ich denke noch etwas dazu zu bauen wäre mir recht nur was weiß
allerdings 2 Versionen mit unterschiedlich großen FPGAs. Ich würde dir die 1000er Version empfehlen. Ein xc3s200 wird relativ schnell zu klein.
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CMOS Sensor MT9P031
gesteckten Platinen. Die eine Platine enthält den Bildsensor, die zweite den CY7C68013A mit einem CPLD (XC9572XL). Ein Speicherbaustein ist nicht zu sehen, das Datenblatt des CPLD sagt nichts über einen internen Speicher. Ich denke, der CPLD ist dafür da, um verschiedene Bildsensoren anzupassen. Das heißt
was für einen FPGA/SDRAM Baustein hast du benutzt? Auf dem DevBoard von Aptina wird ein VIRTEX-II XC2V250FG256 (ohne extra RAM) eingesetzt. Gruß, Julius
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Xilinx Impact x9536 CPLD
ging das Störungseinfangen über die Pgm-Leitungen von Löschen des Schaltkreises bis Totalausstieg (9572XL).
evtl. eine Strombegrenzung drin? Ich hab jetzt die Werte nicht im Kopf (siehe Datenblatt), der XC9536 könnte so um die 100 mA brauchen + deine LEDs. Duke
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CPLD 95xxx o.ä. als digitaler Tiepass nutzbar ?
Nun wollte ich fragen ob jemand eine Möglichkeit kennt diese in fertigen Blöcken graphisch in einen XC95108, 9572 oder 9536 zu programmieren. Oder gibt es vielleicht fertige Codes dafür, oder eine Möglichkeit mit einem FPGA? Hat evtl. jemand einen Lösungsansatz für dieses Problem? Mein Hauptanliegen
die Zeitverzögerung programmieren sollte? >Wichtiger wäre erst einmal die Zeitverzögerung im CPLD XC9536, das andere >könnte ich >dann mit meinem OSZI und in der Firma kontrollieren. 1.) Du weisst noch gar nicht so recht was du machen willst. Dir fehlen WICHTIGE Grundlagen. Also such dir ein Buch
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[S] suche alte Atmel und Altera CPLDs
und die jeweilige Gehäuse TQFP oder PLCC, ist im Prinzip egal) Zum Tausch stehen z.b. neue Xilinx XC9572XL-5C(TQFP100), XC9536XL-10C(VQ44), XC2S100-5C(TQ144), Altera EP1C3T144C8N, EPM240T100C5N, auch diverse weitere CPLDs/FPGAs in BGA, etc. Der Hintergrund der Suche: ich baue z.zt. mehrere Adapter
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Logikcracks gefragt! Job für µC oder Logik-Ic? Schrittmotor ansteuern
irgendeinem Logik-Ic zu machen Anstatt Digitalschaltung würde es natürlich auch ein kleines CPLD tun: XC9572 5V 44 pins 2 EUR XC2C64 3.3V 44 pins 2 EUR Aber immer noch teurer als ein kleiner uC ...
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alu , 74181, CPU, IC
Ein XC9572 oder ähnliches könnte bestimmt das gleiche schaffen...
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Aufgabe des 74HCT541
Ich habe eine Schaltung bekommen, an der hinter den I/O-Pins eines CPLD XC9472XL ein 74HCT541 sich befindet. Welche Aufgabe hat der 74HCT541? Verstärkt er das Signal nur oder welche Aufgabe hat er? Welche Aufgabe hat ein oktal busdriver? Ein Datenblatt habe ich mit angehangen
@ Jens Denkst du etwa, dass der 9572 XL keine IOs hat, die man in den Tristate schicken könnte?
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[V] Aus Hobby-Auflösung: MCUs,FPGA, Speicher, etc.
1x PIC16F84A-20/P (Microchip, MCU) 1x PIC16F877-04/P (Microchip, MCU) inkl. Sockel 40pol. 1x XC2S100-5TQ144C (Xilinx, Spartan 2 FPGA) EUR 15,00 1x XC9572-15 PC84C (Xilinx, CPLD PLCC84) EUR 5,00 1x ADV7125KST140 (Analog Devices, 8-Bit High Speed Video DAC) 1x ADV7125JST140 (Analog Devices,
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Frage zu Machbarkeit bzgl. CPLD
Ein mittlelgrosses CPLD ist haeufig teuer als ein kleines FPGA, wie ein XC3S50A(N) und hat trotzdem deutlich weniger Resoucen...
CPLDs als das von dir gefundene 544-1964-ND EPM240T100C5N gleicher Preis, mehr Inhalt 122-1448-ND XC9572XL-10VQG44C, billiger, etwa gleich viel Inhalt. Suche immer 3,3 Volt Typen, die 5 Volt tolerant sind. 5V CPLDs werden mit Gold aufgewogen. Wenns dein Budget hergibt nimm ca. 500 LE und externes
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Leistungsaufnahme von FPGA/CPLD
steht in den Datenblättern, für die CPLDs gibts exakte Diagramme. Da ich grade gemessen habe: XC9572XL halbvoll mit 1 MHz Takt (also sehr langsam) zieht ca. 10 bis 20 mA.
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BUCHSUCHE VHDL (Reichardt / Schwarz)
gelesen, das das Buch toll ist, deswegen dachte ich, das Buch sollte es sein. Habe auch schon mehrere XC9572 durch, teilweise mit "ABEL" oder "PLAN". Weil fast alle empfehlen es mit VHDL zu versuchen. Deswegen. CL
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suche 64Bit Schieberegister
XC9572XL?
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Portierung vhdl
Hallo, ich habe mal vor einiger Zeit eine Schaltung als Schaltbild für einen XC9572 CPLD von Xilinx mit der ISE Web Software erstellt. Der Projektnavigator erzeugt automatisch eine Datei mit dem Eintrag "VHDL Funktional Model". In dieser Datei ist die VHDL Beschreibung von meinem
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CPLD kaputt ???
Hallo. Ich habe hier einen Xilinx XC9572-15 verwendet. Dieser zeigt aber ein äußerst merkwürdiges Verhalten. Versorgt wird er mit 5V. Programmiere ich ihn (mit iMPACT), so funktioniert dies einwandfrei. Auch verifizieren und löschen
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Einstiegsboard Spartan-6
folgenden Artikel gestossen: http://www.ebay.de/itm/Xilinx-FPGA-USB-Development-Learning-board-Spartan-6-XC6SLX9-Remote-controller-/141762290694?hash=item2101b0e406 Für Gehversuche mit CPLD habe ich mir einen XC9572XL auf DIL zugelegt. Ist das einigermaßen brauchbar für die ersten Gehversuche? Hab mich
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RGB-LED mit PWM
> lösung - ich habe mich noch nicht mit solchen dingern beschäftigt - > gibts da was? Xilinx XC9500-Serie... in PC44/84 Gehäuse, mit 50ct Sockel auch auf Lochraster zu verwenden. Läuft mit 5V oder 3.3V. Programmierung über Parallelport-Adaptor. (Drei Widerstände könnten reichen, sonst kommt noch
, der nicht in >einem bga steckt, únd sich mit 3 widerständen an einem pc mit ... >Xilinx XC9500-Serie... in PC44/84 Gehäuse, mit 50ct Sockel auch auf >Lochraster zu verwenden. Läuft mit 5V oder 3.3V. Programmierung über Genau! Wobei die NICHT mit variabler Spannung arbeiten wie die AVRs
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Latch mit CPLD
Hallo! Ich versuche zur Zeit mir ein Latch mit dem XC9572XL von Xilinx aufzubauen. Den Quelltext habe ich hier definiert. Fällt jemanden dabei irgendwas auf, was nicht in Ordnung ist? Das Ale soll bei der negativen Flanke, die Anweisung ausführen! Danke
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LED am CPLD anklemmen
ich habe mal einen XC9572XL ( 3,3V Betriebsspannung ) dazu gebracht, als Stromquelle für diverse LEDs zu dienen ( alle LEDs auf der linken Seite auf dem Steckbrett ). Gab keine Probleme. Auch der ATmega325 (5 V) konnte die
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Cache-RAMs als Logikanalyzer
>Eher 74AC161 oder 74AC163... Ich würde einen CPLD ala XC9572 oder grösser nehmen und da die Zähler und Triggereinheit reinbauen. Den kann man dann recht frei programmieren, aber da liegt dann auch schon das Problem. Man muss ihn programmieren;)
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Downloadkabel
der Homepage geben, wo ich den Bauplan für diese Downloadkabel und das Downloadprogramm für xilinx XC9572 CPLDs finde. Es ist so ein ganz einfaches Kabel für die LPTx Schnittstelle am Computer, auf der anderen Seite ist ein JTAG-Anschluss. Es enthält keine weiteren Bauteile. Ich ahb schon gegoogle, finds
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Suche ketten AND GATE
konventionelle 74'er Logik. Wenn es schneller sein muß oder bei vielen solcher Eingänge, dann wäre z.B. ein XC9572XL CPLD geeignet. Gibt es im 44 TQFP Gehäuse (für 1,62 Euro bei Digikey), mit 9,8 x 9.8 mm^2. So klein wie möglich gäbe es den auch noch in BGA-Bauform, wenn du dir das antun willst oder es bestücken
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100Mhz TTL? HC/HCT
Bei 100MHz entweder AC(T) oder F. Oder eben CPLD, der XC9572 (XCR3064) ist für Bastler im PLCC44 noch einfach zu handhaben (Sockel mit Pins im 2.54-Raster) und direkt über den LPT-Port programmierbar. Peter
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geht CPLD + Quarz ohne Quarzoszi?
dann natürlich die entsprechende Logik sein, so wie bei einem Oszillator mit Gattern. Verwende XC9572XL CPLDs von Xilinx. Hat da jemand ein Beispiel oder einen Link? Vielen Dank - cl
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CPLD und nicht benötigte PINs
Richtig, sind XC9572 von Xilinx. Danke für die schnelle Anwort. Wo bekomme ich denn als Privatmensch die 7ns-Typen in Deutschland her? Gruß Holger
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USB-Blaster CPLD-Design
Hallo, ich habe mir einen USB-Blaster selber gebaut (FT245RL + XC9572XL) Das, was Sie brauchen, habe ich angehängt! MfG aus Westerwald
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Suche eagle Library für Xilinx CPLD
schon jemand hat und mir zukommen lassen könnte. Ich bräuchte eine eagle Library für das Xilinx CPLD XC9572XL-5TQ100C (also im 100-TQFP Gehäuse). Vielen Dank im Vorraus, Holger
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Verscherble diverse Bauteile Sammlungen wegen Hobbyaufgabe
ATTINI 2313 .... div. Spannungsregler, ein paar OPAmps, ein paar Dioden, einige Quarze und auch 2 CPLD XC9572XL. Ein paar Transistoren. Für 15 € ein perfekter Einstieg in die MC-Entwicklung. 4. Sammlung Diverse ist ein ehemaliges Pollin-Überraschungspakt mit passiven Bauteilen. Für Versandkosten geb
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CPLD Starter Kit für Anfänger
Christian J. schrieb im Beitrag #4003675: > Was hat Xilinx denn da? Wie gesagt: z.B den XC9572XL, den XC95108 oder ähnliche...
Ich bin vor einigen Monaten von Xilinx zu Altera gewechselt, bzw. von der XC95 Serie zu MAX V und zukünftig MAX 10. Auch wenn der MAX V etwas langsamer bootet ziehe ich diesen Baustein eindeutig vor, da.. ... Alle Eingänge als Schmitt-Trigger konfigurierbar sind. Allgemein
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LM1881N für Ambilight
ich würde Dir dazu raten nen kleinen cpld (xc9572xl oderso) fürs pixel/zeilenzählen undso zu nehmen, ist weniger aufwand und flexibler als 74hc...
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Kurzschlussfestigkeit von FPGA Ausgängen
Stromaufnahme steigt dann zwar ein wenig, aber kaputt ist der noch lange nicht. Ausprobiert mit einem XC9572 (unfreiwillig) sowie Spartan 2 und Spartan 3 (jeweils mutwillig).
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Controller für Farb Display
Bsp: XC9572-PLCC44 Gibt es bei mehreren Distributoren. Kosten unter 5 Neudeutsche Währungseinheiten Datenblätter bei http://www.xilinx.com Takt: 125MHz, Schaltzeiten ca. 10 ns (also so ca. 100MHz, sollte
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Welche Speicherbausteine nehmen?
: http://www.msc-toolguide.com/lattice/device-family/machxo Nur: 5V FPGAs (als Vergleich zum XC9572 CPLD) wirst du nicht mehr finden.
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VHDL-Simulator unter linux
kostenlosen Version schnarch langsam. Jetzt hatte ich genug Minuten auf 100 ms von einem kleinen (XC9572) Design Simuergebnisse zu warten (Verhaltens-Simu, nicht Timing) und hab die ISE 8.1.02 angeworfen. Da muss schon einiges geklickert werden bis es läuft. Insbesondere im Fenster links-oben ist auf
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Schaltplan für Digitale Uhr gesucht
man auch einen CPLD nehmen und darin dann Logischaltungen bequem einprogrammieren. Z.B. den Xilinx XC9572 im PLCC-44 kann man mit Sockel auf ne Rasterplatine pappen.
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ghdl = compiler&simulator?
executables dann in einen cpld/fpga reindrücken? wenn ja, kann mir jemand sagen, wie ich das z.b. bei nem xc9572 machen kann? hab jetzt schon sooo viel gegoogelt, doch nix dergleichen gefunden! thx tüddel