Suchergebnisse für ""AD7356""

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17 Treffer für "AD7356" Suchergebnisse für ""AD7356""

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    TEM_uni_5_adc_stream.vhd

    => AD7356_12_SDO_A, AD7356_SDO_B => AD7356_12_SDO_B); AD7356_34: AD7356 port map( clk80 => clk80, data_ready => AD7356_34_data_ready, data_a => AD7356_3_data, data_b => AD7356_4_data, AD7356_nCS => AD7356_34_nCS, AD7356_SCK => AD7356_34_SCK, AD7356_SDO_A => AD7356_34_SDO_A, AD7356_SDO_B => AD7356_34_SDO_B); AD7356_56: AD7356 port map( clk80 => clk80, data_ready => AD7356_56_data_ready, data_a => AD7356_5_data, data_b

    in „Wie Clockdomain crossing für FT232H, wie debuggen?“ · FPGA, VHDL & Co. ·

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    Wie Clockdomain crossing für FT232H, wie debuggen?

    Code drin habe um die Quelle auszuwählen: [vhdl] case ADC_select is when "001" => ADC_data <= AD7356_1_data; ADC_data_ready <= AD7356_12_data_ready; when "010" => ADC_data <= AD7356_2_data; ADC_data_ready <= AD7356_12_data_ready; when "011" => ADC_data <= AD7356_3_data; ADC_data_ready <= AD7356_34_data_ready; when "100" => ADC_data <= AD7356_4_data; ADC_data_ready <= AD7356_34_data_ready; when "101" => ADC_data <= AD7356_5_data; ADC_data_ready <= AD7356_56_data_ready; when "110" => ADC_data <= AD7356_6_data; ADC_data_ready <= AD7356

    FPGA, VHDL & Co. ·Gustl B. · ·2 Antworten

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    TEM_uni_5_adc_stream_bench.vhd

    LED_o: out std_logic; -- FT232RL UART FT232RL_RX: in std_logic; FT232RL_TX: out std_logic; -- ADCs AD7356_12_nCS: out std_logic; AD7356_12_SCK: out std_logic; AD7356_12_SDO_A: in std_logic; AD7356_12_SDO_B: in std_logic; AD7356_34_nCS: out std_logic; AD7356_34_SCK: out std_logic; AD7356_34_SDO_A: in std_logic

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    ADUM_AD7356.vhd

    library IEEE; use IEEE.STD_LOGIC_1164.ALL; use ieee.numeric_std.ALL; entity ADUM_AD7356 is Port( clk80 : in std_logic; data_ready : out std_logic; data_a : out std_logic_vector(11 downto 0); data_b : out std_logic_vector(11 downto 0); AD7356_nCS : out std_logic; AD7356_SCK : out std_logic; AD7356_SDO_A : in std_logic; AD7356_SDO_B : in std_logic); end ADUM_AD7356; architecture Behavioral of ADUM_AD7356 is signal counter :unsigned(3 downto 0):=(others => '0'); signal data_buffer_a, data_buffer_b

    in „Wie Clockdomain crossing für FT232H, wie debuggen?“ · FPGA, VHDL & Co. ·

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    AD7356.vhd

    library IEEE; use IEEE.STD_LOGIC_1164.ALL; use ieee.numeric_std.ALL; entity AD7356 is Port( clk80 : in std_logic; data_ready : out std_logic; data_a : out std_logic_vector(11 downto 0); data_b : out std_logic_vector(11 downto 0); AD7356_nCS : out std_logic; AD7356_SCK : out std_logic; AD7356_SDO_A : in std_logic; AD7356_SDO_B : in std_logic); end AD7356; architecture Behavioral of AD7356 is signal counter :unsigned(3 downto 0):=(others => '0'); signal data_buffer_a, data_buffer_b : std_logic_vector

    in „Wie Clockdomain crossing für FT232H, wie debuggen?“ · FPGA, VHDL & Co. ·

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    TEM_uni_5_adc_stream.vhd

    => AD7356_12_SDO_A, AD7356_SDO_B => AD7356_12_SDO_B); AD7356_34: AD7356 port map( clk80 => clk80, data_ready => AD7356_34_data_ready, data_a => AD7356_3_data, data_b => AD7356_4_data, AD7356_nCS => AD7356_34_nCS, AD7356_SCK => AD7356_34_SCK, AD7356_SDO_A => AD7356_34_SDO_A, AD7356_SDO_B => AD7356_34_SDO_B); AD7356_56: AD7356 port map( clk80 => clk80, data_ready => AD7356_56_data_ready, data_a => AD7356_5_data, data_b

    in „Wie Clockdomain crossing für FT232H, wie debuggen?“ · FPGA, VHDL & Co. ·

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    synth 8-6014

    removed. ["D:/vhdl/TEM_uni_5_stream_2017/TEM_uni_5_stream.srcs/sources_1/imports/sources_1/ADUM_AD7356.vhd":25] Leider steht da eben nicht mehr dabei. Das sind alles Signale die mir im Vivado 2016.4 erhalten bleiben denn die sind auch notwendig. Ich wüsste gerne warum das jetzt rausfliegt.

    FPGA, VHDL & Co. ·Gustl B. · ·2 Antworten

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    Analog- und Digital-Teil bestmöglich trennen

    hast Du einen Operationsverstärker vor dem ADC? Aber weil ich ja auch schon mit 12 Bit ADCs (AD7356) gebastelt habe: Board wird versorgt mit 5V, dann zwei LDOs, beide 3,3V, einer für alles was digital ist und einer für den Analogteil. Direkt am ADC noch Kondensatoren, ich habe je Versorgungs Pin

    Platinen ·Alex K. · ·16 Antworten

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    VIVADO 2017.1

    adc_stream.vhd:206] [vhdl]with ADC_select select ADC_data <= fifo_counter when "000", AD7356_1_data when "001", AD7356_2_data when "010", AD7356_3_data when "011", AD7356_4_data when "100", AD7356_5_data when "101", AD7356_6_data when "110", fifo_counter when "

    FPGA, VHDL & Co. ·Gustl B. · ·23 Antworten

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    ADC allgemein Ansprechwahrscheinlichkeit

    ist, dass da horizontale Linien drinnen sind. In Y Richtung ist der ADC Wert, das ist ein 12 Bit AD7356 bei dem hier die werte von 2048 ... 4095 aufgetragen sind in Y-Richtung (bipolare Beschaltung, unipolares Signal am Eingang). Jedenfalls ist die Y-Position nicht irgendwie interpoliert, sondern jede

    Aha, vielen Dank! Hier http://www.analog.com/media/en/technical-documentation/data-sheets/AD7356.pdf Seite 8 Figure 4 zeigt auch so Linien. Ist es das?

    Mikrocontroller und Digitale Elektronik ·Gustl B. · ·5 Antworten

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    Programmable Gain Amplifier

    Hallo, ich möchte immer noch DC Spannung mit einem AD7356 digitalisieren. Am Ende brauche ich ein differentielles Signal zwischen 0 und 2.048V symmetrisch um 1.024V. Wie man das macht weiß ich aber bereits. Meine Eingangsspannung der Quelle ist wie gesagt

    Analoge Elektronik und Schaltungstechnik ·Gustl B. · ·8 Antworten

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    Ein weiteres ADC Board für Trenz Electronic FPGA Modul

    ich habe weitergebastelt. Dieses Mal ging es mir um die Schaltung vor den ADCs. Verbaut sind drei AD7356 5MSample/s 12Bit SPI und an den Eingängen soll eine Spannung von 0V bis +12V erfasst werden können. Im Anhang Fotos, das Eagle .brd und .sch, das habe ich aber leicht anders bestückt. Wie es bestückt

    Projekte & Code ·Gustl B. · ·9 Antworten

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    ADC Frontend für Unipolar Single-Ended 0-12V Signal

    dabei eben keine zusätzlichen Störungen einbringen. Marcus H. schrieb im Beitrag #4925319: > AD7356 Datenblatt p.10 "Terminology": > - Lesen, verstehen, quantisieren. > - vor dem nächsten Post mindestens SNR / BW festlegen Was auch immer. Mir geht es hier nicht um den ADC, der ist gut genug

    Wie kommst Du eigentlich auf diesen komischen AD7356? Der scheint ja einen speziellen differentiellen Treiber zu benötigen. Sowas ist mir bisher noch nie untergekommen. Ich würde sowas auch nicht freiwillig einsetzen. Der ist ja nichtmal preisgünstig

    Analoge Elektronik und Schaltungstechnik ·Gustl B. · ·65 Antworten

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    Rauschen.pdf

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    in „Noch ein ADC Board für Trenz Electronic FPGA Modul“ · Projekte & Code ·

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    Noch ein ADC Board für Trenz Electronic FPGA Modul

    AD7356 ch A: Vocm sollte 1.024V sein, bei dir ist aber 1.8 ! U4 pin 2 sollte so 1V sein, und R23 linke seite sollt nach GND mit ähnlcihen impedance als das zeug zu X3 AD7356 ch B: hier ist gar kein common mode schaltung? R35 untere ende sollta am 1V liegen dh nach deiner schaltung MUSS von AD7356 von BEIDEN kanalen diese oberwellse das sein.. was man auch sieht.

    Projekte & Code ·Gustl B. · ·48 Antworten

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    Arduino und externer ADC über SPI

    Hallo, ich hab einen Arduino Due und möchte damit einen AD7356 auslesen. Hält man den CS Pin länger auf low werden die Daten von beiden Kanälen des ADC auf einem SPI MISO ausgegeben, mit meinem Code versuche ich das so hinzubekommen aber es werden aber nur nullen

    Mikrocontroller und Digitale Elektronik ·name123 · ·16 Antworten

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    verschiedene Spannungen mit einem ADC messen

    2,7V Ufet = 4V als Spannungen die über den Bauteilen abfallen können. Als ADC hab ich den AD7356 mit 2 differentiellen Eingängen für die Messung von UL und Ushunt. Der ADC kann jedoch nur 2V p-p messen und deshalb muss ich mein Messignal dem Messbereich anpassen, ich hatte zuerst an sowas wie

    Analoge Elektronik und Schaltungstechnik ·Bias · ·0 Antworten