Zustandsautomat+register problem

[VHDL_Bginner (Gast)]

Moin!
Ich habe ein zustandsautmat von 2 zustaenden(S0,S1) in Vhdl geschrieben.
:
signal reg_bit:std_logic_vector(2 downto 0):="00";
First:process(clk)
begin
if rising_edge(clk) then
   zustand<= folge_z;
end if;
end process First;

SECOND:process(x,zustand)
begin
when S0 => if x='1' then

            folge_z<=S0;
          else
            folge_z<=S1;
          end if;
when S1 =>reg_bit<= reg_bit(1 downto 0) & data;--Data im register 
speichern
           ausgabe<=reg_bit
           folge_z<=S0;
end case;
end process Second;
:
Mein problem liegt darin, dass ich wenn im zustand S1 für erte mal bin, 
kann ich kein data in meinem register speichern,aber das passiert erst 
beim dem zweiten mal wenn ich S1 wieder erreiche.Was hab ich falsch vh 
in meinem code gemacht?
mfg

[Föntöter (Gast)]

Kommen die Daten synchron rein?
Wenn nicht, musst du sie synchronisieren:

process(clk)
  begin
    if rising_edge(clk) then
      data_synch1 <= data;
      data_synch2 <= data_synch1;
    end if;
  end process;

Und warum machst du die Statemachine nicht direkt synchron:

process(clk)
  begin
    if rising_edge(clk) then
      case zustand is

        when S0 => 
          if x='1' then
            zustand<=S0;
          else
            zustand<=S1;
          end if;
          
        when S1 =>
          reg_bit<= reg_bit(1 downto 0) & data_synch2;--Data speichern
          ausgabe<=reg_bit
          zustand<=S0;
      end case;
    end if;
end process;

[lkmiller (Gast)]

Das geht schon im Simulator schief, weil im SECOND-process
das Signal data nicht in der Sensitivity-List steht.

Das eigentliche Problem liegt aber darin,
dass die Beschreibung des Schieberegisters

reg_bit <= reg_bit(1 downto 0) & data;

kombinatorisch ist und somit
unendlich schnell und andauernd
während zustand=S1 ausgeführt werden müsste.

So eine Hardware kann nicht erzeugt werden.

Eine Zuweisung in ein Schieberegister muss immer mit einem Takt
erfolgen, weil ein Schieberegister ja aus FFs besteht.