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Forum: FPGA, VHDL & Co. Widerstände im FPGA als Abschluss nutzen?


Autor: Bustle (Gast)
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Hallo ihr,

im Constrains file kann ich ja Widerständen einzelnen IOs zuordnen. Ist 
dies auch über die Logik möglich?

Hintergrund ist der...
...mehrere FPGAs kommunizieren über differenzielle IOs und nur der 
letzte in der Reihe sollte die Abschlusswiederstände bereitstellen.

Danke, Gruß,
Bustle

Autor: Morin (Gast)
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> Ist dies auch über die Logik möglich?

Meines Wissens nach kannst du die Widerstände in den HDL-Dateien an- 
oder ausschalten, indem du die IOBs explizit instanziierst, und dann 
über Generic-Parameter angibst, was du genau haben willst. Das hat dann 
aber den gleichen Effekt wie bei Constraints, also insbesondere kannst 
du die Widerstände nicht im laufenden Betrieb dazu- oder wegschalten.

Autor: Bustle (Gast)
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...mmh, ich bräuchte es im laufenden Betrieb.

Falls jemand hier noch was einfällt oder meine Frage nicht ganz 
eindeutig ist, wäre ich über einen Hinweis froh.

Autor: Falk Brunner (falk)
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@  Bustle (Gast)

>...mmh, ich bräuchte es im laufenden Betrieb.

Geht AFAIK nicht.

Wenn deine FPGAs nicht steckbar auf Modulen sind ist das auch unnötig. 
Und wenn doch, dazu hat der liebe Gott einen steckbaren Terminator 
erfunden ;-)

MFG
Falk

Autor: Bustle (Gast)
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Danke

Autor: Gast (Gast)
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Zweiten Pin parallel, der einen Terminator steuert.

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