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Forum: FPGA, VHDL & Co. Aus BIDIR wurde OUT


Autor: paul (Gast)
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Hallo Forum,

Meine Bidirektionale(inout) ports wurden plötzlich als outs in portout 
report. In View Technologie Schematic werden diese auch als OUT's 
angezeigt. Wie konnte das sein? In der Entity wurden diese als inout 
deklariert. Liegt das am Code? Wie kann ich diese als Inout 
instanziieren?
Brauche Hilfe

Danke im Vorraus

Autor: Christian R. (supachris)
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Benutzt du denn den Eingang auch im Design? Und schaltest du die Pins 
dazu in Tristate? In Schematic bei Xilinx muss an jedem BIDIR ein IOBUF 
oder IOBUFDS sein, sonst wirds ein Out nachher. In VHDL gehts natürlich 
mit der 'Z' Zuweisung in Tristate zu schalten, damit der nicht mehr 
treibt

Autor: Duke Scarring (Gast)
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Suchst Du eine Beschreibung für einen Tristate-Treiber?
out_sig <= intern_sig when enable='1'  else  out_sig <= 'Z';

Duke

Autor: Lothar Miller (lkmiller) (Moderator) Benutzerseite
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> Liegt das am Code?
Ja, vermutlich.
Aber leider kann dir keiner weiterhelfen, solange du deinen Code geheim 
hältst.

Autor: paul (Gast)
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Danke für die Hilfe. Hat sich somit erledigt. War ein 
Implementierungsfehler meinerseits. Habe gedacht, dass der Bus das 
erkennen soll.
Vielen Dank

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