Forum: FPGA, VHDL & Co. Optimierung durch mehrmaliges Synthetisieren?


von X. O. (overflow)


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Hallo,

ich arbeite mit Precison von Mentor Graphics. Die Synthese läuft soweit 
auch ganz gut. Beim Synthetisieren ist mir aber etwas bzgl. 
Logikverbrauch aufgefallen was ich nicht ganz nachvollziehen kann bzw. 
nicht weiß ob das überhaupt sein darf.

Beim ersten Mal synthetisieren verbraucht mein Design ca. 35000 FF; 
synthetisiere ich ein zweites Mal reduziert sich der Verbrauch nochmals 
deutlich und es werden nur mehr ca. 30000 FF verbraucht(Die Rechenzeit 
für die Synthese sinkt um ca. die Hälfte). Ein weiteres Synthetisieren 
bringt dann nichts mehr.
Der theoretisch von mir errechnete Hardwareverbrauch liegt zwar noch 
darunter,deshalb wäre es schon möglich das da noch was eingespart wird, 
trotzdem frage ich mich warum das so ist und warum das nicht schon beim 
Ersten mal synthetisieren soweit optimiert wird, dass der endgültige 
Verbrauch rauskommt.
Gibt es eine plausible Erklärung dafür oder dürfte das so nicht 
passieren?

Grüße
Fabian

von Mathi (Gast)


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Führst Du eine inkrementelle Synthese durch?
Synthetisierst Du zweimal das exakt gleiche Design?

von Xenu (Gast)


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Ich arbeite nicht mit Mentor, aber es könnte sein, dass er das erste 
Ergebnis abspeichert und beim zweiten Mal andere (aufwendigere) 
Optimierungen benutzt.

von X. O. (overflow)


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Ja, wenn die erste Synthese durch ist starte ich direkt ohne was zu 
ändern den zweiten Durchlauf.

von Mathi (Gast)


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Normalerweise muss man die inkrementelle Synthese extra aktivieren. Dann 
nimmt er das Ergebnis der vorherigen Synthese und orientiert sich daran 
für die neue. Falls Du die irgendwie aktiviert hast, könnte das eine 
Erklärung für dieses Verhalten sein.

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