XML Parser für VHDL Simulation

OP #2170025
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Hallo,

für die Simulation gibt es ja in VHDL auch FileIO Funktionen. Für meine 
Zwecke wäre es von Vorteil, wenn ich bestimmte Informationen aus einer 
XML-Datei lesen könnte.
Jetzt meine Frage, gibt es sowas wie einen XML Parser für VHDL? Mit 
file_open und readline etc. wär es wahrscheinlich ziemlich mühevoll die 
Informationen aus der XML rauszubekommen...

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