VHDL

Gast #201866
Lesenswert?

Autor: mazin - mazinalnoorcompuserve.de
Datum: 19.11.2004 22:18

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Hallo,
ich möchte jemand mir helfen,
meine Frage ist?
Wie kann man  das folgende analoge Bauelement in VHDL-Altera Quartus
4.1 porogrammiern?
1-  Amplifeir 16  (Gain) = 4 Bit
2-  Amplifier 1/512
3-  Delay Tim (∆T=25us)
4-  Plus (+)

Danke
Al noor

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