Forum: FPGA, VHDL & Co. Vivado Custom AXI4-Stream peripheral


Vivado Custom AXI4-Stream peripheral
von Tux T. (tuxtech)

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Hallo,

ich versuche eine VHDL-Komponente mit AXI4-Stream-interface (Master) zu 
entwickeln. Habe im IP-Packager also eine Komponente erstellt und dann 
wurde automatisch ein (relativ umfangreiches) AXI4-Stream interface 
generiert.
Leider bin ich mir jetzt nicht sicher, wie ich dieses verwenden muss, 
also wo ich meine zu sendenden Daten da anlegen muss.
Ist es sinnvoll das so zu machen, oder lieber das Interface selber 
(simpler) schreiben?

Gruß

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