Hallo, ich mache echt Fortschritte mit dem FPGA & VHDL, vergangene Nacht habe ich das BRAM zum laufen gebracht :-). Mit meinen eigenen Libs klappts mittlerweile auch super... Als nächstes kommt der DCM dran, da geht wohl das WE drauf... Aber mal eine Zwischenfrage zum Simulator, ich finde keine Möglichkeit Signale direkt im Simulator anzuschauen. Ich kann immer nur ports anschauen Z.B.: signal EN: std_logic := '1'; -- Sehe ich im Sim nicht Das Signal EN würde ich gerne im Simulator anschauen. Ich muss dass immer so umständlich machen, indem ich das Signal auf einen Port mappe. Ein Port wird ja automatisch im Simulator abgedatet. Ihr habt bestimmt eine Idee wie das eleganter funktioniert, Sebastian
Welcher Simulator? Welcher Baustein? Da weiß man ja nicht mit was du arbeitest.
Wahrscheinlich hast du im simulationview nicht die entity ausgewählt in der dieses Signal vorkommt. Also im Modelsim Hauptfenster gibt es 3(?) Ansichten, siehe reiter unterhalb linken teilfenster, dort simulation (?) auswählen. Dann zeigt er dir die oberen Module, die anklicken und er zeigt er die SubModule in diesem Module. Im Signalfenster erscheinen dann die signale im gewählten Modul. Falls ich sicher weiss, welchen Simulator du meinst, kann ich ja mal einen Scheibenschuss posten.
Danke für die Antworten, @FPGAküchle mit Deiner Beschreibung bin ich weitergekommen. Im Modelsim kann ich mir nun alle Signale anschauen :-) Normal simuliere ich immer nur in der PackageSim.ise. Darin habe ich es nicht geschafft die Signalzustände anzeigen zu lassen. Vielleicht hat ja dazu auch noch jemand eine Idee. Sebastian
#Normal simuliere ich immer nur in der PackageSim.ise. Darin habe ich es #nicht geschafft die Signalzustände anzeigen zu lassen. Vielleicht hat ja #dazu auch noch jemand eine Idee. Kenn ich nicht, haste mal nen Codeschnipsel?!
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