VHDL Doku

Chris Gast #388683
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Hallo,
in meinem Praxissemester arbeite ich mit Xilinx ISE ,
meine Hauptaufgabe ist also VHDL Beschreibungen.
Da ich wahrschienlich nicht der erste bin der das macht, würde mich
interessieren wie ihr eure Doku so gestaltet habt ? ...
einfach die Simulationsergebnisse von ModelSim, als ps exportiert und
dann später in irgendein Bildformat konvertiert ?
Habt ihr alle SM von Hand gezeichnet, oder gibt es da Tools ? ....

eigentlich eine ganz allgemeine Frage, wie dokumetiere ich am bestem
meinem VHDL Code ?

Danke für Tipps ...
  Chris
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Tobias O. Gast #388684
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Am besten so ausführlich wie möglich.

Schriftliches Gesamtkonzept und Vorüberlegungen.
Darstellung des Gesamtdesigns als Blockschaltbild.
Kurze Beschreibung der Aufgaben der Module.
Verdrahtung der Module untereinander.
Je nach dem was sich besser eignet Funktionsweise der Module -
Darstellung als Statemaschine oder Flußdiagramm. Die textuelle
Beschreibung darf hierbei natürlich nicht fehlen. Dabei darauf achten
nicht zu sehr ins Detail zu gehen um den Leser nicht zu verwirren.
Als Abschluss könnte dann ein Auszug aus einer Waveform von Modelsim
folgen. Wobei nicht zu viele Signale sichtbar sein sollten und du
anhand von Markern bestimmte Zeitpunkte innerhalb der Simulation
Markieren solltest und erklärst was dort passiert.

Achte darauf, dass das ein fremder Lesen und Verstehen soll. Er muss in
der Lage sein zu verstehen was dort ungefähr passiert.
Im Anhang befinden sich Bilder mit Beispielen an denen du dich
orientieren kannst.

Gruß Tobias
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