Forum: FPGA, VHDL & Co. CY7C68001 <=> CPLD


CY7C68001 <=> CPLD
von Bustle (Gast)

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Hallo ihr,

hat jemand von euch schon mal versucht den CY7C68001 mit einem CPLD
anzusteuern?

Ich hänge immer wieder an dem Punkt, dass ich ein Schreibzugriff
(momentan Synchron) mache und der CY7C68001 diesen nicht erkennt, also
das Ready Signal nicht runter zieht.

Vielleicht habt ihr ja einen Tipp und evtl. schon mal so ein ähnliches
Problem.

Danke

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Re: CY7C68001 <=> CPLD
von Bustle (Gast)

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Puh,

hab den Fehler gefunden. Ein Via ist nicht richtig durchkontaktiert und
daher komische Effekte hervorgerufen... => Drahtbrücke :-(

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