Mehrere Hierarchiestufen instanziieren.

shockwaverider Gast #685476
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Hallo Leute,

ich hätte da mal eine kurze Frage an euch. Ich bin gerade dabei die 
einzelnen Komponenten meines ersten größeren VHDL-Projekt in meiner 
Top-Level Datei zu instanziieren und dann zusammenzuschalten. So weit so 
gut. Mein Problem ist nun, dass eine der zu instanziierenden Komponenten 
selber wiederum eine Instanz einer VHD-Datei besitzt. Nun spuckt mir ISE 
bei der Erstellung der Component dieser niederen Top-Level-Datei in 
meiner Haupt-Top-Level Datei folgende Fehlermeldung aus:

HDLParsers:164 parse error, unexpected COMPONENT, expecting END

Heißt das also, man darf in seiner Top-Level-Datei keine Component 
erzeugen, die ihrerseits wiederum über eine eingebaute Component 
verfügen?

Ich hoffe ich habe mich einigermaßen verständlich ausgedrückt? Habt 
Nachsicht, bin noch rel. blutiger Anfänger auf diesem Gebiet.

Vielen Dank im voraus!
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shockwaverider Gast #685480
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Hi Karl,

danke für den Tip. Hatte einfach bloß an einer Stelle vergessen die zwei 
entscheidenen Wörter end component; hnzuschreiben :-/

Ich denke, jetzt müsste es gehn.

Nochmals besten Dank!
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shockwaverider Gast #686101
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Hallo nochmal,

ich hab jetzt das Problem, dass unter der Ansicht 
"Synthesis/Implementation"
in ISE die VHD Datei (z.B. A.vhd), die ihrerseits als Component in einer 
übergeordneten Top_Level Datei (z.B. B.vhd) eingebunden und dort 
instanziiert wird, nicht richtig in die höchste Top_Level Datei 
(main.vhd) eingebunden wird. Stattdessen findet sie sich einzeln über 
der main angeordnet. Außerdem weisen die aus der Datei B.vhd gebildeten 
Instanzen jeweils in ihrem Symbol ein Fragezeichen auf. Ich habe 
irgendwie noch nicht so recht kapiert, wie man in die Top-Entity des 
Designs eine Komponente einbinden kann, die ihrerseits wiederum eine 
weitere Komponente besitzt. Oder könnten diese Fragezeichen auch noch 
eine andere Bedeutung haben?

Ich hoffe, ich hab euch nicht allzu sehr verwirrt? :-)

Danke!
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