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Forum: FPGA, VHDL & Co. Signal will be lost - Fehlermeldung


Autor: Manuel (Gast)
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Hallo ihr Lieben,

habe eine Frage an euch.

Ich habe eine Synthese mit Xilinx WebPack machen lassen und unter 
anderem werden bedenkliche Fehlermeldungen ausgegeben. Kann mir von euch 
jemand sagen, was mir dieser Fehler sagen soll?

WARNING:Xst:638 - in unit Data_IO_tester Conflict on KEEP property on 
signal 
A01/B03/C04/D04/E11/F16/Mtridata_Filter_BlockRAM_Multiplexer_ctrl_1 and 
A01/B03/C04/D04/E11/F16/Mtridata_Filter_BlockRAM_Multiplexer_ctrl_0 
A01/B03/C04/D04/E11/F16/Mtridata_Filter_BlockRAM_Multiplexer_ctrl_0 
signal will be lost.

Ich danke euch für die Hilfe.

Bis bald

Gruß Manuel

Autor: Morin (Gast)
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Naja klingt ganz so als wolltest du beide Signale (_0 und _1) KEEPen 
wollen und das Synthesetool kommt damit nicht klar, und wählt 
willkürlich aus das _0 zu schlucken und das _1 zu KEEPen.

Hatte diese Meldung aber bisher nie, deshalb ist es nur eine Vermutung.

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