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Forum: FPGA, VHDL & Co. Probleme mit Input


Autor: Thomas Pototschnig (pototschnig)
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Hallo,

in einem Design hab ich aus Pinmangel versucht ein normales Input Signal 
auf einen GCLK/I zu legen. Der FPGA ist ein XC2S50.

Beim Implementieren meckert mich das Tool an:
ERROR:Pack:1107 - Unable to combine the following symbols into a single IOB
   component:
     PAD symbol "HEX<0>" (Pad Signal = HEX<0>)
     BUF symbol "HEX_0_IBUF" (Output Signal = HEX_0_IBUF)
   Each of the following constraints specifies an illegal physical site for a
   component of type IOB:
     Symbol "HEX<0>" (LOC=P88)
   Please correct the constraints accordingly.

Weiß jemand, wie man den dazu überreden kann das Signal trotzdem an den 
Pin zu routen? Oder geht das gleich überhaupt nicht?

Autor: Thomas Pototschnig (pototschnig)
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Lösung gefunden:
The GCLK IOs can only use IBUFGs, so the tool is unable to pack a IBUF
into the IOB. To work around this issue, specify that the net use an 
IBUFG. This can be done by instantiating it in your code or adding a
BUFFER_TYPE constraint to your code with the value set to IBUFG. 
The syntax for these can be found in the Software Manuals. 

Mfg
Thomas Pototschnig

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