Guten Abend zusammen,
ich habe eine SPI Kommunikation mit einem F2274 als Master aufgebaut. Es
werden lediglich CLK bzw. MOSI verwendet, CS wird separat geschaltet und
vom Slave wird nicht gelesen. Der inaktive clock Zustand ist low, die
Daten sollen vom Slave auf steigender Flanke übernommen werden (UCCKPH
gesetzt).
Das klappt alles auch soweit, lediglich das Warten auf das Ende der
Übertragung funktioniert nicht wie gewollt. Ohne die unten eingefügte
for()-Schleife dreht der Master dem Slave unmittelbar nach der letzten
(16.) steigenden Flanke den CS ab. Damit geht die Übertragung schief,
weil das Software-SPI im Slave zwar schnell ist, den Portzustand aber
auch nicht in der Zeit Null lesen kann.
So wie ich das BUSY-Flag interpretieren würde sollte es erst
zurückgesetzt werden, wenn die Übertragung beendet, sprich CLK wieder
low ist. Verstehe ich hier etwas falsch oder bräuchte TI einen weiteren
Eintrag im Errata-Sheet?
Beste Grüße,
odic
1 | // select slave
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2 | d_SpiSlaveCS_1();
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3 |
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4 | // write command byte
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5 | UCB0TXBUF = t_Data_UB;
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6 |
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7 | // wait till TX buffer is empty
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8 | while(UCB0TXIFG != (IFG2 & UCB0TXIFG)){;}
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9 |
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10 | // write checksum
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11 | UCB0TXBUF = (UBYTE)~t_Data_UB;
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12 |
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13 | // wait till TX buffer is empty
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14 | while(UCB0TXIFG != (IFG2 & UCB0TXIFG)){;}
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15 |
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16 | // wait till transmission is completed
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17 | while(UCBUSY == (UCB0STAT & UCBUSY)){;}
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18 |
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19 | // wait before disabling CS (waiting for BUSY flag doesn't have the effect as expected)
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20 | for (i=0;i<600;i++){;}
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21 |
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22 | // deselect slave
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23 | d_SpiSlaveCS_0();
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