MSP430: Maximale Taktfrequenz mit internem Oszi

Hab folgendes Code-Beispiel gefunden:

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//  MSP-FET430P430 Demo - FLL+, Runs Internal DCO at 8MHz

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//

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//  Description: This program demostrates setting the internal DCO to run at

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//  8MHz with auto-calibration by the FLL+.

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//  ACLK = LFXT1 = 32768Hz, MCLK = SMCLK = DCO = (121+1) x 2 x ACLK = 7995392Hz

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//  //* An external watch crystal between XIN & XOUT is required for ACLK *//  

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//

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//                 MSP430FG439

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//             -----------------

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//         /|\|              XIN|-

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//          | |                 | 32kHz

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//          --|RST          XOUT|-

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//            |                 |

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//            |             P1.1|--> MCLK = 8Mhz

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//            |                 |

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//            |             P1.5|--> ACLK = 32kHz

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//            |                 |

19

//

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//  M. Buccini

21

//  Texas Instruments Inc.

22

//  Feb 2005

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//  Built with IAR Embedded Workbench Version: 3.21A

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#include  <msp430xG43x.h>

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void main(void)

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{

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  WDTCTL = WDTPW + WDTHOLD;                 // Stop watchdog timer

30

  SCFI0 |= FN_4;                            // x2 DCO freq, 8MHz nominal DCO

31

  SCFQCTL = 121;                            // (121+1) x 32768 x 2 = 7.99 Mhz

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  FLL_CTL0 |= DCOPLUS + XCAP18PF;           // DCO+ set so freq= xtal x D x N+1

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  P1DIR = 0x22;                             // P1.1,5 to output direction

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  P1SEL = 0x22;                             // P1.1,5 to output MCLK & ACLK

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  while(1);                                 // Loop in place

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}

Was ich nicht ganz Check... oben steht "Runs Internal DCO at 8MHz". 
Gleichzeitig wird aber bei XIN/XOUT ein 32kHz Quarz angehängt. Ist 
dieses Beispiel nun mit externem oder internem oszi?

danke
klaus

> Ist dieses Beispiel nun mit externem oder internem oszi?
Ich würde mal sagen beides. In der Regel wird der externe 32kHz dazu 
benutzt den internen exakt einzustellen. Ich nehme mal an das das bei 
diesem Beispiel auch so ist (// (121+1) x 32768 x 2 = 7.99 Mhz)

Hab den jetzt mal nach dem Beispiel eingestellt. Aber mein SPI clock ist 
immer noch so langsam. Ca. 5kHz und auch kein schöner Rechteck. Es 
werden so komische positive und negative Flanken ausgegeben.

Die Register für den SPI-Takt hab ich folgendermassen initialisiert:

 UBR00 = 0x02;                         // UCLK/2
 UBR10 = 0x00;


Müsste dann doch bei einem CPU-Clock von 4MHz ein 2MHz Takt ergeben. Und 
nicht 5kHz...

Mit SSEL0 und SSEL1 werden ja die Source für den Vorteiler gewählt. Da 
kann man zwischen UCLKI, ACLK und SMCLK wählen. Was ist der Unterschied 
zwischen diesen drei?

Der MSP430 hat grundlegend 3 Takt-"Stränge".
- ACLK
- MCLK
- SMCLK
ACLK und SMCLK sind eigentlich überall verfügbar. Daneben gibt es noch 
Peripherie bezogene Taktquellen wie eben der UCLKI.
Für den Anfang solltest du für dein SPI den SMCLK nehmen. Ist das 
einfachste.

Also bei obigem Beispiel, mit internem Oszi, beträgt die MCLK Frequenz 
3MHz. Sie sollte aber 8MHz betragen. Jemand eine Idee wieso?

Hat niemand eine Idee warum die Frequenz nur 3MHz beträgt?

Beim Beispiel steht:

MCLK = SMCLK = DCO


Den MCLK hab ich an Port P1.1 gemessen. Der ist 3MHz.
Der SPI-Takt sollte SMCLK/2 sein und der ist 1.5MHz.

>Womit misst du das eigentlich?
Mit einem KO, das stimmt schon.


>Ist denn der
>Uhrenquarz richtig angeschlossen und hat er auch wirklich 32,768kHz?

Wie gesagt, ich hab kein Uhrenquarz. Ich wollte ihn nur mit internem 
Oszi takten. Geht das überhaupt bei der Frequenz? Wie hoch kann ich ihn 
denn maximal intern takten?

Ohne Uhrenquarz hilft nur Try and Error. Solange an den Register-Werten 
spielen bis es passt.