Xilinx CoreGEN: Wo sind die Sinustabellen hin?

Gast #1685893
Lesenswert?

Ich habe vor 3 Jahren in einem Projekt eine Funktion genutzt, welche 
mittels CoreGen ein internes Block-RAM oder distributet RAM, bzw ROM als 
Sinustabelle nutzen konnte. Der Core belegte die Tabelle automatisch 
nach Vorgaben. Ich finde diese Funktion aber nirgens im aktuellen 
CoreGen.

Ich finde nur den CORDIC-Algo, aber der war es nicht.

Jemand eine Idee?

Antwort schreiben

Bitte melde dich an, um einen Beitrag zu schreiben.

oder

Mit Google-Account einloggen

Die Registrierung ist kostenlos und dauert nur eine Minute.

Jetzt registrieren