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Fehlersuche
damit beliebig langsam getaktet werden kann. Man muss nur beachten, dass dadurch die Busleitungen mit den Open Drain Ausgängen nicht zu sehr belastet werden. Am Besten schließt man diese Test-LEDs ebenfalls invertiert an
ist einfacher als sehr viele Änderungen auf einmal durchzuführen und danach zu testen. Siehe auch. AVR Checkliste Forumsbeitrag: Protokoll eines unbekannt Display mittels Chaosangriff entziffern Links. Analog Circuits (World Class Designs) ISBN 978-0750686273, eine Zusammenstellung von verschiedensten
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FPGA
festgelegt und damit bekannt sind. Insbesondere bei langsamen sequentiellen Aufgaben (Benutzerinterface, komplexe Steueraufgaben etc.) wird gerne auf eine klassische CPU zurückgegriffen, weil ein eventueller Zeitnachteil wegfällt, aber das Testen des Systems
SERDES-Transceiver für mittelpreise FPGAs ohne SERDES / sehr hohe Frequenzen Camera-Link-Deserializer (für langsame FPGAs) LVDS-Buffer-Deserializer (für langsame FPGAs ohne LVDS buffer) DVI-Buffer Für Analoge Daten benötigt man selbstredend noch Video-ADCs / Video-DACs, die überhaupt erst ein digitales Signal erzeugen
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STM32
STM32F479 und vieles mehr ... Struktur der Dokumentation. Die Dokumentation der STM32 ist im Vergleich zur AVR-Familie umfangreicher und komplexer. Sie teilt sich in mehrere Dokumente auf. Als Beispiel der Dokumentation soll stellvertretend der STM32F103RC genannt werden. Die Seite von ST beinhaltet alle nötigen
und prinzipiell auch andere Cortex-M benutzt werden kann. Zwar ist er mit 1.8MHz Takt ein sehr langsamer Vertreter seiner Art, jedoch lassen sich mit ihm fremde Hex- und Binary-Files sowohl Debuggen als auch Flashen. Die ST-LINK-Variante auf den Nucleo- bzw. Discovery-Boards beherrscht nur SWD und kein